[实用新型]一种可重构I/O芯片无效
申请号: | 200920129919.5 | 申请日: | 2009-02-18 |
公开(公告)号: | CN201383145Y | 公开(公告)日: | 2010-01-13 |
发明(设计)人: | 江俊逢 | 申请(专利权)人: | 江俊逢 |
主分类号: | G06F13/38 | 分类号: | G06F13/38 |
代理公司: | 深圳鼎合诚知识产权代理有限公司 | 代理人: | 龚安义 |
地址: | 518000广东省深圳市罗湖*** | 国省代码: | 广东;44 |
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摘要: | 本实用新型公告了一种可重构I/O芯片,包括基于FPGA技术且装载有固件化微控制程序的微程序控制器;与微程序控制器连接的FIFO缓存器;与FIFO缓存器连接的数据流驱动器;与微程序控制器和数据流驱动器连接的功能寄存器;连接数据流驱动器与I/O端口的交叉开关;所述数据流驱动器由一个n×n移位寄存器矩阵和一个n位输入/输出锁存器构成,其中每个移位寄存器都是独立的;所述功能寄存器用于设定I/O接口参数;所述FIFO缓存器、数据流驱动器和功能寄存器统一编址。所述数据流驱动器是可扩充的。本实用新型提供一种海量超高速的可重构数据流分配器和可重构I/O接口,具有可编程性与可重构性。 | ||
搜索关键词: | 一种 可重构 芯片 | ||
【主权项】:
1.一种可重构I/O芯片,其特征在于,包括: 微程序控制器; 与微程序控制器连接的数据流缓存器; 与数据流缓存器连接的数据流驱动器; 与微程序控制器和数据流驱动器连接的功能寄存器,所述功能寄存器包括用于设定相应的移位寄存器在每次数据传输操作中的比特率、比特数、以及以给定的启动时间与操作速度启动相应的移位寄存器进行数据传输操作的移位操作控制器; 与数据流驱动器连接的I/O端口; 所述数据流缓存器、数据流驱动器和功能寄存器统一编址。
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