[发明专利]基于FPGA的宽带数字下变频器无效
| 申请号： | 200910078867.8 | 申请日： | 2009-03-04 |
| 公开（公告）号： | CN101827055A | 公开（公告）日： | 2010-09-08 |
| 发明（设计）人： | 李和平;王岩飞 | 申请（专利权）人： | 中国科学院电子学研究所 |
| 主分类号： | H04L27/00 | 分类号： | H04L27/00;H04B1/00 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 周长兴 |
| 地址： | 100080 *** | 国省代码： | 北京;11 |
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| 摘要： | 一种基于FPGA的宽带数字下变频器，由一片FPGA实现一路信号的数字下变频；多路并行数据进入FPGA后，首先对该多路并行数据进行抽取，抽取间隔D为大于1的正整数，由FPGA内部的数据抽取模块对抽取后输入的数据流进行重整，分到d个支路，d的取值为大于1的正整数；每个支路按照抽取因子D进行抽取；通过抽取后，数据率降低了D倍，多相滤波模块在低速环节对降低了D倍的输入数据进行滤波处理，以实现输入信号的抗混迭滤波和抗镜像滤波；d个支路的输出进行d′倍内插，内插因子为0；将进行d′倍内插的数据由混频块进行混频和综合后，得到基带复信号，对基带复信号的实部和虚部进行分离以输出两路正交I和Q信号。 | ||
| 搜索关键词： | 基于 fpga 宽带 数字 变频器 | ||
【主权项】：
一种基于FPGA的宽带数字下变频器，由一片FPGA实现一路信号的数字下变频；FPGA内部包括数据抽取、多相滤波、内插、混频和基带输出功能模块；多路并行数据进入FPGA后，首先对该多路并行数据进行抽取，抽取间隔D为大于1的正整数，由FPGA内部的数据抽取模块对抽取后输入的数据流进行重整，分到d个支路，d的取值为大于1的正整数；每个支路按照抽取因子D进行抽取；通过抽取后，数据率降低了D倍，多相滤波模块在低速环节对降低了D倍的输入数据进行滤波处理，以实现输入信号的抗混迭滤波和抗镜像滤波；d个支路的输出进行d′倍内插，内插因子为0；将进行d′倍内插的数据由混频块进行混频和综合后，得到基带复信号，对基带复信号的实部和虚部进行分离以输出两路正交I和Q信号。
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