[发明专利]用于在具有快闪程序存储器的微控制器中提供程序断点的机制无效
| 申请号： | 200680028287.2 | 申请日： | 2006-06-07 |
| 公开（公告）号： | CN101233495A | 公开（公告）日： | 2008-07-30 |
| 发明（设计）人： | 弗罗德·米尔希·彼得森 | 申请（专利权）人： | 爱特梅尔公司 |
| 主分类号： | G06F11/00 | 分类号： | G06F11/00 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 | 代理人： | 孟锐 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明揭示一种微控制器。所述微控制器包含中央处理器单元(CPU)和经由指令总线与所述CPU通信的快闪程序存储器。所述微控制器包含耦合到所述CPU的芯片上调试(OCD)逻辑。所述OCD逻辑含有检测所述CPU与所述快闪程序存储器之间的指令总线上的零操作码以提供程序断点的逻辑。这是超越现有技术的一个优点，因为可将任何数目的此类断点插入到所述快闪程序存储器中，而不需要擦除所述存储器。根据本发明的系统和方法以芯片上调试逻辑和复杂性的最小增加提供对基于快闪程序存储器的微控制器中的程序断点极大改进的支持。 | ||
| 搜索关键词： | 用于 具有 程序 存储器 控制器 提供 断点 机制 | ||
【主权项】：
1.一种微控制器，其包括：中央处理器单元(CPU)；快闪程序存储器，其经由指令总线与所述CPU通信；以及芯片上调试(OCD)逻辑，其耦合到所述CPU，所述OCD逻辑含有检测指令总线上的预定操作码并用于提供程序断点的逻辑。
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