[发明专利]多IP模块的系统结构及多IP模块读数据的方法有效
| 申请号： | 200610119404.8 | 申请日： | 2006-12-11 |
| 公开（公告）号： | CN101202690A | 公开（公告）日： | 2008-06-18 |
| 发明（设计）人： | 钱晓辉 | 申请（专利权）人： | 上海华虹NEC电子有限公司 |
| 主分类号： | H04L12/40 | 分类号： | H04L12/40;H04L12/56;H04L29/06;G06F13/40 |
| 代理公司： | 上海浦一知识产权代理有限公司 | 代理人： | 顾继光 |
| 地址： | 201206上*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开了一种多IP模块的系统结构，包括多个IP模块、地址总线、读数据总线和写数据总线，所述写数据总线并联接入各IP模块的数据写端口，所述各IP模块按顺序依次排列，所述读数据总线连接到最后一个IP模块的数据读输出端口，相邻后一个IP模块的数据读输入端口与前一个IP模块的数据读输出端口相连接。本发明还公开了一种多IP模块读数据的方法，根据该IP模块的地址是否被选中，从而选择输出该IP模块的数据或者由前一个IP模块输入的数据。本发明避免使用三态总线，实现了IP模块读数据的操作；而本发明多IP模块的系统结构，其数据总线也没有采用三态数据总线，大大降低了技术难度，简化了系统结构，降低了系统功耗。 | ||
| 搜索关键词： | ip 模块 系统 结构 读数 方法 | ||
【主权项】：
1.一种多IP模块的系统结构，其特征在于，包括多个IP模块、地址总线、读数据总线和写数据总线，所述每个IP模块各包括有数据写端口、数据读输入端口和数据读输出端口，所述写数据总线并联接入各IP模块的数据写端口，所述各IP模块按顺序依次排列为IP1、IP2直到IPn，所述读数据总线连接到最后一个IP模块IPn的数据读输出端口，排序后的所有IP模块中，相邻后一个IP模块的数据读输入端口与前一个IP模块的数据读输出端口相连接。
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