[发明专利]多IP模块的系统结构及多IP模块读数据的方法有效
申请号: | 200610119404.8 | 申请日: | 2006-12-11 |
公开(公告)号: | CN101202690A | 公开(公告)日: | 2008-06-18 |
发明(设计)人: | 钱晓辉 | 申请(专利权)人: | 上海华虹NEC电子有限公司 |
主分类号: | H04L12/40 | 分类号: | H04L12/40;H04L12/56;H04L29/06;G06F13/40 |
代理公司: | 上海浦一知识产权代理有限公司 | 代理人: | 顾继光 |
地址: | 201206上*** | 国省代码: | 上海;31 |
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摘要: | |||
搜索关键词: | ip 模块 系统 结构 读数 方法 | ||
1.一种多IP模块的系统结构,其特征在于,包括多个IP模块、地址总线、读数据总线和写数据总线,所述每个IP模块各包括有数据写端口、数据读输入端口和数据读输出端口,所述写数据总线并联接入各IP模块的数据写端口,所述各IP模块按顺序依次排列为IP1、IP2直到IPn,所述读数据总线连接到最后一个IP模块IPn的数据读输出端口,排序后的所有IP模块中,相邻后一个IP模块的数据读输入端口与前一个IP模块的数据读输出端口相连接。
2.根据权利要求1所述的多IP模块的系统结构,其特征在于,所述IP模块中包括有选择器,所述选择器一个选择输入端连接该IP模块的数据读输入端口,所述选择器的另一个选择输入端连接该IP模块的数据输出端,所述选择器的输出端连接该IP模块的数据读输出端口,所述选择器的控制端连接该IP模块的地址译码电路。
3.根据权利要求1所述的多IP模块的系统结构,其特征在于,所述各依次排列的IP模块中,读取数据频率较高的IP模块排列在较后面的位置,读取数据频率较低的IP模块排列在较前面的位置。
4.一种利用如权利要求1所述的多IP模块的系统结构进行读数据的方法,其特征在于,包括如下步骤:
(1)通过地址总线将要读取数据的地址发送给各IP模块;
(2)各IP模块进行地址译码,与该地址对应的IP模块的地址译码电路根据该地址,控制该对应的IP模块的选择器选择将该对应的IP模块的数据输出给数据读输出端口;与该地址不对应的IP模块的地址译码电路根据该地址,控制该不对应的IP模块的选择器选择将该不对应的IP模块从数据读输入端口输入的数据输出给数据读输出端口。
5.根据权利要求4所述的多IP模块读数据的方法,其特征在于,在所述第(1)步之前还包括对各IP模块进行排序的步骤。
6.根据权利要求5所述的多IP模块读数据的方法,其特征在于,在对各IP模块进行排序时,读取数据频率较高的IP模块排列在较后面的位置,读取数据频率较低的IP模块排列在较前面的位置。
7.根据权利要求5所述的多IP模块读数据的方法,其特征在于,对各IP模块进行动态排序。
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