[发明专利]实时处理器系统及控制方法无效
| 申请号： | 200410078695.1 | 申请日： | 2004-09-17 |
| 公开（公告）号： | CN1598797A | 公开（公告）日： | 2005-03-23 |
| 发明（设计）人： | 渕上竜司;米泽友纪;西田要一 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | G06F13/24 | 分类号： | G06F13/24 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 马莹;邵亚丽 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种实时处理器系统以及控制方法。实时处理器系统具备：总线判优器(100)、具有处理器和中断处理部的多个运算处理单元(110、120)、DMA控制器(130)、多个优先级寄存器(141～143)、存储器(170)，以及SCI(180)，总线判优器(100)具有优先级比较部(150)以及总线分配决定部(160)。在各个优先级寄存器中，存储各个运算处理单元的I/O存取优先级值，将其进行比较，从而决定I/O存取权。通过改变优先级寄存器的设定，来适当地处理多路中断。 | ||
| 搜索关键词： | 实时 处理器 系统 控制 方法 | ||
【主权项】：
1.一种实时处理器系统，具备：总线判优器；至少两个运算处理单元，作为运算处理器单元，具有处理器和中断处理部，连接到所述总线判优器；优先级寄存器，存储用于所述处理器进行通常处理的I/O存取优先级值，或用于所述中断处理部进行中断处理的I/O存取优先级值；以及至少一个I/O装置，连接到所述总线判优器，其中，所述总线判优器具有：优先级比较部，比较所述优先级寄存器中存储的优先级值；以及总线分配决定部，根据所述优先级比较部的比较结果决定总线的使用权。
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