[发明专利]半导体器件的形成方法无效

专利信息
申请号: 200410036680.9 申请日: 2004-04-28
公开(公告)号: CN1551299A 公开(公告)日: 2004-12-01
发明(设计)人: 東川誠 申请(专利权)人: 佳能株式会社
主分类号: H01L21/205 分类号: H01L21/205;H01L31/18;H01L31/075;H01L27/142;C23C16/00
代理公司: 中国国际贸易促进委员会专利商标事务所 代理人: 王以平
地址: 日本*** 国省代码: 日本;JP
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摘要: 一种利用高频等离子体CVD法形成半导体器件的方法,所述半导体器件在衬底上具有由硅系列薄膜构成的多个pin结,其特征在于,按下述顺序进行如下工序:形成第一半导体层的工序;用包含0.01~0.5重量%的水分的部件接触覆盖上述第一半导体层的表面的工序;除掉上述部件的工序;在上述第一半导体层上形成第二半导体层的工序。根据本发明,能够高效率地形成具有层叠了许多硅系列薄膜的结构的半导体器件,能够形成批间特性的偏差少、具有更优良的均匀性和特性的半导体器件,另外,能够提供一种紧密性和耐环境性优良的半导体器件。
搜索关键词: 半导体器件 形成 方法
【主权项】:
1.一种利用高频等离子体CVD法形成半导体器件的方法,所述半导体器件在衬底上具有由硅系列薄膜构成的多个pin结,其特征在于,按下述顺序进行如下工序:形成第一半导体层的工序;用含有0.01~0.5重量%的水分的部件接触、覆盖上述第一半导体层的表面的工序;除掉上述部件的工序;以及在上述第一半导体层上形成第二半导体层的工序。
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