[发明专利]低稳态误差的锁相回路及其校正电路有效
| 申请号： | 02147935.6 | 申请日： | 2002-10-30 |
| 公开（公告）号： | CN1494217A | 公开（公告）日： | 2004-05-05 |
| 发明（设计）人： | 陈志成;徐哲祥 | 申请（专利权）人： | 联发科技股份有限公司 |
| 主分类号： | H03L7/06 | 分类号： | H03L7/06;H03L7/08;H03L7/085 |
| 代理公司： | 北京市柳沈律师事务所 | 代理人： | 王志森;黄小临 |
| 地址： | 台湾省*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种低稳态误差的锁相回路及其校正电路。该校正电路包含：时钟发生器，根据振荡时钟产生相位接近或同相位的模拟输入信号与模拟参考时钟；延迟单元来延迟模拟参考时钟的相位；相位检测器，接收模拟输入信号与延迟单元输出的延迟参考时钟，并根据该等信号的相位差输出电荷控制信号；电荷泵，接收电荷控制信号，并根据该电荷控制信号输出控制电流；积分器，对控制电流积分产生误差电压；延迟时间控制单元，根据误差电压产生延迟单元的延迟时间控制信号；及压控振荡器接收参考控制电压，并产生所述振荡时钟。该低稳态误差的锁相回路是利用延迟单元延迟输入信号的相位或参考时钟的相位，藉以补偿该锁相回路的电路特性，并降低锁相回路的稳态误差。 | ||
| 搜索关键词： | 稳态 误差 回路 及其 校正 电路 | ||
【主权项】：
1.一种具低稳态误差的锁相回路，包含：一延迟单元，接收一锁相时钟，并产生延迟一第一预设时间的一延迟时钟；一相位检测器，接收一输入信号与所述延迟时钟，并根据该输入信号与延迟时钟的相位差输出电荷控制信号；一电荷泵，接收所述电荷控制信号，并根据该电荷控制信号输出一控制电流；一回路滤波器，根据所述控制电流产生一控制电压；以及一压控振荡器，根据所述控制电压产生所述锁相时钟。
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