[发明专利]数字时钟信号调节装置无效
| 申请号： | 01109167.3 | 申请日： | 2001-03-16 |
| 公开（公告）号： | CN1375931A | 公开（公告）日： | 2002-10-23 |
| 发明（设计）人： | 黄鸿儒;白宏达 | 申请（专利权）人： | 矽统科技股份有限公司 |
| 主分类号： | H03K5/156 | 分类号： | H03K5/156;G06F1/08 |
| 代理公司： | 北京纪凯知识产权代理有限公司 | 代理人： | 赵蓉民 |
| 地址： | 中国*** | 国省代码： | 台湾;71 |
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| 摘要： | 一种数字时钟调节装置,用以调整电路的时钟信号的频率,其中包含累加器与门通电路。累加器是用以根据一调节参数,而产生第一输出信号。第一输出信号则区分成由最高位所构成的调节信号,以及除去该最高位所剩余的所有位而构成的回馈信号。而回馈信号更馈送回累加器中,作为输入信号而与调节参数进行累加运算。门通电路则与累加器相耦合,并根据调节信号与时钟信号,以排除时钟信号的部份时钟周期,藉以达成调整时钟信号的频率的效果。 | ||
| 搜索关键词： | 数字 时钟 信号 调节 装置 | ||
【主权项】：
1.一种数字时钟调节装置，用以调整电路的时钟信号的频率，其特征在于：该数字时钟调节装置至少包含：累加器，用以根据一调节参数而产生第一输出信号，该第一输出信号区分成调节信号以及回馈信号，该调节信号是由该调节参数的数字资料中最高位所构成，而该回馈信号则由该调节参数的数字资料中，除去该最高位所剩余的所有位而构成，该回馈信号更馈送回该累加器作为输入信号而与该调节参数进行累加运算；以及门通电路，与该累加器相耦合，并根据该调节信号与该时钟信号，以排除该时钟信号的部份时钟周期，藉以达成调整该时钟信号的频率的效果。
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