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[发明专利]解密方法和电路以及对应的设备-CN201910173208.6有效
发明人： G·谷亚纳西亚;R·克里特利 -专利权人：意法半导体股份有限公司
申请日： 2019-03-07 - 公布日： 2023-08-08 - 主分类号： G06F21/60 文献下载
摘要：本申请涉及解密方法和电路以及对应的设备。一种用于数据解密的方法包括：通过以突发模式操作的AXI总线接收对存储在存储器中的数据单元的数据访问请求，将接收的请求划分为对加密数据单元的请求和对非加密数据单元的请求，将对加密数据单元的请求和对非加密数据单元的请求都转发至存储器，通过AXI总线获取相应数据单元集合，以及通过计算用于加密数据单元的解密掩码和将计算的解密掩码应用于获取到的加密数据单元，来将高级加密标准AES处理应用于对加密数据单元的请求。根据通过所述请求传送的数据起始地址和安全信息，执行将请求划分为对加密数据单元的请求和对非加密数据单元的请求。
解密方法电路以及对应设备

[发明专利]密码方法和电路、对应的设备-CN201910515054.4有效
发明人： R·克里特利;G·谷亚纳西亚 -专利权人：意法半导体股份有限公司
申请日： 2019-06-14 - 公布日： 2023-03-07 - 主分类号： H04L9/06 文献下载
摘要：本公开的实施例涉及一种密码方法和电路、对应的设备。一种密码方法包括提供用于存储经加密数据的存储器位置。存储器位置具有相应地址，并且经由通信总线可访问。该方法包括通过通信总线接收对存储器位置的访问请求，其中访问请求包括从相应起始地址开始访问存储器位置的相应组的突发请求，并且根据起始地址基于密码密钥计算加密/解密加密掩码。接收明文数据用于加密，并且该方法包括将密码掩码应用于明文数据以从中获取经加密数据，并且将经加密数据包括在输出数据中以便通过通信总线进行传输。
密码方法电路对应设备

[发明专利]处理系统以及对应的操作方法-CN202210538235.0在审
发明人： R·克里特利 -专利权人：意法半导体股份有限公司
申请日： 2022-05-17 - 公布日： 2022-11-22 - 主分类号： H04L9/18 文献下载
摘要：本公开的实施例涉及处理系统以及对应的操作方法。主设备经由互连总线发出存储器突发事务请求以从从设备获取数据。密码引擎耦合到互连总线，并解密所获取的数据以产生用于主设备的明文数据。密码引擎根据流密码操作模式，或块密码操作模式选择性地操作。所述密码引擎被配置为响应于所述密码引擎从所述块密码操作模式切换到所述流密码操作模式而暂缓所述从设备与所述主设备之间的互连总线的读取数据信道。响应于由密码引擎产生的明文数据的读取突发的最后节拍，重新激活读取数据信道。
处理系统以及对应操作方法

[实用新型]电路和设备-CN201920894694.6有效
发明人： R·克里特利;G·谷亚纳西亚 -专利权人：意法半导体股份有限公司
申请日： 2019-06-14 - 公布日： 2020-03-06 - 主分类号： H04L9/06 文献下载
摘要：本实用新型的实施例涉及一种电路和设备。一种密码方法包括提供用于存储经加密数据的存储器位置。存储器位置具有相应地址，并且经由通信总线可访问。该方法包括通过通信总线接收对存储器位置的访问请求，其中访问请求包括从相应起始地址开始访问存储器位置的相应组的突发请求，并且根据起始地址基于密码密钥计算加密/解密加密掩码。接收明文数据用于加密，并且该方法包括将密码掩码应用于明文数据以从中获取经加密数据，并且将经加密数据包括在输出数据中以便通过通信总线进行传输。
电路设备

[实用新型]处理系统、集成电路和微控制器-CN201920710970.9有效
发明人： R·克里特利;G·谷亚纳西亚;D·勒-戈斯科茨;N·安奎特 -专利权人：意法半导体(格勒诺布尔2)公司;意法半导体股份有限公司
申请日： 2019-05-17 - 公布日： 2020-02-11 - 主分类号： G06F21/72 文献下载
摘要：本申请涉及处理系统、集成电路和微控制器。在一个示例中，集成电路包括：寄存器接口，其包括多个寄存器；总线接口，被配置为监视发送到寄存器接口的写入请求，其中写入请求包括目标地址和待写入的数据。总线接口被配置为接收待写入多个寄存器的数据和用于选择多个寄存器中的相应寄存器的寄存器选择信号。集成电路包括监视电路，该监视电路被配置为监视总线接口和多个寄存器之间的寄存器选择信号，以便确定待写入多个寄存器的数据何时有效。本申请的各种实施例提供了用于验证/证实包括一个或多个密码密钥的安全配置的解决方案。
寄存器总线接口寄存器选择信号集成电路写入寄存器接口监视电路写入请求配置监视安全配置处理系统密码密钥目标地址微控制器申请验证

[实用新型]电路和电子设备-CN201920289802.7有效
发明人： G·谷亚纳西亚;R·克里特利 -专利权人：意法半导体股份有限公司
申请日： 2019-03-07 - 公布日： 2020-01-21 - 主分类号： G06F21/85 文献下载
摘要：本申请涉及电路和电子设备。电路包括：输入节点，被配置为通过AXI总线接收数据访问请求，其传送相应数据起始地址和指示突发请求中请求的数据单元是加密还是非加密数据单元的安全信息，该请求将关于数据单元大小、突发请求类型和长度的补充信息与相应数据起始地址和安全信息一起传送；读取电路块，耦合到输入节点，被配置为从存储器接收数据单元可用性信号，读取数据起始地址和安全信息，据此将突发请求划分为对加密数据单元和对非加密数据单元的突发请求，使这些请求转发到存储器，并从存储器获取相应数据单元集合；和处理电路装置，被配置为将AES处理应用于对加密数据单元的突发请求。由此提供适于插在AXI总线上以与存储器控制器协作的硬件方案。
安全信息加密数据单元数据起始地址非加密数据存储器输入节点数据单元配置电路传送存储器接收数据处理电路装置存储器控制器数据单元集合单元可用性补充信息处理应用电子设备读取电路访问请求接收数据起始地址请求类型请求转发耦合到加密协作申请

[发明专利]处理系统、相关集成电路和方法-CN201910413254.9在审
发明人： R·克里特利;G·谷亚纳西亚;D·勒-戈斯科茨;N·安奎特 -专利权人：意法半导体(格勒诺布尔2)公司;意法半导体股份有限公司
申请日： 2019-05-17 - 公布日： 2019-11-26 - 主分类号： G06F21/72 文献下载
摘要：本申请涉及处理系统、相关集成电路和方法。在一个示例中，集成电路包括：寄存器接口，其包括多个寄存器；总线接口，被配置为监视发送到寄存器接口的写入请求，其中写入请求包括目标地址和待写入的数据。总线接口被配置为接收待写入多个寄存器的数据和用于选择多个寄存器中的相应寄存器的寄存器选择信号。集成电路包括监视电路，该监视电路被配置为监视总线接口和多个寄存器之间的寄存器选择信号，以便确定待写入多个寄存器的数据何时有效。
寄存器总线接口寄存器选择信号集成电路写入寄存器接口监视电路写入请求配置监视处理系统目标地址申请

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