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- [发明专利]存储器控制器-CN201210473722.X有效
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潘塔斯·苏塔迪嘉
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马维尔国际贸易有限公司
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2008-04-10
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2013-03-27
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G06F12/02
- 一种存储器控制器，包括类型确定模块，被配置为在所述存储器控制器操作期间，确定所述存储器控制器所连接的存储器的类型，其中，所述存储器包括包含多个页的存储器块，并且其中，每个页包括多个存储器单元；页配置模块，被配置为基于被确定为与所述存储器控制器连接的存储器的类型来生成存储器映射，其中，所述存储器映射针对存储器块中的每个页指定(i)用于存储数据的存储单元的数目以及(ii)用于存储开销的存储单元的数目，其中，所述多个页中的第一页中用于存储数据的存储单元的数目和用于存储开销的存储单元的数目被配置为与所述多个页中的第二页中用于存储数据的存储单元的数目和用于存储开销的存储单元的数目不同。
- 存储器控制器
- [发明专利]存储器控制器-CN201980010364.9在审
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T·M·布鲁尔
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美光科技公司
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2019-01-28
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2020-09-11
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G06F13/16
- 本发明公开一种存储器控制器电路(100)，其可耦合到第一存储器电路(125)，例如DRAM，并且包含：第一存储器控制电路(155)，其从所述第一存储器电路读取或对所述第一存储器电路写入；第二存储器电路(175)，例如SRAM；第二存储器控制电路(160)，其被调适成当所述所请求的数据存储于所述第二存储器电路中时，响应于读取的读取请求而从所述第二存储器电路读取，否则将所述读取请求传送到所述第一存储器控制电路所述第二存储器控制电路还将接收到的可编程原子操作请求传送到所述可编程原子操作电路系统并且针对所述第二存储器电路的高速缓存行设置危险位。
- 存储器控制器
- [发明专利]存储器控制器-CN201910182184.0在审
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杨崇和;常仲元;李春一
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澜起科技股份有限公司
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2019-03-11
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2020-09-22
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G06F13/16
- 本申请公开了一种存储器控制器，其耦接到存储模块以控制对所述存储模块的访问。所述存储器控制器包括：寄存时钟驱动器，其耦接到所述存储模块，用于向所述存储模块提供数据访问命令以控制对所述存储模块的访问；数据缓冲器，其耦接在所述寄存时钟驱动器与所述存储模块之间，用于在所述寄存时钟驱动器的控制下在所述存储模块与所述寄存时钟驱动器之间交互数据；其中，所述寄存时钟驱动器包括计算单元，所述计算单元用于对经由所述数据缓冲器接收自所述存储模块的数据进行计算，并且将计算结果经由所述数据缓冲器提供给所述存储模块。
- 存储器控制器
- [发明专利]存储器控制器-CN201910181860.2在审
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马青江;山岗;李春一
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澜起科技股份有限公司
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2019-03-11
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2020-09-18
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G06F3/06
- 本申请公开了一种存储器控制器，其耦接到存储模块以控制对所述存储模块的访问，所述存储模块包括一个或多个存储体，每个存储体包括多个存储单元。所述存储器控制器包括：寄存时钟驱动器，其耦接到所述存储模块，用于向所述存储模块提供数据访问命令以控制对所述存储模块的访问；一个或多个数据缓冲器，其耦接到所述寄存时钟驱动器，并且每个数据缓冲器通过一个存储体数据接口耦接到一个存储体；其中，至少一个所述存储体数据接口包括多个数据总线，并且每个数据总线分别与所述存储体数据接口所耦接的存储体中的一个或多个存储单元耦接，使得所述存储体能够在所述寄存时钟驱动器的控制下通过所述多个数据总线分别与所述数据缓冲器进行数据交互
- 存储器控制器
- [发明专利]存储器控制器-CN202110045868.3在审
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金宙铉;金到训;金真永
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爱思开海力士有限公司
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2021-01-14
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2021-11-12
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G06F3/06
- 本公开涉及一种控制存储器装置的控制器，该存储器装置包括多个页面，每个页面与物理地址相对应，该控制器可以包括：存储器，适用于存储多个逻辑到物理(L2P)组块，每个L2P组块指示一个或多个逻辑地址与一个或多个物理地址之间的映射，以及适用于存储原始有效页面位图(VPB)，原始VPB指示多个页面中的每一个是否是存储有效数据的有效页面；以及处理器，适用于在检测到损坏的L2P组块时，基于正常L2P组块来生成重构的VPB，检测原始VPB
- 存储器控制器
- [发明专利]存储器控制器-CN202110716219.1在审
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金宙铉;金到训;金真永;慎基范;延济完;李广淳
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爱思开海力士有限公司
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2021-06-28
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2022-05-20
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G06F3/06
- 本公开涉及一种用于控制存储器装置的控制器，该控制器可以包括：请求接收器，被配置为从可操作地联接到控制器的主机接收包括逻辑地址的请求；依赖性检查器，被配置为从请求接收器获取请求并检查该请求的依赖性，依赖性指示是否存在影响处理该请求的任何先前未完成请求；映射管理器，被配置为响应于请求对先前未完成请求不具有依赖性的检查结果，生成包括被映射到该请求的逻辑地址的物理地址的命令；以及命令提交器，被配置为向存储器装置提供由映射管理器所生成的命令，其中请求接收器、依赖性检查器、映射管理器和命令提交器被构造为配置数据管线。
- 存储器控制器
- [发明专利]存储器控制器-CN201780005111.3有效
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成濑峰信
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爱信艾达株式会社
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2017-01-24
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2021-12-10
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G06F12/00
- 本发明提供一种在存储器根据实际数据进行动作的状态下，能够得知对于数据的选通点的技术。存储器控制器(1)具有：数据倾斜调整部(2)，调整读取数据信号的数据倾斜；选通调整部(3)，调整选通点；数据变化点检测部(4)，检测数据变化点；选通点检测部(5)，检测选通点；动态时机运算部(6)，对各个读取数据信号运算动态时机信息；动态时机信息存储部(7)，存储动态时机信息；以及动态时机信息输出部(8)，输出动态时机信息。
- 存储器控制器
- [发明专利]存储器控制器-CN201680016795.2有效
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成濑峰信
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爱信艾达株式会社
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2016-03-24
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2020-10-23
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G06F11/00
- 抑制向存储器传送数据时产生的噪声。存储器控制器(C)具有：写入部(6)，向存储器写入传输数据，读取部(7)，从存储器读取数据。写入部(6)具有置换单元(6b)，当构成在信号线(DL)传输的数据的位串的“1”和“0”的排列图案是被设定为置换对象的对象图案的情况下，在写入存储器之前，该置换单元(6b)将该位串置换为噪声被抑制的置换位串读取部(7)具有还原单元(7b)，该还原单元(7b)将从存储器读取的置换位串还原为初始位串。
- 存储器控制器
- [发明专利]存储器控制器-CN201910660418.8有效
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陈忱;沈鹏;郑秀玉;施宏彦
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上海兆芯集成电路有限公司
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2019-07-22
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2021-08-17
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G11C7/22
- 一种存储器控制器，包括接收电路、控制电路以及处理电路。接收电路接收第一写入指令、第一写入数据、第二写入指令以及第二写入数据。控制电路判断第一写入指令及第二写入指令是否为部分写入指令。当第一写入指令及第二写入指令为部分写入指令时，在读取期间，处理电路根据第一写入指令及第二写入指令读取存储阵列，用以产生第一读取数据及第二读取数据。控制电路根据第一读取数据及第二读取数据修改第一写入数据及第二写入数据，用以产生第一修改数据以及第二修改数据。在写入期间，处理电路将第一修改数据及第二修改数据写回存储阵列。
- 存储器控制器
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