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[发明专利]具有轮常数生成的SMS4加速处理器-CN201680055767.1有效
发明人： S.K.萨特帕菲;S.K.马修;K.S.亚普;V.戈帕尔 -专利权人：英特尔公司
申请日： 2016-08-15 - 公布日： 2023-07-25 - 主分类号： G06F21/71 文献下载
摘要：处理系统包括存储器和操作地耦合到存储器的处理逻辑。处理逻辑识别输出位序列的一个或多个常数位。处理逻辑生成输出位序列的多个可变位。处理逻辑产生包括识别的常数位和生成的多个可变位的输出位序列。
具有常数生成 sms4 加速处理器

[发明专利]经双仿射映射的s-盒硬件加速器-CN201680055704.6有效
发明人： S.K.萨特帕菲;S.K.马修;V.戈帕尔;K.S.亚普 -专利权人：英特尔公司
申请日： 2016-08-12 - 公布日： 2022-07-05 - 主分类号： G06F21/60 文献下载
摘要：一种处理系统包括：存储器和操作地耦合到存储器的密码加速器模块，密码加速器模块采用来通过执行以下来实现字节替代操作：输入位序列的第一映射仿射变换以产生第一中间位序列；第一中间位序列的逆变换以产生第二中间位序列；以及第二中间位序列的第二映射仿射变换以产生输出位序列。
经双仿射映射硬件加速器

[发明专利]用于提供SIMD SM4加密块密码功能性的指令和逻辑-CN202110941501.X在审
发明人： G.M.沃尔里奇;V.戈帕尔;S.M.古利;K.S.亚普;W.K.费哈利 -专利权人：英特尔公司
申请日： 2015-12-11 - 公布日： 2021-10-08 - 主分类号： G06F9/30 文献下载
摘要：本公开的发明名称是“用于提供SIMD SM4加密块密码功能性的指令和逻辑”。指令和逻辑提供单指令多数据(SIMD)SM4轮片操作。指令的实施例指定例如在立即操作数中的第一和第二源数据操作数集合和替换函数指示符。处理器的实施例可包括加密单元，其响应于第一指令而执行以下操作：响应于指示第一替换函数的替换函数指示符而在具有来自第二源数据操作数集合的对应密钥的第一源数据操作数集合的一部分上执行SM4轮交换的片；响应于指示第二替换函数的替换函数指示符使用具有来自第二来源数据操作数集合的对应常数的第一源数据操作数集合的另一部分执行SM4密钥生成的片，以及在SIMD目的地缓存器中存储第一指令的结果元素集合。
用于提供 simd sm4 加密密码功能指令逻辑

[发明专利]单个数据缓冲器的并行处理-CN201380030628.X有效
发明人： S.M.古利;W.K.费哈尔;V.戈帕尔;J.D.圭尔福德;G.M.沃尔里奇;K.S.亚普 -专利权人：英特尔公司
申请日： 2013-07-10 - 公布日： 2020-08-11 - 主分类号： G06F9/38 文献下载
摘要：用于对单个可变长度的数据缓冲器执行串行数据处理算法的技术包括:填补缓冲器的数据段，使数据段流式传送到数据寄存器中,以及对段中的每个并行地执行串行数据处理算法。
单个数据缓冲器并行处理

[发明专利]单个数据缓冲器的并行处理-CN201380030617.1有效
发明人： S.M.古利;W.K.费哈尔;V.戈帕尔;J.D.圭尔福德;G.M.沃尔里奇;K.S.亚普 -专利权人：英特尔公司
申请日： 2013-07-10 - 公布日： 2019-05-14 - 主分类号： G06F9/38 文献下载
摘要：用于对单个可变长度的数据缓冲器执行串行数据处理算法的技术包括：将所述缓冲器的段流式传送到数据寄存器中，并行地对所述段中的每个执行所述算法，以及将对所述段中的每个执行所述算法的结果相组合以形成所述串行数据处理算法的输出。
单个数据缓冲器并行处理

[发明专利]在永久存储器中的数据存储-CN201410496214.2在审
发明人： A.M.阿尔特曼;K.S.亚普;R.K.拉马努詹 -专利权人：英特尔公司
申请日： 2014-09-25 - 公布日： 2015-04-15 - 主分类号： G06F12/14 文献下载
摘要：本发明公开包括与永久存储器中存储数据相关联的系统、方法和装置的实施例。在实施例中，存储器控制器可以配置成用加密密钥加密数据，并且已加密数据可以存储于永久存储器中。存储器控制器还可以配置成响应于重置事件，改变和/或破坏加密密钥。可能公开了和/或要求保护其它实施例。
永久存储器中的数据存储