专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]错误校正方法和使用其的半导体器件-CN201811044479.3有效
  • 金昌铉;金溶美 - 爱思开海力士有限公司
  • 2018-09-07 - 2023-03-10 - G06F11/10
  • 本申请涉及错误校正方法和使用其的半导体器件。半导体器件包括读取数据发生电路和校验子发生电路。读取数据发生电路从在第一读取操作期间产生的第一输出数据和第一输出奇偶校验码码来产生第一读取数据。此外,读取数据发生电路从在第二读取操作期间产生的第二输出数据和第二输出奇偶校验码码产生第二读取数据。校验子发生电路从第一读取数据和第二读取数据产生校验子信号。校验子发生电路产生校验子信号使得与第一读取数据相对应的第一半矩阵的列向量对称于与第二读取数据相对应的第二半矩阵的列向量。
  • 错误校正方法使用半导体器件
  • [发明专利]半导体器件及包括其的半导体系统-CN201810937766.0有效
  • 金昌铉;金溶美 - 爱思开海力士有限公司
  • 2018-08-17 - 2022-12-30 - G11C29/42
  • 本发明公开了一种半导体器件及包括其的电子系统。半导体系统包括第一半导体器件和第二半导体器件。第一半导体器件根据包括与错误发生次数有关的信息的错误代码的逻辑电平组合来产生第一错误清洗控制信号和第二错误清洗控制信号。第二半导体器件在刷新操作期间响应于第一错误清洗控制信号而在第一周期时间执行存储区的错误清洗操作,以及在刷新操作期间响应于第二错误清洗控制信号而在第二周期时间执行存储区的错误清洗操作。
  • 半导体器件包括半导体系统
  • [发明专利]半导体器件-CN201710941260.2有效
  • 权奇薰;金溶美;金载镒 - 爱思开海力士有限公司
  • 2017-10-11 - 2022-02-25 - G11C16/10
  • 一种半导体器件,包括错误计数信号发生电路和行错误控制电路。错误计数信号发生电路产生如果被选择用来执行错误刷洗操作的单元的出错数据的数量等于预定数量则被使能的错误计数信号。如果出错数据的数量大于或等于所述预定数量则行错误控制电路响应于错误计数信号而储存关于出错数据的数量的信息,或者在比所述预定数量更多的出错数据被检测到之后响应于错误计数信号而储存关于呈现出错数据的行路径的数量的信息。
  • 半导体器件
  • [发明专利]半导体器件-CN201710865269.X有效
  • 李在仁;金溶美 - 爱思开海力士有限公司
  • 2017-09-22 - 2022-02-25 - G11C13/00
  • 一种半导体器件,包括:写入读取控制电路,用于输出响应于写入命令而被使能的写入使能信号以及测试模式信号;以及错误校正电路,适用于响应于写入使能信号而执行确定输入数据的错误信息的计算操作、然后输出包括错误信息的内部奇偶校验信号,以及响应于写入使能信号而通过延迟输入数据来输出内部数据。
  • 半导体器件
  • [发明专利]半导体器件-CN201710827448.4有效
  • 李在仁;金溶美 - 爱思开海力士有限公司
  • 2017-09-14 - 2022-02-11 - G06F11/10
  • 可以提供一种半导体器件。半导体器件可以包括:输入和输出(I/O)电路,其被配置为基于写入使能信号将从输入数据产生的传输数据输出为内部数据,并且被配置为基于写入使能信号来输出关于输入数据的错误信息。写入使能信号可以基于写入信号来产生,该写入信号可以根据是否执行错误校正操作而被延迟一延迟时间。
  • 半导体器件
  • [发明专利]半导体器件-CN201710755852.5有效
  • 金溶美;金载镒;李在仁 - 爱思开海力士有限公司
  • 2017-08-29 - 2021-09-14 - G11C7/22
  • 一种半导体器件包括控制信号发生电路和输入/输出(I/O)控制电路。控制信号发生电路产生第一读取控制信号和第二读取控制信号以及第一写入控制信号和第二写入控制信号。第一读取控制信号和第二读取控制信号中的一个以及第一写入控制信号和第二写入控制信号中的一个根据用于选择第一I/O线或第二I/O线的第一地址和第二地址的组合而被选择性使能。I/O控制电路响应于第一读取控制信号和第二读取控制信号而通过第一I/O线和第二I/O线中的任意一个来输出加载在第一内部I/O线和第二内部I/O线上的读取数据。此外,I/O控制电路响应于第一写入控制信号和第二写入控制信号而通过第一I/O线和第二I/O线中的任意一个来输出输入数据。
  • 半导体器件
  • [发明专利]半导体存储器装置-CN200610002103.7无效
  • 金溶美 - 海力士半导体有限公司
  • 2006-01-16 - 2007-01-10 - G11C7/10
  • 根据本发明的半导体存储器装置能够方便地改变调整ODT操作的时序和具有优化的ODT时序,不管半导体存储器装置是安置于模块的任一级上。本发明包括:阻抗调整单元,用于根据阻抗选择信号来调整输入垫的阻抗值;ODT操作控制单元,用于使用译码信号和ODT时序信号在产生阻抗选择信号时控制阻抗调整单元;延迟调整单元,用于将内部控制时钟延迟预定时序,由此产生ODT时序信号;以及ODT时序控制单元,用于根据半导体存储器装置是排列至模块的第一级还是第二级来控制延迟调整单元以决定预定时序的值。
  • 半导体存储器装置

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