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[发明专利]低消耗、高吞吐的5GLDPC译码器实现方法及装置-CN202310714259.1在审
发明人：孙岳;魏瑞;李颖;车书玲;李文乐 -专利权人：西安电子科技大学
申请日： 2023-06-15 - 公布日： 2023-09-05 - 主分类号： H03M13/11 文献下载
摘要：本发明公开低消耗、高吞吐的5G LDPC译码器实现方法，具体为：步骤1、由输入参数计算出译码所需要的参数；步骤2、根据扩展因子Zc的取值，采用不同的分块存储方式；步骤3、根据扩展因子Zc的取值，决定是否对基矩阵进行层拆分变换，更新所需要的变量节点后验概率信息；步骤4、对层内的校验节点信息、变量节点后验概率信息进行更新；步骤5、实现分层迭代译码；步骤6、完成每一层的所有校验节点的信息更新且达到设置的迭代次数后，译码迭代完成，开始译码结果的输出处理。该方法实现所需资源的大幅降低；并利用拆分矩阵相邻两层的正交特性，采用层内流水操作使降低译码并行度后的译码器吞吐率得到了提升。还公开了低消耗、高吞吐的5G LDPC译码器实现装置。
低消耗吞吐 gldpc 译码器实现方法装置

[发明专利]一种适用于5G-LDPC的并行交织器以及方法-CN202310335251.4在审
发明人： 车书玲;李文乐;魏瑞;李颖 -专利权人：西安电子科技大学
申请日： 2023-03-30 - 公布日： 2023-06-23 - 主分类号： H03M13/27 文献下载
摘要：本发明提出了一种适用于5G‑LDPC的并行交织器以及方法，用于解决现有技术中存在的交织地址计算复杂度高和吞吐量较低的技术问题。并行交织器包括顺次连接的读写缓存模块和比特交织模块，及顺次连接的参数计算模块和参数存储模块；所述参数存储模块的输出端与比特交织模块相连；其中，比特交织模块包括并行排布的Q个循环移位单元和与该Q个循环移位单元输出端级联的码字合并模块，Q≥1；参数存储模块包括顺次连接的信息存储单元和计数器。实现步骤为：1.读写缓存模块存储5G‑LDPC编码后数据；2.参数计算模块计算交织层结尾比特长度；3.参数存储模块计算循环移位因子；4.比特交织模块获取交织结果。
一种适用于 ldpc 并行交织以及方法

[发明专利]基于软信息高斯消元算法的卷积码盲识别方法-CN202111059685.3在审
发明人： 车书玲;张美琪;孙蓉;雷欢欢 -专利权人：西安电子科技大学
申请日： 2021-09-10 - 公布日： 2021-12-28 - 主分类号： H03M13/23 文献下载
摘要：本发明公开一种基于软信息高斯消元算法的卷积码盲识别方法，其步骤包括：接收卷积码软信息序列；生成软可信度矩阵；用软信息高斯消元算法进行消元；根据更新准则更新软可信度矩阵；设置合适的判决阈值检测校验向量。本发明利用软信息高斯消元算法，克服了现有技术有关信道信息损失的问题，使得本发明实现有关信道差错统计特性信息的保留；本发明采取的更新准则，克服了现有技术错误比特连续传播的问题，使得本发明实现信道传输可靠性的提高；本发明采用合适的判决阈值，克服了现有技术对校验向量存在判决误差的问题，使得本发明实现对校验向量的精准判决。
基于信息高斯消元算法卷积码识别方法

[发明专利]基于拉丁方阵的准循环LDPC码纠错方法-CN201110363098.3有效
发明人： 车书玲;王新梅 -专利权人：西安电子科技大学
申请日： 2011-11-16 - 公布日： 2012-04-18 - 主分类号： H03M13/11 文献下载
摘要：本发明公开了一种基于拉丁方阵的准循环LDPC码纠错方法，主要解决现有技术的缺少简易方法找到全部满足行列约束关系的拉丁方阵的问题。其实现过程是：(1)寻找拉丁方阵第二行中能自由取值元素的位置集合Ψ；(2)构造拉丁方阵的第二行；(3)构造整个拉丁方阵W；(4)生成准循环LDPC码的校验矩阵H；(5)由校验矩阵H得到生成矩阵G；(6)在发端，由生成矩阵G对信息编码之后发到信道；(7)在收端，根据校验矩阵H进行译码，从噪声中恢复信息。仿真表明，本发明所构造的基于拉丁方阵的准循环LDPC码的纠错性能优异，可用于需要高度可靠性的通信或数字存储系统中进行纠错。
基于拉丁方阵循环 ldpc 纠错方法