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[发明专利]一种编解码验证系统、方法、设备及可读存储介质-CN202310782255.7在审
发明人：朱佳齐;杨崇朋;黄运新 -专利权人：深圳大普微电子科技有限公司
申请日： 2023-06-28 - 公布日： 2023-10-03 - 主分类号： G06F30/33 文献下载
摘要：本申请公开了计算机技术领域内的一种编解码验证系统、方法、设备及可读存储介质。本申请提供的编解码验证系统能够使编码模块和解码模块独立运行，设计完成的编码模块或解码模块可以单独部署于该系统中，使得相应编码模块或解码模块在该系统内被单独调用来进行芯片验证工作，降低了芯片验证工作的滞后性，缩短芯片开发的整体时间。同时，该系统提供的对比端便于定位编码模块和/或解码模块中存在的设计漏洞。而且，该系统使编码模块和解码模块在同一环境中进行验证，可以实现相同测试数据在不同模块中的复用，由此简化了芯片验证流程，可节约验证所用的计算机资源。
一种解码验证系统方法设备可读存储介质

[发明专利]回归测试方法及系统-CN202211656581.5在审
发明人：张吉兴;杨崇朋;黄运新 -专利权人：深圳大普微电子科技有限公司
申请日： 2022-12-22 - 公布日： 2023-06-30 - 主分类号： G06F9/50 文献下载
摘要：本申请公开了一种回归测试方法及系统，包括：获取携带有仿真时间参数的回归测试指令，所述仿真时间参数用于指示回归测试的执行时间限制；确定所述回归测试指令对应的测试用例；基于所述仿真时间参数，根据所述测试用例执行回归测试处理。如此，通过在回归测试指令中携带用于指示回归测试的执行时间限制的仿真时间参数，以基于仿真时间参数对所述回归测试指令对应的测试用例执行回归测试处理，实现智能化控制回归测试，能够解决因部分回归测试挂死而导致服务器资源浪费的问题，以及多人同时进行回归测试时，服务器资源分配均衡的问题，同时能够满足对仿真时间有依赖关系的测试用例的验证需求，提高了对服务器资源的利用率并提升了回归测试效率。
回归测试方法系统

[发明专利]基于UVM的SM4模块验证平台及验证方法-CN202211656130.1在审
发明人：代广周;杨崇朋;任培培;杨亚飞 -专利权人：深圳大普微电子科技有限公司
申请日： 2022-12-22 - 公布日： 2023-05-12 - 主分类号： G06F30/398 文献下载
摘要：本申请公开了一种基于UVM的SM4模块验证平台及验证方法，包括：代理模块，被配置为根据测试用例生成验证事务，并将所述验证事务发送至待测SM4模块以及参考模型模块；所述验证事务封装了以下变量：加解密选择、工作模式选择、初始向量、初始向量密钥、输入数据、数据密钥和输出数据；参考模型模块，被配置为模拟所述待测SM4模块的行为，获取SM4算法参考模型对所述验证事务执行预设处理后生成的第一结果；对比模块，被配置为对所述第一结果和所述待测SM4模块输出的第二结果进行比对，获得比对结果。如此，基于UVM对SM4模块进行验证，可以遍历SM4模块所有的工作模式，能够有效提高对SM4模块的验证效率，缩短芯片的研发周期，同时降低芯片研发成本。
基于 uvm sm4 模块验证平台方法

[发明专利]一种验证进度确定方法、装置、设备及可读存储介质-CN202011395421.0有效
发明人： 杨崇朋;黄运新 -专利权人：深圳大普微电子科技有限公司
申请日： 2020-12-03 - 公布日： 2023-04-18 - 主分类号： G06F11/26 文献下载
摘要：本申请公开了一种验证进度确定方法、装置、设备及可读存储介质。本申请公开的方法包括：获取验证计划数据，以及验证计划数据对应的功能覆盖数据；关联验证计划数据和功能覆盖数据，以确定覆盖组或覆盖点的实体层次路径，并生成功能覆盖类文件和包括实体层次路径的初始验证计划；利用测试工具解析初始验证计划和功能覆盖类文件，以获得各个测试用例对应的运行结果以及功能覆盖信息；将功能覆盖信息、初始验证计划和各个运行结果输入反标器，以输出验证进度标示结果。本申请能够自动确定实体层次路径和功能覆盖类文件，从而高效自动确定验证进度。相应地，本申请提供的一种验证进度确定装置、设备及可读存储介质，也同样具有上述技术效果。
一种验证进度确定方法装置设备可读存储介质

[发明专利]一种存储器参数提取方法、装置、设备及可读存储介质-CN202011389824.4在审
发明人： 杨崇朋;孟鹏涛 -专利权人：深圳大普微电子科技有限公司
申请日： 2020-12-02 - 公布日： 2021-02-12 - 主分类号： G06F30/327 文献下载
摘要：本申请公开了一种存储器参数提取方法、装置、设备及可读存储介质。本申请公开的方法包括：获取实例化有存储器参数的RTL代码文件；存储器参数包括：存储器类型、深度、位宽、部分写分组位宽标志、数据冗余标志、工作频率、每种类型的存储器个数和存储器在芯片中所占物理空间大小；调用NPI模型从RTL代码文件中提取存储器参数；生成包括存储器参数的报告文件。本申请实现了存储器参数的自动提取，可避免人工记录出错，也降低了参数提取成本，提高了参数提取效率，更为方便快捷。相应地，本申请提供的一种存储器参数提取装置、设备及可读存储介质，也同样具有上述技术效果。
一种存储器参数提取方法装置设备可读存储介质

[发明专利]一种SoC自动化随机验证的方法-CN201710136016.9有效
发明人：李亮亮;杨崇朋 -专利权人：记忆科技（深圳）有限公司
申请日： 2017-03-09 - 公布日： 2020-10-20 - 主分类号： G06F30/3323 文献下载
摘要：本发明公开了一种SoC自动化随机验证的方法，其特征在于通过脚本语言自动生成随机种子，将随机种子分别输入到C程序和SoC的测试激励模块；C程序根据输入的随机种子生成内部需要的随机数；测试激励模块根据生成的随机种子随机生成测试激励，测试激励实现SoC芯片的测试，通过检测输出判断测试结果。结合了外部程序产生随机数和内部测试用例C程序产生随机数的优点，通过外部传入随机种子给内部测试用例C程序产生随机数据，简单方便高效，实现了自动产生真正随机数据的效果，大大提高了验证的覆盖率和效率。
一种 soc 自动化随机验证方法

[发明专利]一种Soc芯片验证方法-CN201710878162.9有效
发明人： 杨崇朋;陈明园;周秀梅;范宏亮;陈政睿 -专利权人：记忆科技（深圳）有限公司
申请日： 2017-09-26 - 公布日： 2020-07-14 - 主分类号： G06F9/455 文献下载
摘要：本发明公开了一种Soc芯片验证方法，其特征在于在待验证Soc芯片内部的地址空间中划分一段或者2段以上的总线地址空间作为虚拟通讯接口，待验证Soc芯片的外部还挂载有包括外部驱动模块和虚拟接口监控模块；虚拟接口监控模块监控到该随机数申请，通过随机函数产生随机数据，并通过外部驱动模块将生成的随机数据写入虚拟存储载体中；在虚拟通讯接口的地址范围内将不同的地址定义为不同通讯请求，虚拟通讯接口通过总线上数据的地址信息来识别是否属于事先规划好的通讯请求。通过引入虚拟通讯接口的实时监控，有效控制随机激励的产生，并通过打印信息，仿真进程控制，实现CPU程序与硬件仿真程序的实时交互，有利于问题的快速定位，使得验证能够快速收敛。
一种 soc 芯片验证方法

[发明专利]一种实现SoC验证的交互机制的方法-CN201710135990.3在审
发明人：李亮亮;杨崇朋 -专利权人：记忆科技（深圳）有限公司
申请日： 2017-03-09 - 公布日： 2017-07-28 - 主分类号： G06F17/50 文献下载
摘要：本发明公开了一种实现SoC验证的交互机制的方法,其特征在于将对特定寄存器的操作和监控进行分离，通过增加交互接口模块、监视器模块和事件任务模块来实现；C程序、监视器模块和RTL通过所述交互接口模块进行连接并实现数据交互，所述交互接口模块实现AHB信号的打包；监视器模块实时监测交互接口模块打包的AHB总线信号，监测到AHB总线中存在向预先设定的寄存器操作时，将该操作映射为特定的事件实例；事件任务模块实现各个事件实例具体执行的操作的定义和管理。将CPU写寄存器的操作转换成SystemVerilog事务，并在上层的测试用例中使用事务来控制流程，解决了传统方法使用不便，移植性复用性差等诸多问题。
一种实现 soc 验证交互机制方法

[发明专利]基于数字逻辑的时间授时方法及系统-CN201210576506.8有效
发明人：蒋震;许俊;杨崇朋 -专利权人：盛科网络（苏州）有限公司
申请日： 2012-12-27 - 公布日： 2013-05-08 - 主分类号： G04R20/02 文献下载
摘要：本发明提供一种基于数字逻辑的时间授时方法及系统，其方法包括如下步骤：S1、接收首次要求授时输出的请求信息；S2、获取特定时间格式的当前秒值，并将所述当前秒值换算成对应的GPS周值及GPS周内秒值；S3、感测秒脉冲，并在每接收到一个秒脉冲后，更新所述时间信息中的GPS周值及GPS周内秒值并保存；S4、输出当前被保存的时间信号。本发明可以较低的成本实现时间信号的实时输出。
基于数字逻辑时间授时方法系统

[发明专利]一种以太网交换芯片中实现节能统计的方法及系统-CN201110412271.4无效
发明人：郑海东;贾复山;杨崇朋 -专利权人：盛科网络（苏州）有限公司
申请日： 2011-12-12 - 公布日： 2012-06-13 - 主分类号： H04L12/24 文献下载
摘要：本发明揭示了一种以太网交换芯片中实现节能统计的方法及系统，通过一个内嵌SRAM，使用calendar控制器及calendar寄存器组来控制并刷新选中寄存器端口在SRAM中的统计值，该统计值包括选中寄存器端口的触发次数及触发时间值，并且当SRAM中的统计值超过一定的阈值时，SRAM将上报CPU上报读取统计值，这种方法能精确地对节能以太网的节能信息进行统计，既可以节省芯片的面积，降低成本和功耗，又能灵活支持交换机的不同物理端口形态。
一种以太网交换芯片实现节能统计方法系统

[发明专利]在多个MAC中实现1588UDP封装包的校验和更新的方法及系统-CN201110349104.X无效
发明人：廖继平;杨崇朋 -专利权人：盛科网络（苏州）有限公司
申请日： 2011-11-08 - 公布日： 2012-05-09 - 主分类号： H04L1/24 文献下载
摘要：本发明提供一种在多个MAC中实现1588UDP封装包的校验和更新的方法及系统，其中方法包括以下步骤：报文出口处理模块读取报文数据，进行报文头编辑及报文数据修改，将被修改的64比特时间戳或时间修正域值用0代替，经计算得到原16比特UDP校验和的值；通过报文时间标识点从PTP引擎得到当前64比特时间戳，并结合所述原16比特UDP校验和的值采用增量计算方式得到新的16比特UDP校验和的值；MAC发送报文到被修改数据位置时，将新的16位校验和的值以及64比特时间戳替换原有数据。本发明通过修改PTP报文进MAC端前的UDP校验和计算方式，不用在多个MAC中存储64比特原时间戳或时间修正域值，大大减少了寄存器或存储器的使用，从而降低了芯片设计成本。
mac 实现 1588 udp 封装校验更新方法系统

[发明专利]在多个MAC中实现IEEE 1588不同时戳格式包封装的方法及装置-CN201110351801.9有效
发明人： 杨崇朋;许俊 -专利权人：盛科网络（苏州）有限公司
申请日： 2011-11-09 - 公布日： 2012-04-18 - 主分类号： H04L7/00 文献下载
摘要：本发明提供一种在多个MAC中实现IEEE1588不同时戳格式包封装的方法，包括以下步骤：S1，获取在参考时钟域内得到的秒加纳秒格式的时间戳；S2，将上述秒加纳秒格式的时间戳同步到一个比参考时钟快至少2倍的核心时钟的核心时钟域；S3，在与参考时钟域对应的其中一个核心时钟域内将秒加纳秒格式的时间戳转换为纳秒格式的时间戳；S4，在上述一个核心时钟域内向所有MAC广播纳秒格式时间戳，在与参考时钟域对应的除上述一个核心时钟域外的其他核心时钟域内向所有MAC广播秒加纳秒格式的时间戳；S5，MAC根据需要打时戳的格式类型在上述一个核心时钟域和其他核心时钟域选择上述广播而来的两种时间戳并放入包封装中进行不同时戳格式报文的传输。
mac 实现 ieee 1588 同时格式封装方法装置

[发明专利]提高PTP时间同步精度的方法及系统-CN201110367604.6有效
发明人： 杨崇朋;许俊 -专利权人：盛科网络（苏州）有限公司
申请日： 2011-11-18 - 公布日： 2012-04-04 - 主分类号： H04L7/00 文献下载
摘要：本发明提供一种提高PTP时间同步精度的方法及系统，其中方法包括以下步骤：在靠近物理层处，对发出或接收到的每个PTP消息报文打上时间戳；通过时间漂移调整和时间偏差调整得到调整后的PTP计数时间；PTP消息报文在秒脉冲触发时，判断PTP计数时间是否落在整秒的-1/2f与+1/2f之间，只有落在整秒的-1/2f与+1/2f之间，才送出秒脉冲。本发明通过PTP计数器秒翻转时，对纳秒落在允许的精度范围时做出是否送出PTP时钟输出信号的判断，从而使同步精度相比PTP计数分辨率提高一倍，在PTP使能的主从节点连接中实现纳秒级的同步精度。
提高 ptp 时间同步精度方法系统

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