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- [实用新型]一种信号处理板-CN202221209385.9有效
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吴东;夏思宇
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成都普诺科技有限公司
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2022-05-18
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2022-12-27
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G01S7/285
- 本实用新型涉及一种信号处理板，它包括处理模块、数据采集模块、锁相环、板载晶振、12V电源模块、接口模块和存储模块；数据采集模块、接口模块和存储模块与处理模相互连接；板载晶振的输出端与所述锁相环的输入端连接，锁相环的时钟信号输出端与处理模块和数据采集模块的时钟信号输入端连接，为处理模块提供工作时钟和为数据采集模块提供采集时钟和接口工作时钟；12V电源模块的供电输出端与所述处理模块和数据采集模块的供电输入端连接。本实用新型将上下变频功能和中频采集转换功能集成到一片芯片中，能够实现超宽频率的信号采集和发送，极大压缩了使用空间，极大降低了设备功耗，大幅度降低了设备成本，大大扩展了使用场景。
- 一种信号处理
- [实用新型]一种可控震源数据采集卡-CN202221266168.3有效
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夏思宇;吴东
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成都普诺科技有限公司
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2022-05-24
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2022-09-06
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H01R27/02
- 本实用新型涉及一种可控震源数据采集卡，它包括多通道的ADC采集模块、主控模块、电源模块、接口模块、存储模块、GPS模块和GPS天线接口；所述ADC采集模块与所述主控模块连接，所述电源模块的供电输出端与所述ADC采集模块和主控模块的供电输入端连接，所述主控模块与所述接口模块和存储模块连接；所述主控模块与所述GPS模块连接，所述GPS模块与GPS天线接口连接，GPS天线接口上连接GPS天线。本实用新型能够同步采集多路模拟信号，并通过网络将数据上传，采集卡支持远程网络控制和GPS时间标记功能。
- 一种可控震源数据采集
- [实用新型]一种基带信号处理板-CN202221131581.9有效
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吴东;荣彬杰
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成都普诺科技有限公司
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2022-05-11
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2022-08-26
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H04B1/16
- 本实用新型涉及一种基带信号处理板，它包括两片FPGA、下行接收通道、上行发送通道、时钟模块、DDS模块、和电源模块；两片FPGA相互连接；下行接收通道和上行发送通道与两片FPGA相接；其中一个FPGA的输出端与DDS模块的输入端连接；时钟模块的输出端与所述下行接收通道、上行发送通道、两片FPGA的输入端连接；电源模块的供电输出端与所述下行接收通道、上行发送通道、两片FPGA的供电输入端连接。本实用新型RapidIO，PCIE，光纤，LVDS等专用高速接口以及千兆以太网，RS422和GPS等常规通用接口既能够适用于专用协议的高速数据传输，也能够适用于外部通用设备的数据交互。
- 一种基带信号处理
- [实用新型]一种超短波测向装置-CN202220994342.X有效
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荣彬杰;吴东
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成都普诺科技有限公司
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2022-04-27
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2022-08-23
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G01S3/14
- 本实用新型涉及一种超短波测向装置，它包括主控模块、AD采集通道模块、监视通道模块、时钟模块、外部电源模块、接口模块和存储模块；主控模块与监视通道模块、AD采集通道模块、接口模块和存储模块相互连接；时钟模块的输出端与所述监视通道模块、AD采集通道模块和主控单元的时钟信号输入端连接；外部电源模块的供电输出端与主控模块的输入端连接。本实用新型具有8通道超短波信号同步采集、处理能力以及1通道超短波信号监视，具备通过DDR芯片对高速采集数据进行独立缓存的功能，能够将高速采集数据通过DDR芯片缓存后再通过SRIO接口向后级传输，支持千兆网口数据传输，能够实现设备上主要器件温度、电压等自检信息进行上传。
- 一种超短波测向装置
- [实用新型]一种便携式数据通用采集板-CN202220945804.9有效
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夏思宇;荣彬杰
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成都普诺科技有限公司
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2022-04-22
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2022-08-09
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G06F1/16
- 本实用新型涉及一种便携式数据通用采集板，它包括前端变频模块、中频采集模块、信号处理主板和数字阵列固态硬盘；所述前端变频模块连接多个数据采集通道，经过变频处理后与所述中频采集模块的输入端连接；所述中频采集模块的时钟信号输入端连接外部参考时钟，并通过PCIe总线与所述信号处理主板连接；所述信号处理主板与所述前端变频模块和数字阵列固态硬盘相互连接。本实用新型ADC的信噪比及动态范围高，数字端能最大限度保证模拟信号性能，单通道采集的最大数据率为2GB/s，能够实现数据的实时传输和存储，使用硬盘阵列即可完成数据的实时存储和读取，整机设备便携性好。
- 一种便携式数据通用采集
- [实用新型]一种高速调制解调板-CN202221078870.7有效
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荣彬杰;夏思宇
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成都普诺科技有限公司
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2022-05-07
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2022-08-02
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H04M11/06
- 本实用新型涉及一种高速调制解调板它包括两片FPGA、AD采集子卡、DA输出子卡、时钟模块、电源模块、接口模块和存储模块；电源模块的供电输出端与两片二FPGA的供电输入端连接，两片FPGA相互连接；两片FPGA与DA输出子卡和AD采集子卡连接；时钟模块的时钟信号输出端与所述AD采集子卡、DA输出子卡、两片FPGA的时钟信号输入端连接；接口模块和存储模块与两片FPGA相互连接。本实用新型集成高速串行总线技术的高速AD采集和高速DA发射，大大提高了收发模拟信号的带宽和动态指标，大大降低了高速大带宽信号在FPGA中的时序控制开发难度。
- 一种高速调制解调
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