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[发明专利]总线控制电路、半导体集成电路、电路基板、信息处理装置以及总线控制方法-CN201780052512.4有效
发明人：大谷敬之;上方辉彦;川崎贵之;仁茂田永一 -专利权人：株式会社索思未来
申请日： 2017-05-09 - 公布日： 2023-05-02 - 主分类号： G06F13/36 文献下载
摘要：在对具有第一格式的与排他访问对应的第一总线规格的第一排他指令、和具有适合不与排他访问对应的第二总线规格的第二格式的第一总线规格的第二排他指令进行相互转换，进行第一以及第二总线规格间的排他指令的传输的总线控制电路中，具有：排他指令转换电路，其在从第一排他指令向第二排他指令的转换时，接受第一排他指令，转换为第二排他指令并输出；排他指令生成电路，其在从第二排他指令向第一排他指令的转换时，接受第二排他指令并生成第一排他指令；排他响应发行电路，其在从第二排他指令向第一排他指令的转换时，发行针对第二排他指令的排他响应信息；以及排他响应接收电路，其在从第一排他指令向第二排他指令的转换时，接受针对第二排他指令的排他响应信息。
总线控制电路半导体集成电路路基信息处理装置以及控制方法

[发明专利]总线电路和半导体装置-CN201310061430.X无效
发明人： 川崎贵之;后藤诚司;大谷敬之 -专利权人：富士通半导体股份有限公司
申请日： 2013-02-27 - 公布日： 2013-10-30 - 主分类号： G06F21/55 文献下载
摘要：本公开提供了总线电路和半导体装置。一种用于将从一个模块输出的多位数据传输到另一个模块的总线电路包括：数据总线；分割电路，被配置为将所述数据分割为多个包括多个位的分割数据，所述多个位的数目等于或小于所述数据总线的位宽度的一半；反相器电路，被配置为通过对所述多个分割数据中的每一个进行反相而产生多个反相分割数据；输出电路，被配置为将所述多个分割数据中的每一个以及与所述分割数据中的每一个相对应的所述反相分割数据中的每一个作为数据对输出；以及耦合电路，被配置为从接收自所述数据总线的所述数据对中提取并耦合所述多个分割数据。
总线电路半导体装置