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[发明专利]半导体集成电路-CN201980097306.4在审
发明人： 冲之井理典;小川幸生;东井亮;滨崎机一 -专利权人：株式会社索思未来
申请日： 2019-06-12 - 公布日： 2022-02-01 - 主分类号： G11C7/22 文献下载
摘要：一种半导体集成电路，包括：输出缓冲器，将存储器控制信号输出至外部端子；电源控制部，对向输出缓冲器的电源电压的供给进行控制；上拉控制部，对外部端子的上拉进行控制；以及控制信号生成部。在将存储器控制信号输出至外部端子的输出期间，控制信号生成部生成用于通过电源控制部将电源电压供给至输出缓冲器的电源控制信号、以及用于通过上拉控制部使上拉停止的上拉控制信号，并且在不将存储器控制信号输出至外部端子的空闲期间，控制信号生成部生成用于通过电源控制部停止向输出缓冲器供给电源电压的电源控制信号、以及用于上拉外部端子的上拉控制信号。由此，在根据从输出端子输出的输出信号将输出端子设定为预定电压的情况下，能够防止输出端子变成高阻抗状态。
半导体集成电路

[发明专利]可变延迟电路和半导体集成电路-CN201980097511.0在审
发明人： 冲之井理典 -专利权人：株式会社索思未来
申请日： 2019-06-21 - 公布日： 2022-02-01 - 主分类号： H03K5/14 文献下载
摘要：一种可变延迟电路，具有：第1延迟电路，包括能够对将接收到的信号返回输入侧还是转发至输出侧进行切换的多个第1延迟元件；及第2延迟电路，包括与第1延迟元件相同的第2延迟元件和具有与第1延迟元件相同的功能且延迟时间比第1延迟元件还长的多个第3延迟元件。第1延迟电路的第一级的第1延迟元件与第2延迟电路的第一级的第2延迟元件串联连接。此外，通过使第1延迟电路和第2延迟电路中的一个所接收到的输入信号延迟预定时间而得的延迟信号从第1延迟电路和第2延迟电路中的另一个输出。由于通过第一级的第1延迟元件和第2延迟元件可设定最小延迟量，所以在能够调整大范围延迟量的可变延迟电路中可提高延迟量较小时的精度。
可变延迟电路半导体集成电路