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- [发明专利]输入数据处理电路-CN01131186.X无效
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高桥秀彰
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日本电气株式会社
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2001-09-05
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2002-04-03
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H04L1/00
- 根据本发明,输入数据处理电路包括一个鉴相器50,检测从双电路发送的第一和第二时钟之间的时钟相位差。如果时钟相位差大于与帧的数据长度一半即输入数据集合的“m”字节一半相应的预定时间,则读出电路60选择第一和第二FIFO(10或20)缓冲器之一。此时,选择的FIFO缓冲器的时钟比第一和第二FIFO(10和30)缓冲器中的另一个的时钟快出时钟的相位差。然后读出电路60仅从选择的FIFOI缓冲器读出帧。结果,即使在双电路产生的时钟之间存在速率差时,在FIFO缓冲器中也不会发生“数据短缺”的现象。
- 输入数据处理电路
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