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[发明专利]一种低时延、幸存路径长度自动调节的维特比译码电路-CN202211618272.9在审
发明人：吴琪;陈谡;刘洋 -专利权人：中科芯集成电路有限公司
申请日： 2022-12-15 - 公布日： 2023-05-30 - 主分类号： H03M13/00 文献下载
摘要：本发明公开一种低时延、幸存路径长度自动调节的维特比译码电路，属于数字通信领域，包括译码控制电路、插值电路、分支度量计算电路、加比选电路和幸存路径回溯电路。译码控制电路根据配置生成译码电路控制信息；插值电路对码率为2/3、3/4的软比特数据进行插值操作，使之恢复成1/2码率的软比特数据；分支度量计算电路在当前节点下计算软比特数据相对4种不同输出所对应的分支度量值；加比选电路进行路径度量的计算、比较与选择，选出幸存路径并将节点信息存入SRAM中；幸存路径回溯电路回溯幸存路径，译出码字。本发明能减小电路面积，低时延的流水线译码结构应对突发数据，提高译码速度与效率，幸存路径动态调节可以很好的应对包长不固定的译码场景。
一种低时延幸存路径长度自动调节译码电路

[发明专利]一种在UVM中通过串行接口访问多页寄存器的方法-CN202211593953.4在审
发明人：戴威;陈谡;范学仕;唐茂洁 -专利权人：中科芯集成电路有限公司
申请日： 2022-12-13 - 公布日： 2023-05-26 - 主分类号： G06F13/42 文献下载
摘要：本发明公开一种在UVM中通过串行接口访问多页寄存器的方法，属于芯片验证领域。首先分页建立底层寄存器块，加入到顶层寄存器块中，并赋予不同的偏移地址加以区分；然后自定义寄存器前门访问类，将所有寄存器前门访问替换为自定义前门访问组件；最后在自定义前门中判断当前寄存器所在页，设置对应的片选信号，并启动串行接口sequence完成读写操作。本发明解决了在地址位宽有限的情况下，通过寄存器的分页片选的方式实现更多寄存器访问。
一种 uvm 通过串行接口访问寄存器方法

[发明专利]一种基于UVM事件机制的自适应仿真结束方法-CN202211590272.2在审
发明人：戴威;陈谡;范学仕;唐茂洁 -专利权人：中科芯集成电路有限公司
申请日： 2022-12-12 - 公布日： 2023-05-23 - 主分类号： G06F11/07 文献下载
摘要：本发明公开一种基于UVM事件机制的自适应仿真结束方法，属于验证方法领域。本发明主要通过UVM事件、“看门狗”机制和UVM的Phase投票机制实现。仿真开始时，“看门狗”机制开始计数，当特定UVM事件触发时，清零计数器；若一段时间没有事件触发，计数器达到阈值，进入仿真结束流程。本发明解决了在没有办法通过简单的延时、等待特定条件情况下自适应结束仿真的方法，使用简单，使用范围广，可以提高验证效率。
一种基于 uvm 事件机制自适应仿真结束方法

[发明专利]一种基于GMSK的软比特联合解调解扩方法-CN202211474316.5在审
发明人：张国义;范学仕;陈谡;宋朋 -专利权人：中科芯集成电路有限公司
申请日： 2022-11-23 - 公布日： 2023-03-14 - 主分类号： H04B1/69 文献下载
摘要：本发明涉及直接序列扩频系统的解调解扩技术领域，特别涉及一种基于GMSK的软比特联合解调解扩方法，包括以下步骤：对接收数据序列按照基于扩频倍数的过采样点数进行分组；采用Gold伪随机序列生成本地扩频码，将扩频码与相应NCO信号相乘得到本地调制序列；利用有效采样点信号将接收数据序列与本地调制序列及其共轭序列分别相乘得到相应的相关序列；依据序列分组长度对两种相乘结果分别累加积分，得到每个码元与本地参考信号的相关积分值，并求取相关积分值的平均值；计算两种平均值的功率，输出功率差值作为最终的解调解扩软比特数据。本发明相较于常规FSK类调制的先解调后解扩的实现方案，有效提高了解调器性能。
一种基于 gmsk 比特联合解调方法

[发明专利]一种在大多普勒频率下的PMF-FFT捕获方法-CN202111627879.9在审
发明人：刘娜;陈谡;范学仕;唐茂洁 -专利权人：中科芯集成电路有限公司
申请日： 2021-12-28 - 公布日： 2022-10-28 - 主分类号： H04B1/707 文献下载
摘要：本发明公开一种在大多普勒频率下的PMF‑FFT捕获方法，属于卫星通信系统信号处理领域。在采用PMF‑FFT算法的基础上提出了使用二次PMF‑FFT的方法，可以将码片误差缩小至一个码片范围内，使捕获判断模块可以很好地适应大多普勒范围，提高了捕获的准确性，缩短了捕获时间。在捕获初步完成后，将剩余频差估计在一个较大的范围内，引入剩余频偏估计模块，将频偏估计在一个较小的误差内，方便后续载波跟踪的处理。该方法不仅工程实现简单，且能够满足工程的信噪比要求。在捕获过程中，还通过捕获控制模块去控制各个模块的工作时序以及捕获状态，不仅保证了捕获的正确性，且便于调试。
一种多普勒频率 pmf fft 捕获方法

[发明专利]一种复用cordic核的二阶锁频辅助三阶锁相的载波跟踪环路-CN202111605106.0在审
发明人：刘娜;陈谡;范学仕;唐茂洁 -专利权人：中科芯集成电路有限公司
申请日： 2021-12-24 - 公布日： 2022-10-28 - 主分类号： H04B1/7085 文献下载
摘要：本发明公开一种复用cordic核的二阶锁频辅助三阶锁相的载波跟踪环路，属于通信系统领域。为了能在低信噪比、大多普勒动态的条件下实现对信号的精确跟踪，本发明利用锁相环对相位跟踪的精确性以及锁频环对大动态、信噪比较高的容忍性特点，将两者的优点充分结合在一起，锁频环对载波频率进行快速的锁定，锁相环在锁频环快速跟踪的基础上对载波相位进行进一步的跟踪，双环路保障能在同步初期快速追上频率偏移，且在同步后期能够稳定跟踪相位。同时锁相环与锁频环复用同一个cordic核，节省了系统的逻辑资源。在信噪比较低、多普勒变化率较大的条件下，可以完成对接收信号相位的精准同步，提升环路的动态性能。
一种 cordic 二阶锁频辅助三阶锁相载波跟踪环路

[发明专利]一种实现线速处理的方法和装置-CN201410789757.3有效
发明人：何波;陈谡 -专利权人：中兴通讯股份有限公司
申请日： 2014-12-17 - 公布日： 2020-06-26 - 主分类号： H04L12/861 文献下载
摘要：本发明公开了一种实现线速处理的方法和装置，包括：将同步光纤网络上的数据包POS映射Mapper模块进行点到点协议PPP/类高级数据链路控制HDLC协议封装后的HDLC帧进行入队缓存；判断出出队缓存中所有HDLC帧的大小大于或等于预设阈值，对入队缓存中的HDLC帧进行线速处理，将线速处理后的HDLC帧保存到出队缓存中。通过本发明的方案，在出队缓存中所有HDLC帧的大小大于或等于预设阈值时，对入队缓存中的HDLC帧进行线速处理，使得POS接口的速率达到线速，提高了POS接口的转发性能。
一种实现处理方法装置

[发明专利]一种帧定位方法及装置-CN201410682890.9在审
发明人：陈谡;何波 -专利权人：中兴通讯股份有限公司
申请日： 2014-11-24 - 公布日： 2016-06-22 - 主分类号： H04J3/16 文献下载
摘要：本发明公开一种帧定位方法及装置，获取当前时钟周期内的数据流；识别所述数据流中的定界符；根据预设方式设置至少两级缓存；通过所述至少两级缓存根据所述数据流中定界符对所述数据流进行帧定位。本发明通过以上技术方案，通过缓存级联的方式简化了帧定位方法，避免在一次缓存内同时拆分出全部的帧数据，大大减小了复杂逻辑而导致的芯片布局布线延时对时序设计的影响，有利于实现设计时钟频率的需求。适用于各种高速POS成帧器中的帧定位，解决传统基于多字节的帧定位方式实现困难、不够完善的问题。
一种定位方法装置

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