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[发明专利]指令执行方法及指令执行装置-CN202010009867.9有效
发明人： 邹鹏皓;张稚 -专利权人：上海兆芯集成电路有限公司
申请日： 2019-06-12 - 公布日： 2022-03-22 - 主分类号： G06F9/30 文献下载
摘要：本发明提供一种指令执行方法及指令执行装置。该指令执行装置包含一处理器。处理器包括：一指令翻译器(instruction translator)、一执行单元以及一重排缓冲器(reorder buffer)。指令翻译器(instruction translator)用以接收一宏指令(macro‑instruction)，并将宏指令至少翻译成为一第一微指令及一第二微指令。指令翻译器分别为第一微指令及第二微指令标识一原子操作标志以代表第一微指令的一第一目的操作数(destination operand)及第二微指令的一第二目的操作数均指向相同的一架构寄存器。执行单元用以执行第一微指令，以产生一第一执行结果，并执行第二微指令，以产生一第二执行结果。重排缓冲器(reorder buffer)用以根据原子操作标志来绑定第一微指令与第二微指令的退出操作(retirement)。
指令执行方法装置

[发明专利]指令执行方法及指令执行装置-CN201910504891.7有效
发明人： 邹鹏皓;张稚 -专利权人：上海兆芯集成电路有限公司
申请日： 2019-06-12 - 公布日： 2021-06-01 - 主分类号： G06F9/30 文献下载
摘要：本发明公开一种指令执行方法及指令执行装置。该指令执行装置包含：处理器。处理器包括：指令翻译器(instruction translator)、重排缓冲器(reorder buffer)、架构寄存器(architecture register)以及执行单元。指令翻译器接收宏指令，并将宏指令翻译成为第一微指令、第二微指令及第三微指令；其中，指令翻译器为第一微指令及第二微指令标识相同的原子操作标志；执行单元执行第一微指令，以产生第一执行结果，将第一执行结果存储至一临时寄存器，并执行第二微指令，以产生第二执行结果，将第二执行结果存储至架构寄存器，并执行第三微指令，以从临时寄存器读取第一执行结果并将第一执行结果存入架构寄存器。
指令执行方法装置

[发明专利]指令执行方法及指令执行装置-CN201910530579.5有效
发明人： 邹鹏皓;宋晨晨;张康康;王健斌 -专利权人：上海兆芯集成电路有限公司
申请日： 2019-06-19 - 公布日： 2021-05-28 - 主分类号： G06F9/28 文献下载
摘要：一种指令执行方法，适用于以一处理器执行，处理器包括寄存器别名表(Register Alias Table，RAT)及保留站(Reservation Station)，指令执行方法包含：藉由该寄存器别名表分别接收第一微指令及第二微指令，该寄存器别名表分别传送该第一微指令及该第二微指令至该保留站中；以及藉由该保留站依据该第一微指令的第一特定消息，为该第一微指令指定多个执行单元之一以执行该第一微指令，且依据该第二微指令的第二特定消息，为该第二微指令指定所述多个执行单元之一以执行该第二微指令；其中，当该保留站判断为该第一微指令及该第二微指令指定的执行单元相同时，则该保留站标示该第二微指令相关于该第一微指令。
指令执行方法装置

[发明专利]指令的分配方法和处理器-CN202010898333.6在审
发明人：张康康;邹鹏皓;王健斌 -专利权人：上海兆芯集成电路有限公司
申请日： 2020-08-31 - 公布日： 2020-12-01 - 主分类号： G06F9/4401 文献下载
摘要：本公开涉及一种指令的分配方法和处理器，该分配方法包括：根据指令的属性，确定指令的类型；将属于第一类型的指令发送到第一发布队列，并将属于第二类型的指令发送到第二发布队列，所述第一发布队列是基于矩阵结构的发布队列，所述第二发布队列是基于记分板‑内容可寻址内存CAM结构的发布队列；以及执行所述第一发布队列和所述第二发布队列中的指令。
指令分配方法处理器

[发明专利]指令执行方法及指令执行装置-CN202010721141.8在审
发明人：张稚;邹鹏皓 -专利权人：上海兆芯集成电路有限公司
申请日： 2020-07-24 - 公布日： 2020-10-30 - 主分类号： G06F9/30 文献下载
摘要：本发明公开一种指令执行方法及指令执行装置，该指令执行方法包含：将宏指令至少翻译为第一微指令及一第二微指令，并且为该第一微指令标识第一绑定信息，为该第二微指令标识一第二绑定信息；以及依据该第一绑定信息及该第二绑定信息同时执行该第一微指令及该第二微指令的退出操作；其中，该第一微指令及该第二微指令在微指令存储空间中相邻。
指令执行方法装置

[发明专利]用于微处理器的重发停靠的系统和方法-CN201510101450.4有效
发明人： 邹鹏皓;杨梦晨;王健斌;余晓园;高新宇 -专利权人：上海兆芯集成电路有限公司
申请日： 2015-03-09 - 公布日： 2017-12-15 - 主分类号： G06F9/44 文献下载
摘要：一种用于微处理器的重发指令停靠系统，该微处理器包括保留站模块，其分派指令用于执行；以及重排序缓冲器，其在重发状态期间向该保留站模块重发指令，其中该重发指令停靠系统包括至少一个第一流水线级和至少一个第二流水线级，其中第一流水线级在重发状态期间从重发数据路径向该保留站模块提供第一重发指令，并且一旦该保留站模块被判定为充满则停靠第一重发指令，而且其中第二流水线级选择指向该重排序缓冲器的指针，该重排序缓冲器提供相应的第一重发指令到该重发数据路径上，其中当第二充满信号被声明时将第二流水线级置于保持状态。
用于微处理器重发停靠系统方法