专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]AI计算平台、方法及AI云计算系统-CN202210349300.5在审
  • 杨静忠;山岗 - 澜起科技股份有限公司
  • 2022-04-01 - 2023-10-24 - G06F9/50
  • 本申请涉及人工智能计算技术领域,公开了一种AI计算平台、方法及AI云计算系统。AI计算平台包括:至少一个计算组件,其中所述计算组件包括:处理器,用于发起计算任务并根据存储的网络拓扑信息表将所述计算任务分解为若干个有序的子任务;若干个近内存计算模块,所述若干个近内存计算模块与所述处理器之间两两相连,并且所述若干个近内存计算模块相互之间两两相连,其中,所述若干个近内存计算模块各自被配置为实现不同的运算类型,所述若干个近内存计算模块根据各自实现的运算类型完成所述若干个子任务中的一个或多个。本申请可以降低处理器统一调度负荷,具备良好的通用性和可扩展,可适用单服务器、多服务器及云场景。
  • ai计算平台方法系统
  • [发明专利]可调信号传输时间的基板封装方法及其结构-CN201910616511.9有效
  • 梅萌;史刚;王培春;李广峰 - 澜起科技股份有限公司
  • 2019-07-09 - 2023-09-22 - H01L21/48
  • 本申请涉及芯片封装领域,特别涉及一种可调信号传输时间的基板封装方法及其结构。所述基板封装方法包括:在所述内层设计至少两条不同传输时间的带状线;从所述顶层的导电凸块端引出走线,并将所述走线通过过孔连接到所述内层的所述带状线;从所述底层的焊球端引出走线,并将所述走线通过过孔连接到所述内层的所述带状线;在所述顶层的走线和所述底层的走线上设置过度蚀刻区域;在所述过度蚀刻区域进行过度蚀刻;在所述顶层和所述底层上铺阻焊层,并保持所述过度蚀刻区域的阻焊层开窗;对所述基板进行开短路测试,并通过熔断所述走线来选择信号传输通路。通过在封装基板上设计不同传输时间的信号传输通路,实现信号传输时间的调节。
  • 可调信号传输时间封装方法及其结构
  • [发明专利]算子拆分方法、装置及介质-CN202210210442.3在审
  • 杨密;蔡雨 - 澜起科技股份有限公司
  • 2022-03-04 - 2023-09-12 - G06F9/50
  • 本申请提供一种算子拆分方法、装置及介质。所述方法包括:获取目标算子所需的缓存信息;根据所述目标算子所需的缓存信息和所述第一存储器的存储容量对所述目标算子进行拆分并获取所述目标算子所需的缓存在所述第一存储器中的布局,所述目标算子的拆分结果和所述目标算子所需的缓存在所述第一存储器中的布局用于实现目标人工智能模型到所述人工智能硬件加速器的映射。
  • 算子拆分方法装置介质
  • [发明专利]用于存储器系统的数据更新方法和存储器控制器-CN202011117808.X有效
  • 李毅 - 澜起科技股份有限公司
  • 2020-10-19 - 2023-07-18 - G06F3/06
  • 本申请涉及一种用于存储器系统的数据更新方法和存储器控制器。存储器控制器包括耦接在存储模块与主控制器之间的中央缓冲器与数据缓冲器;安全更新接口,经由其中央缓冲器还耦接到不同于主控制器的安全更新控制器以接收安全更新命令和待更新数据,其中安全更新命令用于指示将待更新数据写入存储模块中的目标地址;更新控制通道,其是不同于缓冲控制通道的控制通道,用以耦接中央缓冲器和数据缓冲器;数据缓冲器响应于中央缓冲器接收到安全更新命令,接收待更新数据以及更新前目标地址中存储的原始数据并将这两种数据同时存储在数据更新缓存中。在待更新数据被写入存储模块的过程中,数据缓冲器利用存储的原始数据响应主控制器对目标地址的访问。
  • 用于存储器系统数据更新方法控制器
  • [发明专利]基于国产密码算法的数据加解密系统及其方法-CN202210016457.6在审
  • 钟大江;杜朝晖 - 澜起科技股份有限公司
  • 2022-01-07 - 2023-07-11 - G06F21/60
  • 本申请提供一种基于国产密码算法的数据加解密系统及其方法。系统包括:主机系统、序列器、硬件处理器、多个直接存储器访问模块和多个密码引擎,密码引擎包括输入和输出缓冲器、对称加解密和摘要算法模块;主机系统确定加解密和/或摘要计算方式并生成对应的加解密和/或摘要计算命令;序列器对加解密和/或摘要计算命令进行解析生成控制流命令,通过控制流命令控制一个或多个直接存储器访问模块将加解密数据发送到一个或多个密码引擎的输入缓冲器;硬件处理器根据加解密和/或摘要计算命令控制对称加解密算法模块对加解密数据进行加解密计算和/或控制摘要算法模块对加解密数据进行摘要计算,将计算结果经由直接存储器访问模块发送到主机系统。
  • 基于国产密码算法数据解密系统及其方法
  • [发明专利]数据处理方法及加速单元-CN202111466061.3在审
  • 魏堃;郭山民;曹国欣 - 澜起科技股份有限公司
  • 2021-12-03 - 2023-06-23 - G06F7/78
  • 本申请提供一种数据处理方法及加速单元。所述数据处理方法包括:S11,读取目标矩阵的首行作为目标行;S12,根据预先设定的偏移量,对所述目标行中的元素进行第一方向的移位,并将移位后的目标行中的元素写入各自对应的行缓存器中;S13,若所述目标行不是所述目标矩阵的最后一行,且所述行缓存器中存在可用空间,则从所述目标矩阵中读取所述目标行的下一行作为新的目标行,循环执行步骤S12~S13;S14,根据预设规则,从各行缓存器中读取对应的元素,将读取的元素合并为一行写入输出缓存器中,循环执行此步骤直到所述行缓存器中的所有元素均写入输出缓存器。所述数据处理方法能够在基于流水线加速单元结构的计算机系统中实现高效的矩阵转置操作。
  • 数据处理方法加速单元
  • [发明专利]具有安全管理设备的控制系统-CN202111529249.8在审
  • 李毅 - 澜起科技股份有限公司
  • 2021-12-14 - 2023-06-16 - G05B19/048
  • 本申请涉及一种具有安全管理设备的控制系统,所述控制系统包括:总线;一个或多个工作设备,所述工作设备耦接至所述总线以通过各自的通信协议与所述总线传输数据;一个或多个安全监控管理器,所述安全监控管理器耦接在所述工作设备和所述总线之间,被配置为侦听所述耦接的工作设备与所述总线之间传输的数据,判断所述数据是否符合预定权限管理规则以生成判断结果,并根据所述判断结果选择性地允许将所述数据发送至所述总线或所述耦接的工作设备;以及中央安全管理器,其耦接至所述安全监控管理器,所述中央安全管理器被配置为对每个所述安全监控管理器中使用的预定权限管理规则进行配置。
  • 具有安全管理设备控制系统
  • [发明专利]芯片边缘裂纹的探测结构及其探测方法-CN202111509808.9在审
  • 张雄 - 澜起科技股份有限公司
  • 2021-12-10 - 2023-06-13 - H01L21/66
  • 本申请公开了一种芯片边缘裂纹的探测结构及其探测方法。在一个实施例中,该探测结构包括:位于芯片切割道和密封环之间的测试环,其中,所述芯片内部包括两个用于测试所述测试环的连接性的测试引脚,所述密封环包括位于衬底中的P型掺杂环和用于隔离所述密封环和所述测试环的浅沟槽隔离区域,所述浅沟槽隔离区域中形成有分别与所述两个测试引脚电连接的N型掺杂区;所述测试环包括位于所述衬底上的多层互连结构并且所述互连结构通过所述N型掺杂区与所述两个测试引脚电连接。本申请可以检测晶圆制造、切割和封装过程中的边缘裂纹,降低可靠性风险。
  • 芯片边缘裂纹探测结构及其方法
  • [发明专利]静电放电和电过载的探测电路-CN202111442023.4在审
  • 张雄;孙春来 - 澜起科技股份有限公司
  • 2021-11-30 - 2023-06-02 - G01R19/17
  • 本申请公开了一种静电放电和电过载的探测电路,探测电路包括:保护电路、感应电路、钳位电路、若干级依次相连的采样逻辑和存储电路。保护电路耦合在输入/输出引脚和内部芯片之间并在发生静电放电和电过载事件时向电源端放电,感应电路和钳位电路耦合在电源端和地端之间,每一级采样逻辑耦合到电源端和存储电路的一个存储单元,第一级采样逻辑耦合到钳位电路,在发生静电放电或电过载事件时若干级采样逻辑逐级采样电源端电压并改变对应存储单元的状态,从而存储单元逐次记录静电放电和电过载事件。本申请可以记录耦合有内部芯片的输入/输出引脚上的静电放电或电过载事件,用于分析静电放电或电过载事件发生的次数和阶段。
  • 静电放电过载探测电路
  • [发明专利]任务处理方法和装置-CN202111363169.X在审
  • 柯研家;杜朝晖;屈文博 - 澜起科技股份有限公司
  • 2021-11-17 - 2023-05-19 - G06F9/48
  • 本申请公开了一种任务处理方法和装置,其中所述装置经由通信接口耦接至主机装置以与主机装置进行任务和数据交互,并且所述装置包括:控制器、数据处理引擎和调度器,其中调度器用于用于经由通信接口从主机装置接收数据处理任务的任务描述符,在数据处理任务被触发执行后,基于任务描述符配置数据处理引擎的工作模式,控制数据处理任务对应的运算数据经由通信接口从主机装置发送至数据处理引擎,并在数据处理引擎对运算数据完成处理并生成数据处理结果后,控制数据处理结果经由通信接口从数据处理引擎发送至主机装置。
  • 任务处理方法装置
  • [发明专利]校准方法、校准装置及多相时钟电路-CN202111199621.3在审
  • 韦康;张亮 - 澜起科技股份有限公司
  • 2021-10-14 - 2023-04-18 - H03L7/081
  • 本申请提供一种校准方法、校准装置及多相时钟电路。所述方法包括:按照第一预设规则分别选通多相位时钟信号中的每一相位时钟信号作为分别的主时钟信号以及分别选通一相应时钟信号作为相应的辅时钟信号;按照第二预设规则分别选通多相位时钟信号中的每一相位时钟信号作为分别的主时钟信号以及分别选通一相应时钟信号作为相应的辅时钟信号;获取第一预设规则和第二预设规则下各主时钟信号与相应的辅时钟信号之间的时间差;根据时间差确定各主时钟信号的延迟调整量,并根据延迟调整量获取多相位时钟信号之间的相位误差;根据相位误差获取多相位时钟信号的校准量。基于所述校准方法得到的相位校准量可以对多相位时钟信号进行校准。
  • 校准方法装置多相时钟电路

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