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[发明专利]用于在分层高速缓存电路内传输数据的方法和装置-CN202180078153.6在审
发明人：约瑟夫·迈克尔·普斯德斯德里斯;克拉斯·玛格努斯·布鲁斯;詹姆师德·加拉;迪米特里奥斯·卡塞利迪斯;古鲁纳赫·拉马吉里;和-塞奥·克姆;安德鲁·约翰·特纳;拉尼娅·侯赛因·哈桑·马梅什 -专利权人： ARM有限公司
申请日： 2021-11-18 - 公布日： 2023-08-18 - 主分类号： G06F12/126 文献下载
摘要：本公开的各方面涉及一种装置，该装置包括处理电路、第一高速缓存电路和第二高速缓存电路，其中该第二高速缓存电路具有比该第一高速缓存电路的访问延迟更长的访问延迟。该第二高速缓存电路响应于接收到对存储在该第二高速缓存电路内的数据的请求，而将所述数据标识为伪无效数据，并且将所述数据提供给该第一高速缓存电路。该第二高速缓存电路响应于接收到指示该第一高速缓存电路将逐出所述数据的逐出指示，响应于确定所述数据在所述数据被提供给该第一高速缓存电路之后未被修改，而将所述伪无效数据标识为有效数据。
用于分层高速缓存电路传输数据方法装置

[发明专利]电路和方法-CN202011062537.2在审
发明人：布鲁斯·詹姆斯·梅休森;潘尼德拉·库玛·曼娜瓦;詹姆师德·加拉;克拉斯·玛格努斯·布鲁斯;安德鲁·约翰·特纳 -专利权人： ARM有限公司
申请日： 2020-09-30 - 公布日： 2021-04-09 - 主分类号： G06F15/78 文献下载
摘要：本申请涉及电路和方法。电路包括：有两个或更多个数据处理节点的集合，每个数据处理节点具有用于保持数据的相应存储电路；以及主节点，所述主节点用于把数据访问操作串行化，并控制由一个或多个数据处理节点保持的数据之间的一致性，使得写入存储器地址的数据与响应于后续的访问请求而从该存储器地址读取的数据一致；数据处理节点的集合的请求节点被配置为将请求传送到所述主节点以执行对给定存储器地址处的给定数据实例的独占访问；所述主节点被配置为响应于所述请求将信息传送到所述数据处理节点的集合的其他数据处理节点以控制由那些其他数据处理节点来对所述给定存储器地址处的由那些其他数据处理节点保持的任何进一步的数据实例进行处理。
电路方法

[发明专利]中断控制器-CN201980032473.0在审
发明人：蒂莫西·尼古拉斯·海;马丁·魏德曼;迈克尔·亚历山大·肯尼迪;安德鲁·约翰·特纳 -专利权人： ARM有限公司
申请日： 2019-05-01 - 公布日： 2020-12-22 - 主分类号： G06F13/24 文献下载
摘要：一种中断控制器包括发布电路，该发布电路用以向处理元件发布中断请求；以及控制电路，该控制电路用以检测与待发布的至少一个待决中断请求相关联的竞争状况的存在，且在该竞争状况已被解决时设定障壁指示符。响应于该竞争状况的存在，该发布电路被配置为：选择该至少一个待决中断请求中的一者；经由路径向该处理元件发布所选定的待决中断请求继之以虚拟请求，该路径确保该处理元件在接收该虚拟请求之前接收到所选定的待决中断请求。在接收到指示该处理元件已接收到该虚拟请求的确认后，该控制电路接着被配置为设定该障壁指示符。
中断控制器

[发明专利]针对虚拟处理器处理并路由中断-CN201480027941.2有效
发明人：安东尼·耶布森;安德鲁·约翰·特纳;马修·吕西安·伊万斯;格勒瑟·詹姆斯·埃文斯;亚当·詹姆斯·麦克尼内 -专利权人： ARM有限公司
申请日： 2014-04-24 - 公布日： 2019-11-15 - 主分类号： G06F9/48 文献下载
摘要：一种用于控制对在数据处理装置处接收的中断进行路由和处理的中断控制器，该数据处理装置包括至少一个物理处理单元和存储器，该至少一个物理处理单元被配置为运行多个虚拟处理器中的至少一个虚拟处理器，该存储器被配置为存储至少一个虚拟未决表格，该虚拟未决表格用于存储针对多个虚拟处理器中对应的虚拟处理器的未决虚拟中断。中断控制器包括：包括对应于至少一个物理处理单元的至少一个数据存储设备的再分配电路，至少一个数据存储设备被配置为存储针对虚拟未决表格的指针和针对未决表格的指针，该虚拟未决表格被配置为存储针对当前在对应的物理处理单元上运行的虚拟处理器的当前未决虚拟中断，该未决表格被配置为存储针对对应的物理处理单元的当前未决物理中断；被配置为接收用于中断虚拟处理器的虚拟中断的输入；和控制电路。该控制电路被配置为：响应于接收到虚拟中断，访问再分配电路中对应于虚拟处理器当前相关联的至少一个物理处理单元的至少一个数据存储设备，并且从数据存储设备中确定虚拟中断的虚拟处理器当前是否在物理处理单元上运行；如果是，则将虚拟中断添加到由再分配电路指向的虚拟未决表格中；以及如果否，则将虚拟中断存储在针对虚拟处理器的虚拟未决表格中，该虚拟未决表格被存储在存储器中。
针对虚拟处理器处理路由中断

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