专利名称
主分类
A 农业
B 作业;运输
C 化学;冶金
D 纺织;造纸
E 固定建筑物
F 机械工程、照明、加热
G 物理
H 电学
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公布日期
2023-10-24 公布专利
2023-10-20 公布专利
2023-10-17 公布专利
2023-10-13 公布专利
2023-10-10 公布专利
2023-10-03 公布专利
2023-09-29 公布专利
2023-09-26 公布专利
2023-09-22 公布专利
2023-09-19 公布专利
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专利权人
国家电网公司
华为技术有限公司
浙江大学
中兴通讯股份有限公司
三星电子株式会社
中国石油化工股份有限公司
清华大学
鸿海精密工业股份有限公司
松下电器产业株式会社
上海交通大学
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  • [发明专利]基于动态权重的测试向量生成与优化方法-CN201910227627.3有效
  • 赵毅强;石振东;刘燕江;何家骥;马浩诚 - 天津大学
  • 2019-03-25 - 2023-09-22 - G06N3/126
  • 本发明涉及集成电路可信任性检测技术,为提出适用木马检测的测试向量生成方法,生成高效精简的测试向量集,进而提高硬件木马的激活概率和检测效率,本发明,基于动态权重的测试向量生成与优化方法,步骤如下:(1)寻找低翻转率的电路节点;(2)低观测节点的查找;(3)测试向量的粗筛;(4)测试向量的细筛;(5)基于低观测节点的测试向量筛选:根据故障检测模型,给低观测节点注入故障“0”和故障“1”,构建故障网表,将待筛选的测试向量输入故障网表,观察电路输出与原始输出是否一致,如发生变化认为该测试向量能够将错误结果传递到电路输出端。本发明主要应用于集成电路可信任性检测场合。
  • 基于动态权重测试向量生成优化方法
  • [发明专利]基于弱相同路径的硬件木马检测装置和方法-CN201910798534.6有效
  • 李宗哲;赵毅强;秦国轩;刘燕江;何家骥 - 天津大学
  • 2019-08-27 - 2023-08-22 - G06F21/55
  • 本发明属于集成电路硬件木马检测方法领域,为快速有效地检测弱相同路径上的延时信息,降低芯片检测的复杂度和成本,除去了工艺偏差的影响,本发明基于弱相同路径的硬件木马检测装置和方法,步骤如下:1)对集成电路版图进行静态时序分析,确定路径以及延迟信息:2)设定弱相同路径延迟阈值,分析并确定弱相同路径集合R:3)分析弱相同路径的敏感性,筛选弱相同路径集合:4)植入多环路片上延迟木马自检测结构,分析有效性:5)对芯片制造后路径的延迟信息进行测试;6)将延迟信息的差值进行对比,判断出疑似植入木马的路径。本发明主要应用于集成电路设计制造场合。
  • 基于相同路径硬件木马检测装置方法
  • [发明专利]芯片电磁侧信道分析方法、系统及存储介质-CN202310146465.7在审
  • 赵毅强;闫明凯;何家骥;李尧 - 天津大学
  • 2023-02-21 - 2023-06-13 - H04L9/00
  • 本发明公开一种芯片电磁侧信道分析方法及系统,包括采集目标设备侧信道的电磁信号,并从所述电磁信号中提取与侧信道分析目标相关的兴趣特征点构建数据集;基于栈式自编码神经网络技术,以所述数据集作为自编码网络的输入,以所述电磁信号作为自编码网络的输出标签,构建自编码网络结构;在密码中间值数据未知时,采用聚类算法对所述自编码网络结构进行预训练,得到假设模型;利用明文数据对所述假设模型进行优化训练,得到用于进行侧信道安全评估的网络模型。较好地实现了对难以取得密码中间值信息的芯片的侧信道安全防护性能的评估。
  • 芯片电磁信道分析方法系统存储介质
  • [发明专利]基于多环形振荡器FPGA配置电路鲁棒性检测方法-CN201910238169.3有效
  • 赵毅强;曹宇文;何家骥;刘燕江;马浩诚 - 天津大学
  • 2019-03-27 - 2022-10-25 - G06F11/22
  • 本发明属于集成电路安全性检测技术领域,为提出集成电路安全性检测技术方案,本发明,基于多环形振荡器FPGA配置电路鲁棒性检测方法,多环形振荡器RO单元是由两个FPGA查找表LUT基本单元分别配置成的反相器和与门组成的可控震荡逻辑结构,在运行时,环形振荡器上信号不停翻转,产生较高频率的震荡信号,通过FPGA的共用电源网络对FPGA上已配置电路产生影响。对FPGA进行多区域划分,将待测电路先配置在FPGA的某一区域,再将不同数量的RO单元配置在其它区域;对待测电路的重要信号的延时数据以及电路的输出结果进行采集,实现FPGA配置电路鲁棒性的检测。本发明主要应用于集成电路安全性检测场合。
  • 基于环形振荡器fpga配置电路鲁棒性检测方法

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