[发明专利]输出方法及相应的输出电路无效

专利信息
申请号: 96193288.0 申请日: 1996-03-28
公开(公告)号: CN1181821A 公开(公告)日: 1998-05-13
发明(设计)人: 理查德·金泽尔;马里奥·梅尔 申请(专利权)人: 西门子公司
主分类号: G05B19/045 分类号: G05B19/045;G05B19/05
代理公司: 柳沈知识产权律师事务所 代理人: 杨梧
地址: 联邦德*** 国省代码: 暂无信息
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摘要:
搜索关键词: 输出 方法 相应 电路
【说明书】:

发明涉及一种过程信号的输出方法以及相应的输出电路,用于在出现输出条件时把过程信号输出到一个待控制的过程。

在技术过程的控制中,常常需要连续不断地对技术过程所提供的输入信号进行监控,在监控期间要对提供给过程的输出信号加以保持,并且当一个规定的输出信号出现时则需要把那些输出信号加以转换。现有技术中,由一个比较器监控转换点的到达,在到达转换点情况下,该比较器触发一个中断,由此暂停一个处理器且转换输出端。基于不可预见的中断封锁时间,在输出端转换时可能出现不同的运行时间。此外,还可以采用高优先中断暂停用于转换输出端的中断程序。由此得出的结果是输出端只能慢慢地而不能以精确的可重复的反应时间转换。

从DE 3204098 A1中已知一种用于输出控制信息的电路布置,在这种电路布置中,借助一个定时电路,在运行一段规定的时间间隔之后,把一个数据从缓冲存储器传输给一个外围设备。

从EP 0327720 A1已知一种输入/输出电路,在该电路中,在一个阈值鉴别器中将一个输入信号与一个额定值进行比较。

本发明的目的在于提供一种方法和其相应的电路,借助该方法和其相应的电路能在可重复的反应时间内迅速、简捷且可靠地实现输出端的转换。

本发明目的的方法通过权利要求1的特征来实现而本发明目的的电路则通过权利要求4的特征来实现。

输出条件可以是任意性质的。例如待输出的过程信号可能是在达到一段规定的时间或者被操作者按动一个规定的健时被触发。然而通常情况下,当待控制的过程所提供的输入信号与一个额定输入信号一致或者该输入信号最初小于(或大于)该额定输入信号时,才输出应该输出的过程信号。因此,两个信号都被传送给一个由比较器构成的监控单元,在所传送的信号相等或者在信号间出现所需的逻辑关系时,该监控单元触发控制信号。所述输入信号例如可以是一个单、双输入信号的规定组合,或者是一个规定的、预先确定的计数器状态。

通过权利要求2或权利要求5的特征,可以避免当过程信号尚未完全储存到缓冲存储器中时过程信号的输出。

通过权利要求3或权利要求6的特征,可以保证当不满足输出条件时,也能够把新的信号存储到输出存储器中。

从下面对一个实施例的阐述中将得出本发明的其他的优点和细节。其中:

图1是一个可编程控制组件。

根据图1,可编程控制组件1具有一个逻辑单元2。该逻辑单元2可与一根数据总线3相连接。经该数据总线3,逻辑单元2能够与其它的图1中未示出的可编程控组件通信,特别是能够与可编程控制总单元通信。

组件1经输出存储器4把输出信号输出到一个待控制的技术过程P。该输出存储器4通常由锁存器构成。同样,组件1经输入存储器5把输入信号读入到组件1中,输入存储器5同样由锁存器构成。该输入存储器5也可以是例如计数器或串联接口。被读入的输入信号在组件1中将与一个额定输入信号进行比较。当两者相等时便向输出存储器4传送新的输出信号,这些新的输出信号被存储在该输出存储器4中并且被输出到过程P。其具体步骤如下:

在逻辑单元2存储了以下内容:即在何种输入信号格式下必须改变输出信号及随后应该输出的过程信号具有何值。因此逻辑单元2把该输入信号格式作为额定输入信号存储到比较器6中。此外,逻辑单元2经传输线7把待输出的过程信号输送到缓冲存储器8的缓冲存储器输入端8′。接着,逻辑单元件2经控制线路9激活缓冲存储器8,该缓冲存储器仍是由锁存器构成的。这样,传来的过程信号被接收到缓冲存储器8中并且在那里被存储起来,并经过缓冲存储器输出端8″和传输线10被传送到输出存储器4的输出存储器输入端4′。

为了能够防止在错误的时间触发比较器6,在比较器6和输出存储器4之间设置了一个“与”门电路12。“与”门电路12的一个输入端12′与比较器指示输出端6′相连接并且其另一输入端经控制线路11与逻辑单元2相连接。在缓冲存储器8存储待输出的过程信号期间和在为比较器6预给定额定输入信号期间,逻辑单元2经控制线路11输出一个0值封锁信号。这样做的效果是,在“与”门电路12中阻止了可能发生的过早触发比较器6的情况。在存储过程终止后,逻辑单元2经控制线路13启动比较器6。此外该逻辑单元还把经控制线路11输出的封锁信号置1,这样“与”门电路12的输出端12″便由比较器6的输出信号来决定。

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