[实用新型]用于M.2连接器的PCIe信号完整性测试的兼容性负载卡有效
申请号: | 202320009088.8 | 申请日: | 2023-01-03 |
公开(公告)号: | CN218996027U | 公开(公告)日: | 2023-05-09 |
发明(设计)人: | 叶狄俊;杨学丽 | 申请(专利权)人: | 合肥市卓怡恒通信息安全有限公司 |
主分类号: | G06F13/38 | 分类号: | G06F13/38;G06F11/22 |
代理公司: | 深圳市德力知识产权代理事务所 44265 | 代理人: | 林才桂;张洋 |
地址: | 230000 安徽省合肥市经*** | 国省代码: | 安徽;34 |
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摘要: | |||
搜索关键词: | 用于 连接器 pcie 信号 完整性 测试 兼容性 负载 | ||
本实用新型提供一种用于M.2连接器的PCIe信号完整性测试的兼容性负载卡,包括PCB板、以及设于PCB板上的数对PCIe差分信号接口和一对时钟信号接口,所述PCB板具有连接端;所述连接端用于电性连接待测设备的M.2连接器,从而所述M.2连接器传输数路PCIe差分信号分别给数对PCIe差分信号接口,并传输时钟信号给时钟信号接口;所述PCIe差分信号接口用于电性连接信号完整性测试设备,所述时钟信号接口用于电性连接PCIe码型切换触发装置。本实用新型的兼容性负载卡能够满足目前市场上广泛应用的PCIe1.0、PCIe2.0、PCIe3.0及PCIe4.0标准的M.2连接器的信号完整性测试;支持PCIe×1、PCIe×2及PCIe×4总线的测试,应用范围广。
技术领域
本实用新型涉及PCIe信号测试技术领域,尤其涉及一种用于M.2连接器的PCIe信号完整性测试的兼容性负载卡。
背景技术
PCI-Express(peripheral component interconnect express,PCIe)是一种高速串行计算机扩展总线标准,是由英特尔公司在2001年提出的。PCIe属于高速串行点对点双通道高带宽传输,所连接的设备分配独享通道带宽,不共享总线带宽,主要支持主动电源管理、错误报告、端对端的可靠性传输、热插拔以及服务质量等功能。PCIe总线标准的速率从1.0版本的2.5GT/s已经发展到5.0版本的32GT/s,目前PCIe3.0和PCIe4.0标准已经在市面上的PC(个人计算机)主板、商用服务器的主板上广泛使用。由于目前主流的计算机都已经搭配NVMe(Non-Volatile Memory express,非易失性内存主机控制器接口规范)固态硬盘,这种固态硬盘使用的信号通道基本都是PCIe信号通道。
随着PCIe总线速率不断提高,应用厂商的产品设计难度也在不断加大,为了保证产品的质量达标,PCIe总线的信号完整性测试就尤为重要,PCIe总线信号完整性是否满足标准要求也是把控产品品质的关键因素。
PCIe的标准协会对用于PCIe总线的信号测试仪器提出了相应的测试标准,现有技术有应用于PCIe总线标准连接器的兼容性负载卡的产品,但是还缺少用于M.2连接器的PCIe总线的信号完整性测试的负载卡。M.2是一种标准的连接器,最早称作NGFF(NextGeneration Form Factor),标准名称为PCI Express M.2 Specification,主要设计目的是在同一连接器上支持多种模组/卡,并能支持PCIe接口。
实用新型内容
本实用新型的目的在于提供一种用于M.2连接器的PCIe信号完整性测试的兼容性负载卡,能够满足目前市场上广泛应用的PCIe1.0、PCIe2.0、PCIe3.0及PCIe4.0标准的M.2连接器的信号完整性测试。
为了实现上述目的,本实用新型提供一种用于M.2连接器的PCIe信号完整性测试的兼容性负载卡,包括PCB板、以及设于PCB板上的数对PCIe差分信号接口和一对时钟信号接口,所述PCB板具有连接端;所述连接端用于电性连接待测设备的M.2连接器,从而所述M.2连接器传输数路PCIe差分信号分别给数对PCIe差分信号接口,并传输时钟信号给时钟信号接口;所述PCIe差分信号接口用于电性连接信号完整性测试设备,所述时钟信号接口用于电性连接PCIe码型切换触发装置。
所述连接端为金手指。
所述PCIe差分信号接口采用超小型推入式连接器。
所述时钟信号接口采用超小型推入式连接器。
所述兼容性负载卡的长度为80mm,宽度为22mm。
所述待测设备为计算机,所述待测设备包括主控芯片组及与主控芯片组电性连接的M.2连接器,所述主控芯片组与M.2连接器通过PCIe×1总线、PCIe×2总线、或PCIe×4总线电性连接。
所述信号完整性测试设备为示波器。
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