[实用新型]一种多频同步时钟信号发生器有效
| 申请号： | 202220592458.0 | 申请日： | 2022-03-18 |
| 公开（公告）号： | CN217689894U | 公开（公告）日： | 2022-10-28 |
| 发明（设计）人： | 董璐;吴炜 | 申请（专利权）人： | 深圳市中强电子有限公司 |
| 主分类号： | G06F1/12 | 分类号： | G06F1/12 |
| 代理公司： | 北京智行阳光知识产权代理事务所(普通合伙) 11738 | 代理人： | 程安东 |
| 地址： | 518000 广东省深圳市宝安区*** | 国省代码： | 广东;44 |
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| 摘要： | |||
| 搜索关键词： | 一种 同步 时钟 信号发生器 | ||
1.一种多频同步时钟信号发生器，包括中央处理器(1)、发生器主体(101)和计算机存储器(6)，其特征在于：所述中央处理器(1)的左侧信号输入端与信号接收器(2)的信号输出端电性连接，所述中央处理器(1)的右侧的信号输出端与数据对比器(3)的信号输入端电性连接，所述中央处理器(1)的右侧的信号输出端与数据调整器(4)的信号输入端电性连接，所述中央处理器(1)的底部的信号输出端与信号传输处理器(5)的信号输入端电性连接；
所述中央处理器(1)位于发生器主体(101)的内腔，且所述发生器主体(101)的顶部的左右两侧均匀焊接有焊接锡点(102)，且所述发生器主体(101)的顶部的中间开设有信号线接口(105)，且所述发生器主体(101)的顶部且位于信号线接口(105)的外侧固定装配有复位弹簧圈(104)，且所述发生器主体(101)的顶部且位于信号线接口(105)的左右两侧均焊接有密封锡点(103)；
所述中央处理器(1)与计算机存储器(6)电性连接，且所述计算机存储器(6)的信号输入端与输入装置(601)电性连接，且所述计算机存储器(6)的信号输出端与输出装置(602)电性连接，所述计算机存储器(6)与数据存储器(603)电性连接，且所述数据存储器(603)与同步数据处理器(604)电性连接。
2.根据权利要求1所述的一种多频同步时钟信号发生器，其特征在于：所述数据调整器(4)的信号输出端与中央处理器(1)的信号输入端电性连接。
3.根据权利要求1所述的一种多频同步时钟信号发生器，其特征在于：所述信号传输处理器(5)与外设进行电性连接。
4.根据权利要求1所述的一种多频同步时钟信号发生器，其特征在于：所述同步数据处理器(604)的信号输出端与计算机存储器(6)的信号输入端电性连接。
5.根据权利要求1所述的一种多频同步时钟信号发生器，其特征在于：所述计算机存储器(6)的输入端电性连接有译码器(10)，且所述译码器(10)的输入端电性连接有行地址(9)，所述行地址(9)的输入端电性连接有逻辑控制模块(7)，所述逻辑控制模块(7)与地址寄存器(8)电性连接，且所述地址寄存器(8)与行地址(9)电性连接，且所述译码器(10)的输出端电性连接有存储列阵(11)，所述存储列阵(11)的输出端电性连接有数据掩码逻辑模块(12)，且所述数据掩码逻辑模块(12)的输出端电性连接有驱动器(13)，且所述驱动器(13)的输出端电性连接有生成器(14)，且所述生成器(14)与计算机存储器(6)电性连接。
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