[发明专利]一种实现SWP全双工通讯的系统及方法有效

专利信息
申请号: 202210697210.5 申请日: 2022-06-20
公开(公告)号: CN115001643B 公开(公告)日: 2023-10-03
发明(设计)人: 王立峰;张奇惠;刘曼 申请(专利权)人: 广州万协通信息技术有限公司
主分类号: H04L5/14 分类号: H04L5/14
代理公司: 北京市盛峰律师事务所 11337 代理人: 于国富
地址: 510400 广东省广州市白云区北太路1633*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 实现 swp 双工 通讯 系统 方法
【权利要求书】:

1.一种实现SWP全双工通讯的系统,其特征在于,包括SWP模块和CPU,所述SWP模块包括双端口RAM、SWP接收模块、SWP发送模块、SWP控制器以及SWP PAD,所述SWP控制器一端与所述双端口RAM相连,另一端与所述CPU相连;所述SWP接收模块和所述SWP发送模块分别连接在所述双端口RAM的两个不同端口上,所述CPU通过所述SWP控制器控制双端口RAM中所述SWP接收模块和所述SWP发送模块的作业过程;所述SWP PAD作为SWP数据端口,包括电压域数字调制信号通路S1和电流域数字调制信号通路S2,所述SWP接收模块与所述电压域数字调制信号通路S1相连,SWP发送模块与电流域数字调制信号通路S2相连,所述电压域数字调制信号通路S1用于接收SWP模块接收到的数字信号,并传给所述SWP接收模块,所述SWP接收模块接收数据后发送给所述双端口RAM;所述电流域数字调制信号通路S2用于接收SWP发送模块待发送的数据,并将其发送给CLF。

2.根据权利要求1所述的实现SWP全双工通讯的系统,其特征在于,所述SWP控制器与所述CPU之间依次通过APB总线、AHB TO APB桥和AHB总线相连。

3.根据权利要求1所述的实现SWP全双工通讯的系统,其特征在于,所述SWP接收模块接收数据后发送给所述双端口RAM,具体为:所述SWP接收模块接收电压域数字调制信号通路S1传输的数据时,当接收到的数据每满一个字节就直接写入双端口RAM,然后CPU通过SWP控制器读取写入双端口RAM中的数据并按照协议进行解析。

4.根据权利要求3所述的实现SWP全双工通讯的系统,其特征在于,所述CPU处理完待解析的数据后,根据协议将待发送的解析完的数据通过SWP控制器写入双端口RAM,待数据写入完毕后,所述SWP控制器控制连接在所述双端口RAM上的SWP发送模块发送到SWP PAD上的电流域数字调制信号通路S2,并最终通过电流信号发送到CLF。

5.根据权利要求3所述的实现SWP全双工通讯的系统,其特征在于,所述双端口RAM包括多个接收数据存储区和多个发送数据存储区,所述接收数据存储区和发送数据存储区数量相同,每个接收数据存储区和发送数据存储区能够分别存储一个字节。

6.根据权利要求5所述的实现SWP全双工通讯的系统,其特征在于,所述双端口RAM包括4个接收数据存储区和4个发送数据存储区,其中,接受数据存储区地址为:0x00~0x1f,0x20~0x3f,0x40~0x5f,0x60~0x7f;发送数据存储区地址为:0x80~0x9f,0xa0~0xbf,0xc0~0xdf,0xe0~0xff。

7.根据权利要求1所述的实现SWP全双工通讯的系统,其特征在于,所述SWP接收模块和所述SWP发送模块内还包括低频时钟模块,所述低频时钟模块频率范围为8.7MHz到17.4MHz。

8.一种实现SWP全双工通讯的方法,基于权利要求1-7任一所述的实现SWP全双工通讯的系统,其特征在于,包括以下步骤:

S101,CLF发送通讯数据到UICC,UICC中的SWP PAD获取信号后,通过电压域数字调制信号通路S1发送到SWP接收模块;

S102,所述SWP接收模块每接收到一个字节的数据就传输给所述双端口RAM中的一个接收数据存储区,然后CPU通过SWP控制器读取写入双端口RAM中接收数据存储区中的数据并按照协议进行解析;

S103,待数据解析完成后,根据协议将解析完成的数据通过SWP控制器写入双端口RAM上的某个发送数据存储区,待该发送数据存储区中的数据满一个字节后采用所述SWP发送模块通过SWP控制器将接收到的数据通过电流域数字调制信号通路S2发送到SWP PAD,最后发送到CLF。

9.根据权利要求8所述的实现SWP全双工通讯的方法,其特征在于,所述双端口RAM中分别包括四个接收数据存储区和四个发送数据存储区,步骤S101和步骤S102中的步骤循环进行,步骤S103中的过程也同时循环进行。

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