[发明专利]加快芯片验证初始化进程的方法及应用在审
| 申请号： | 202210417149.4 | 申请日： | 2022-04-20 |
| 公开（公告）号： | CN114841100A | 公开（公告）日： | 2022-08-02 |
| 发明（设计）人： | 常志恒;叶亮;王智 | 申请（专利权）人： | 苏州盛科通信股份有限公司 |
| 主分类号： | G06F30/3308 | 分类号： | G06F30/3308;G06F30/3312;G06F9/445 |
| 代理公司： | 苏州三英知识产权代理有限公司 32412 | 代理人： | 潘时伟 |
| 地址： | 215000 江苏省苏州市*** | 国省代码： | 江苏;32 |
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| 摘要： | |||
| 搜索关键词： | 加快 芯片 验证 初始化 进程 方法 应用 | ||
1.一种加快芯片验证初始化进程的方法，其特征在于，所述方法包括：
收集所述芯片内多个模块的复位信号和时钟信号；
根据预设规则将多个所述复位信号和时钟信号赋值；
并行释放多个所述复位信号，并将控制所述时钟信号的使能信号置起，以供芯片的块级和芯片级验证。
2.如权利要求1所述的加快芯片验证初始化进程的方法，其特征在于，所述根据预设规则将多个所述复位信号和时钟信号赋值，包括：
将所述复位信号赋值为第一值，所述时钟信号赋值为第二值时，且第一值和第二值不同。
3.如权利要求1所述的加快芯片验证初始化进程的方法，其特征在于，所述并行释放多个所述复位信号，并将控制所述时钟信号的使能信号置起，包括：
通过宏控制并行释放多个所述复位信号，并将控制所述时钟信号的使能信号置起。
4.一种加快芯片验证初始化进程的装置，其特征在于，所述装置包括：
收集模块，用于收集所述芯片内多个模块的复位信号和时钟信号；
赋值模块，用于根据预设规则将多个所述复位信号和时钟信号赋值；
控制模块，用于并行释放多个所述复位信号，并将控制所述时钟信号的使能信号置起，以供芯片的块级和芯片级验证。
5.如权利要求4所述的加快芯片验证初始化进程的装置，其特征在于，所述赋值模块还用于：
将所述复位信号赋值为第一值，所述时钟信号赋值为第二值时，且第一值和第二值不同。
6.如权利要求4所述的加快芯片验证初始化进程的装置，其特征在于，所述控制模块还用于：
通过宏控制并行释放多个所述复位信号，并将控制所述时钟信号的使能信号置起。
7.一种电子设备，其特征在于，包括：
至少一个处理器；以及
存储器，所述存储器存储指令，当所述指令被所述至少一个处理器执行时，使得所述至少一个处理器执行如权利要求1至3中任一项所述的加快芯片验证初始化进程的方法。
8.一种计算机可读存储介质，其特征在于，所述计算机可读存储介质上存储有计算机程序，所述计算机程序被处理器执行时实现如权利要求1至3任一项所述的加快芯片验证初始化进程的方法的步骤。
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