[发明专利]一种适用于TPC编码的速率匹配系统

权利要求书

1.一种适用于TPC编码的速率匹配系统，其特征在于：包括数据注入模块、TPC编码模块和乒乓RAM模块；所述数据注入模块输出端与所述TPC编码模块输入端连接，所述TPC编码模块输出端与所述乒乓RAM模块输入端连接；其中：

所述数据注入模块用于接收乒乓RAM模块发出数据触发信号，根据所述指示信号产生预先设定的帧长数据输出；

所述TPC编码模块用于完成Turbo乘积码编码并输出编码信号；

所述乒乓RAM模块接收所述编码信号进行速率匹配，并产生写入切换信号做RAM切换，以此完成RAM的写入，当读取时，所述乒乓RAM模块产生读取切换信号做RAM切换，以此完成RAM的读取。

2.如权利要求1所述的一种适用于TPC编码的速率匹配系统，其特征在于：所述乒乓RAM模块包括第一速率匹配模块和第二速率匹配模块，所述第一速率匹配模块速率匹配方法包括：

步骤S1:计算出乒乓操作的匹配过程所能容忍的最大编码延时，设乒乓RAM模块深度为D，TPC后帧同步字长度为32bit，最大编码延时为Ed_m，系统时钟为f_sys，系统时钟下周期为单位T＝1/f_sys，码率为R_b，帧间隔为K，编码前数据帧长为3232bit，最低码率的最大不溢出时间为：

对上述公式变形得出：

由得出：

步骤S2:设TPC实际编码延时为Ed，当Ed≥Ed_m时，在RAM读取数据剩余量小于设定值时，向数据注入模块请求编码数据，设第一速率匹配模块的地址为A由于读写均为单bit数据，为保证RAM不溢出，设：

Ed-A≤D-Ed

对该公式变形为：A≥2×Ed-D，其中定义：Ed≤D≤2×Ed；为保证RAM不被读空，设：A≤D；当Ed≥Ed_m时，为保证系统正常工作，编码前读取数据触发信号产生条件满足以下门限时可保证系统正常工作:

2×Ed-D≤A≤D

Ed≤D≤2×Ed

当Ed≤Ed_m时，TPC编码前总bit为3232，TPC编码后总bit为4096，以一帧数据长度为缓存深度，设最大码速率为20Mbps，同时满足不溢出条件：

D＝4096+32bit

为保证RAM不被读空，设：A≤4128，当Ed≤Ed_m时，编码前读取数据触发信号产生条件满足以下门限：