[发明专利]SoC架构中的多总线拓扑系统及总线互连方法有效
| 申请号: | 202110987956.5 | 申请日: | 2021-08-26 |
| 公开(公告)号: | CN113434460B | 公开(公告)日: | 2022-01-11 |
| 发明(设计)人: | 谷佳华;张玉安;丁杰;郦清华 | 申请(专利权)人: | 长沙海格北斗信息技术有限公司 |
| 主分类号: | G06F15/78 | 分类号: | G06F15/78;G06F15/173 |
| 代理公司: | 长沙永星专利商标事务所(普通合伙) 43001 | 代理人: | 周咏;米中业 |
| 地址: | 410000 湖南省长*** | 国省代码: | 湖南;43 |
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| 摘要: | |||
| 搜索关键词: | soc 架构 中的 总线 拓扑 系统 互连 方法 | ||
1.一种SoC架构中的多总线拓扑系统,其特征在于包括若干路总线矩阵和若干个总线桥;各路总线矩阵上均连接有各自的若干个主机端口和若干个从机端口;总线矩阵与总线矩阵之间通过总线桥连接,从而实现带宽和频率的转换;在任意一路总线矩阵上,还通过总线桥与Slave端口实现AHB/APB协议的转换;同时,所述的SoC架构中的多总线拓扑系统的总线互连方法,包括如下步骤:
S1. 根据各个总线矩阵自身独有的主机端口的标识信息宽度和来自其它总线矩阵自身独有的主机端口的标识信息宽度及所有主机端口数量,计算得到各个总线矩阵的标识信息位宽;
S2. 根据步骤S1得到的总线矩阵的标识信息位宽和总线矩阵自身的若干个主机标识信息宽度,计算得到各个总线矩阵的各个主机所增加的标识信息宽度;
S3. 根据步骤S1得到的各个总线矩阵的标识信息位宽和各个总线矩阵的所有主机端口数量,计算得到进行跨总线访问时所需的互连标记信号的增减量;
S4. 根据步骤S1~步骤S3的计算结果,进行SoC架构中的多总线拓扑系统的总线互连。
2.根据权利要求1所述的SoC架构中的多总线拓扑系统,其特征在于所述的若干路总线矩阵,各个总线矩阵之间的工作频率和工作带宽均不相同。
3.根据权利要求1或2所述的SoC架构中的多总线拓扑系统,其特征在于步骤S1所述的根据各个总线矩阵自身独有的主机端口的标识信息宽度和来自其它总线矩阵自身独有的主机端口的标识信息宽度及所有主机端口数量,计算得到各个总线矩阵的标识信息位宽,具体包括如下步骤:
规定存在
式中
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