[发明专利]一种PCIe链路的修复方法、装置、设备及存储介质在审
申请号: | 202110705108.0 | 申请日: | 2021-06-24 |
公开(公告)号: | CN113419888A | 公开(公告)日: | 2021-09-21 |
发明(设计)人: | 李长飞 | 申请(专利权)人: | 苏州浪潮智能科技有限公司 |
主分类号: | G06F11/07 | 分类号: | G06F11/07;G06F11/22;G06F13/40 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 薛娇 |
地址: | 215100 江苏省苏州市吴*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 一种 pcie 修复 方法 装置 设备 存储 介质 | ||
1.一种PCIe链路的修复方法,其特征在于,包括:
当目标PCIe链路出现非致命错误时,获取本次非致命错误的发生时间;
获取之前记录的所述目标PCIe链路所有的所述非致命错误的发生时间;
判断当前记录的所述目标PCIe链路所有的所述发生时间,是否满足预设的时间分布条件;
若满足,则执行所述目标PCIe链路的修复程序。
2.根据权利要求1所述的PCIe链路的修复方法,其特征在于,所述当目标PCIe链路出现非致命错误时,获取本次非致命错误的发生时间具体为:
当目标PCIe链路对应的PCIe设备关于非致命错误的寄存器值改变时,获取本次非致命错误的发生时间并进行记录。
3.根据权利要求2所述的PCIe链路的修复方法,其特征在于,所述预设的时间分布条件包括:
存在第一预设数量的所述非致命错误发生在第一预设时长内;在第二预设时长内发生过所述非致命错误的时间统计单元的数量达到第二预设数量;
其中,所述时间统计单元的时间长度为第三预设时长,各个所述时间统计单元连续且无交集,所述第二预设时长大于所述第一预设时长;
则所述若满足,则执行所述目标PCIe链路的修复程序之后,该PCIe链路的修复方法还包括:
将当前记录的所述目标PCIe链路所有的所述发生时间清零。
4.根据权利要求3所述的PCIe链路的修复方法,其特征在于,所述执行所述目标PCIe链路的修复程序具体为:
若存在第一预设数量的所述非致命错误发生在第一预设时长内,则重新训练所述目标PCIe链路;
若在第二预设时长内发生过所述非致命错误的时间统计单元的数量达到第二预设数量,则判断所述目标PCIe链路当前的数据传输速率是否大于预设阈值;
若大于,则将所述目标PCIe链路的数据传输速率置为所述预设阈值;
若不大于,则禁用所述目标PCIe链路。
5.根据权利要求4所述的PCIe链路的修复方法,其特征在于,所述若不大于,则禁用所述目标PCIe链路之后,该PCIe链路的修复方法还包括:
控制提示器提示目标PCIe链路存在故障。
6.根据权利要求5所述的PCIe链路的修复方法,其特征在于,所述提示器为显示器。
7.根据权利要求1至6任一项所述的PCIe链路的修复方法,其特征在于,所述非致命错误包括传输层包错误以及数据链路层包错误。
8.一种PCIe链路的修复装置,其特征在于,包括:
第一获取模块,用于当目标PCIe链路出现非致命错误时,获取本次非致命错误的发生时间;
第二获取模块,用于获取之前记录的所述目标PCIe链路所有的所述非致命错误的发生时间;
判断模块,用于判断当前记录的所述目标PCIe链路所有的所述发生时间,是否满足预设的时间分布条件,若满足,则触发执行模块;
所述执行模块,用于执行所述目标PCIe链路的修复程序。
9.一种PCIe链路的修复设备,其特征在于,包括:
存储器,用于存储计算机程序;
处理器,用于执行所述计算机程序时实现如权利要求1至7任一项所述PCIe链路的修复方法的步骤。
10.一种计算机可读存储介质,其特征在于,所述计算机可读存储介质上存储有计算机程序,所述计算机程序被处理器执行时实现如权利要求1至7任一项所述PCIe链路的修复方法的步骤。
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