[发明专利]具有倒灌电流防止机制的通用串行总线信号输出电路在审

专利信息
申请号: 202010228045.X 申请日: 2020-03-27
公开(公告)号: CN113452361A 公开(公告)日: 2021-09-28
发明(设计)人: 朱立程;陈力辅 申请(专利权)人: 瑞昱半导体股份有限公司
主分类号: H03K19/003 分类号: H03K19/003
代理公司: 北京泛华伟业知识产权代理有限公司 11280 代理人: 王勇;王博
地址: 中国台*** 国省代码: 台湾;71
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摘要:
搜索关键词: 具有 倒灌 电流 防止 机制 通用 串行 总线 信号 输出 电路
【权利要求书】:

1.一种具有倒灌电流防止机制的通用串行总线信号输出电路,其包括:

开关电路,包括开关控制端,配置以在所述开关控制端接收到第一高态电压时导通,以进行由信号输入端至信号输出端的信号输出;

第一电压拉低电路,包括:

无源元件高通滤波电路,配置以将所述信号输出端的输出端电压耦合至拉低控制端;以及

放电电路,配置以在所述拉低控制端的电压大于预设电平时导通,以对所述开关控制端进行放电而拉低至小于所述第一高态电压的第二高态电压;以及

第二电压拉低电路,配置以将所述输出端电压与参考电压比较并判断所述输出端电压是否具有突波,并在所述输出端电压大于所述参考电压且不具有所述突波时将所述开关控制端拉低至低态电压。

2.如权利要求1所述的通用串行总线信号输出电路,还包括二极管电路,电性耦合于所述拉低控制端以及接地端,以将所述拉低控制端的电压限制于最大值以下。

3.如权利要求1所述的通用串行总线信号输出电路,其中所述放电电路还包括:

N型晶体管,包括第一栅极、第一漏极以及第一源极,其中所述第一栅极电性耦合于所述拉低控制端,所述第一源极电性耦合于接地端;以及

P型晶体管,包括第二栅极、第二漏极以及第二源极,其中所述第二栅极配置以接收小于所述第一高态电压的驱动电压,所述第二漏极电性耦合于所述第一漏极,所述第二源极电性耦合于所述开关控制端。

4.如权利要求3所述的通用串行总线信号输出电路,其中所述N型晶体管导通时,所述P型晶体管根据所述第二源极以及所述第二栅极间的电压差导通,以将所述开关控制端拉低至所述第二高态电压。

5.如权利要求3所述的通用串行总线信号输出电路,其中所述N型晶体管关闭且所述P型晶体管导通时,所述第一漏极以及所述第二漏极的电压上升至与所述驱动电压相等以使所述P型晶体管关闭。

6.如权利要求3所述的通用串行总线信号输出电路,其中所述P型晶体管的所述第二栅极通过无源元件低通滤波电路接收所述驱动电压。

7.如权利要求1所述的通用串行总线信号输出电路,其中所述第二电压拉低电路包括:

比较器,配置以比较所述输出端电压与所述参考电压以产生比较结果;以及

拉低控制电路,配置以根据所述比较结果判断所述输出端电压是否大于所述参考电压以及所述输出端电压是否具有所述突波,以在所述输出端电压大于所述参考电压且不具有所述突波时将所述开关控制端拉低至所述低态电压。

8.如权利要求1所述的通用串行总线信号输出电路,其中所述开关电路包括:

第一N型晶体管,包括第三栅极、第三漏极以及第三源极,其中所述第三栅极电性耦合于所述开关控制端,所述第三源极电性耦合于所述信号输入端;以及

第二N型晶体管,包括第四栅极、第四漏极以及第四源极,其中所述第四栅极电性耦合于所述开关控制端,所述第四漏极电性耦合于所述第三漏极,所述第四源极电性耦合于所述信号输出端。

9.如权利要求1所述的通用串行总线信号输出电路,还包括开关控制电路,配置以输出所述第一高态电压至所述开关控制端,其中所述第二电压拉低电路还在所述输出端电压大于所述参考电压且不具有所述突波时使所述控制电路停止输出所述第一高态电压。

10.一种具有倒灌电流防止机制的通用串行总线信号输出电路操作方法,应用于通用串行总线信号输出电路中,包括:

使开关电路在开关控制端接收到第一高态电压时导通,以进行由信号输入端至信号输出端的信号输出;

使第一电压拉低电路的无源元件高通滤波电路将所述信号输出端的输出端电压耦合至拉低控制端;

使所述第一电压拉低电路的放电电路在所述拉低控制端的电压大于预设电平时导通,以对所述开关控制端进行放电而拉低至小于所述第一高态电压的第二高态电压;

使第二电压拉低电路将所述输出端电压与参考电压比较并判断所述输出端电压是否具有突波;以及

使所述第二电压拉低电路在所述输出端电压大于所述参考电压且不具有所述突波时将所述开关控制端拉低至低态电压。

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