[发明专利]异构计算平台的数据处理方法、装置及可读存储介质在审
申请号: | 201911385140.4 | 申请日: | 2019-12-28 |
公开(公告)号: | CN111143272A | 公开(公告)日: | 2020-05-12 |
发明(设计)人: | 杨宏斌;赵雅倩;董刚;刘海威 | 申请(专利权)人: | 浪潮(北京)电子信息产业有限公司 |
主分类号: | G06F15/173 | 分类号: | G06F15/173 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 刘新雷 |
地址: | 100085 北京市海*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 计算 平台 数据处理 方法 装置 可读 存储 介质 | ||
1.一种异构计算平台的数据处理方法,其特征在于,包括:
当接收到主机下发的数据处理请求,主动从所述主机的数据存储区域读取待计算数据并存储至待处理数据存储区域;
调用相应数据处理算法对所述待处理数据存储区域中的待计算数据进行数据计算,得到数据计算结果;所述数据计算结果存储于计算结果存储区域;
主动将所述数据计算结果写回至所述主机的数据处理结果存储区域;
其中,所述数据存储区域和所述数据处理结果存储区域为预先从所述主机的内存空间中开辟得到;所述待处理数据存储区域和所述计算结果存储区域为预先从FPGA加速板卡的内存空间中开辟得到。
2.根据权利要求1所述的异构计算平台的数据处理方法,其特征在于,所述主动从所述主机的数据存储区域读取待计算数据并存储至待处理数据存储区域为:
主动从所述主机的第一数据存储区域和/或第二数据存储区域读取待计算数据分别存储至第一待处理数据存储区域和第二待处理数据存储区域;
其中,所述第一数据存储区域和所述第二数据存储区域为预先从所述主机的内存空间中开辟得到,用于存储所述待计算数据;所述第一待处理数据存储区域和所述第二待处理数据存储区域为预先从FPGA加速板卡的内存空间中开辟得到,用于存储从所述主机读取的所述待计算数据。
3.根据权利要求2所述的异构计算平台的数据处理方法,其特征在于,所述主动将所述数据计算结果写回至所述主机的数据处理结果存储区域之后,还包括:
若所述数据存储区域中的待计算数据全部计算完成,则向所述主机发送中断信息,以使所述主机将所述数据存储区域中的待计算数据存储至硬盘后存储新的待计算数据。
4.根据权利要求1所述的异构计算平台的数据处理方法,其特征在于,所述数据处理请求为卷积神经网络数据处理请求,所述主动从所述主机的数据存储区域读取待计算数据并存储至待处理数据存储区域包括:
主动从所述数据存储区域读取待计算的特征图数据,从所述主机的内存空间中读取所述卷积神经网络的网络参数和卷积核系数。
5.根据权利要求1至4任意一项所述的异构计算平台的数据处理方法,其特征在于,采用数据读取线程主动从所述主机的数据存储区域读取待计算数据并存储至待处理数据存储区域;相应的,采用数据处理线程调用相应数据处理算法对所述待处理数据存储区域中的待计算数据进行数据计算,得到数据计算结果;通过数据写入线程主动将所述数据计算结果写回至所述主机的结果存储区域;
所述数据读取线程、所述数据处理线程和所述数据写入线程并列执行。
6.一种异构计算平台的数据处理装置,其特征在于,包括:
数据读取模块,用于当接收到主机下发的数据处理请求,主动从所述主机的数据存储区域读取待计算数据并存储至待处理数据存储区域;所述数据存储区域为预先从所述主机的内存空间中开辟得到;所述待处理数据存储区域为预先从FPGA加速板卡的内存空间中开辟得到;
数据处理模块,用于调用相应数据处理算法对所述待处理数据存储区域中的待计算数据进行数据计算,得到数据计算结果;所述数据计算结果存储于计算结果存储区域;所述计算结果存储区域为预先从FPGA加速板卡的内存空间中开辟得到;
数据写回模块,用于主动将所述数据计算结果写回至所述主机的数据处理结果存储区域;所述数据处理结果存储区域为预先从所述主机的内存空间中开辟得到。
7.根据权利要求6所述的异构计算平台的数据处理装置,其特征在于,所述数据读取模块具体用于主动从所述主机的第一数据存储区域和/或第二数据存储区域读取待计算数据分别存储至第一待处理数据存储区域和第二待处理数据存储区域;
其中,所述第一数据存储区域和所述第二数据存储区域为预先从所述主机的内存空间中开辟得到,用于存储所述待计算数据;所述第一待处理数据存储区域和所述第二待处理数据存储区域为预先从FPGA加速板卡的内存空间中开辟得到,用于存储从所述主机读取的所述待计算数据。
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