[发明专利]一种高速信号采集存储处理系统在审

专利信息
申请号: 201910955679.2 申请日: 2019-10-09
公开(公告)号: CN112416831A 公开(公告)日: 2021-02-26
发明(设计)人: 阎文俊;姜万成 申请(专利权)人: 上海矢元电子有限公司
主分类号: G06F13/40 分类号: G06F13/40;G06F13/16
代理公司: 上海骁象知识产权代理有限公司 31315 代理人: 孙路生
地址: 201612 上海市松*** 国省代码: 上海;31
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摘要:
搜索关键词: 一种 高速 信号 采集 存储 处理 系统
【权利要求书】:

1.一种高速信号采集存储处理系统,其特征在于,包括CPU模块、信号采集模块、若干数据存储模块和若干信号处理模块,其中,所述CPU模块、信号采集模块、数据存储模块和信号处理模块之间通过高速背板通信连接;

所述CPU模块,作为系统的主控模块,提供系统管理及界面显示功能,与信号采集模块实现数据的交互,以及上位机的命令发送;

所述信号采集模块,实现高速信号的采集,并对采集数据进行转换及预处理,同时实现DAC回放功能;

所述数据存储模块,实现高速数据的实时存储,同时实现存储数据的回读或回传功能;

所述信号处理模块,实现数字信号的实时处理。

2.根据权利要求1所述的一种高速信号采集存储处理系统,其特征在于,所述信号采集模块包括采集子板和采集载板;

所述采集子板,实现高带宽数据的采集,同时实现DAC回放功能;

所述采集载板,实现ADC数字信号的串并转换及预处理功能,并且可以将数据传输给数据存储模块进行数据存储,也可以将预处理后的数据或者原始数据直接传输给信号处理模块进行处理,同时能够从数据存储模块中读取波形数据进行DAC回放,或者回放特定的波形。

3.根据权利要求2所述的一种高速信号采集存储处理系统,其特征在于,所述采集子板为FMC+子板,所述采集子板的ADC芯片和DAC芯片的数字接口部分均采用通用的JESD204B高速串行接口,通过FMC+与采集载板连接。

4.根据权利要求2所述的一种高速信号采集存储处理系统,其特征在于,所述采集载板具有两组DDR3、一个标准FMC+插口以及收发一体光单元,所述收发一体光单元用于实现与其它系统的互联。

5.根据权利要求1所述的一种高速信号采集存储处理系统,其特征在于,所述数据存储模块包括FPGA芯片、电源单元、时钟单元以及配置单元;

所述FPGA芯片具有一组4*DDRIII、一组2*DDRIII、一组4*SSD、两组4*GTX接口以及预留的GE和RS232接口;

所述电源单元,将高速背板的+12V电源,根据板内各个模块的需求,经由两级DC-DC转换为特定的电压,保证满足各路电源的功耗需求;

所述时钟单元,提供稳定的高质量参考时钟,供内部锁相环使用;

所述配置单元,通过通用的QSPI实现FPGA的配置。

6.根据权利要求5所述的一种高速信号采集存储处理系统,其特征在于,其中一组所述4*GTX接口连接到高速背板,与系统内的信号采集模块通过高速背板进行互联,实现数据的传输存储;另一组所述4*GTX接口为前端数据光纤接口,负责外部数据的采集并把采集到的数据通过光纤接口传输至FPGA芯片内部。

7.根据权利要求1所述的一种高速信号采集存储处理系统,其特征在于,所述信号处理模块使用3片KU115组合进行数字信号的处理,接口KU115通过16组高速信号经由高速背板与信号采集模块连接,获取信号采集模块的采集数据,在信号处理模块内进行数据分配处理及处理后进行数据融合。

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