[发明专利]存储器系统、存储器模块以及操作存储器模块的方法在审

专利信息
申请号: 201910231779.0 申请日: 2019-03-26
公开(公告)号: CN110308869A 公开(公告)日: 2019-10-08
发明(设计)人: 金大正;姜志锡;高兑京;金成峻;金玗燮;朴赞益;申院济;庾庸准;崔仁寿 申请(专利权)人: 三星电子株式会社
主分类号: G06F3/06 分类号: G06F3/06
代理公司: 北京铭硕知识产权代理有限公司 11286 代理人: 史泉;张川绪
地址: 韩国京畿*** 国省代码: 韩国;KR
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摘要:
搜索关键词: 控制器 读取请求 非易失性存储器模块 非易失性存储器装置 存储器系统 易失性存储器装置 操作存储器 存储器模块 重新发送 配置 读取操作期间 正常数据
【权利要求书】:

1.一种存储器系统,包括:

非易失性存储器模块;

第一控制器,被配置为控制非易失性存储器模块,非易失性存储器模块包括:

易失性存储器装置;

非易失性存储器装置;

第二控制器,被配置为控制易失性存储器装置和非易失性存储器装置,

其中,第一控制器被配置为将读取请求发送到第二控制器,

其中,在根据所述读取请求的读取操作期间,当从非易失性存储器装置没有接收到正常数据时,第一控制器对第二控制器执行所述读取请求的一次或多次重新发送,而不限制第一控制器执行所述读取请求的一次或多次重新发送的次数。

2.根据权利要求1所述的存储器系统,

其中,正常数据包括无错误数据和/或具有在可校正范围内的错误的可校正数据,

其中,在发送所述读取请求之后,当第一时间段过去而没有接收到正常数据时,第一控制器执行所述读取请求的一次或多次重新发送中的第一次重新发送,

其中,在所述读取请求的第一次重新发送之后,当第二时间段过去而没有接收到正常数据时,第一控制器执行所述读取请求的一次或多次重新发送中的第二次重新发送。

3.根据权利要求2所述的存储器系统,其中,第二时间段短于第一时间段。

4.根据权利要求1所述的存储器系统,

其中,正常数据包括无错误数据和/或具有在可校正范围内的错误的可校正数据,

其中,响应于接收到所述读取请求,第二控制器从非易失性存储器装置和易失性存储器装置之一读取包括正常数据和/或不可校正数据的数据。

5.根据权利要求4所述的存储器系统,其中,在第二控制器从非易失性存储器装置读取所述数据的同时,第二控制器忽略所述读取请求的一次或多次重新发送。

6.根据权利要求5所述的存储器系统,其中,在从非易失性存储器装置读取所述数据之后,响应于所述读取请求的一次或多次重新发送中的至少一次重新发送,被读取的所述数据被发送到第一控制器。

7.根据权利要求1所述的存储器系统,其中,在执行所述读取请求的一次或多次重新发送中的第一次重新发送之后,当第三时间段过去而没有接收到正常数据时,第一控制器确定读取失败。

8.根据权利要求7所述的存储器系统,

其中,正常数据包括无错误数据和/或具有在可校正范围内的错误的可校正数据,

其中,第三时间段长于第二控制器从非易失性存储器装置读取包括正常数据和/或不可校正数据的数据的时间段。

9.根据权利要求1所述的存储器系统,其中,第一控制器包括:寄存器,存储第一控制器执行所述读取请求的一次或多次重新发送的次数的限制,

其中,第二控制器被配置为修改所述限制。

10.根据权利要求9所述的存储器系统,其中,第二控制器包括串行存在检测装置,

其中,第二控制器被配置为:当第一控制器访问串行存在检测装置时,修改所述限制。

11.根据权利要求9所述的存储器系统,其中,第二控制器被配置为通过系统管理总线修改所述限制。

12.根据权利要求1所述的存储器系统,

其中,第一控制器将写入请求发送到第二控制器,

其中,在根据所述写入请求的写入操作期间,当第二控制器将写入数据写入到非易失性存储器装置时,第二控制器激活提供给第一控制器的写入错误信号。

13.根据权利要求12所述的存储器系统,

其中,响应于所述写入请求,第二控制器执行对易失性存储器装置和非易失性存储器装置之一的写入,

其中,当根据所述写入请求对非易失性存储器装置的写入完成时,第二控制器对写入错误信号进行去激活。

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