[发明专利]基于存储器的分布式处理器架构在审
申请号: | 201880062664.7 | 申请日: | 2018-07-30 |
公开(公告)号: | CN111149166A | 公开(公告)日: | 2020-05-12 |
发明(设计)人: | E.西蒂;E.希勒尔 | 申请(专利权)人: | 纽罗布拉德有限公司 |
主分类号: | G11C11/34 | 分类号: | G11C11/34 |
代理公司: | 北京市柳沈律师事务所 11105 | 代理人: | 胡琪 |
地址: | 以色列霍*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 基于 存储器 分布式 处理器 架构 | ||
1.一种分布式处理器,包含:
基板;
安置于所述基板上的存储器阵列,所述存储器阵列包括多个离散存储器组;
安置于所述基板上的处理阵列,所述处理阵列包括多个处理器子单元,所述处理器子单元中的每一个与所述多个离散存储器组中对应的专属存储器组相关联;
第一多个总线,其每一个将所述多个处理器子单元中的一个连接至其对应的专属存储器组;以及
第二多个总线,其每一个将所述多个处理器子单元中的一个连接至所述多个处理器子单元中的另一个。
2.根据权利要求1所述的分布式处理器,其中所述基板是半导体基板。
3.根据权利要求1所述的分布式处理器,其中所述基板是电路板。
4.根据权利要求1所述的分布式处理器,其中所述处理阵列的所述多个处理器子单元在空间上分布在所述存储器阵列的所述多个离散存储器组当中。
5.根据权利要求1所述的分布式处理器,其中芯片上的所述分布式处理器是人工智能加速器处理器。
6.根据权利要求1所述的分布式处理器,其中所述多个处理器子单元中的每一个被配置为相对于包含于所述多个处理器子单元中的其他处理器子单元独立地执行与特定应用相关联的软件代码。
7.根据权利要求1所述的分布式处理器,其中所述多个逻辑处理器子单元被布置成至少一行及至少一列,且所述第二多个总线将每一处理器子单元连接至同一行中的至少一个邻近处理器子单元且连接至同一列中的至少一个邻近处理器子单元。
8.根据权利要求1所述的分布式处理器,其中所述多个处理器子单元被布置成星形图案,且所述第二多个总线将每一处理器子单元连接至所述星形图案内的至少一个邻近处理器子单元。
9.根据权利要求1所述的分布式处理器,其中每一处理器子单元与至少两个专属存储器组相关联。
10.根据权利要求1所述的分布式处理器,其中每一专属存储器组包含至少一个动态随机存取存储器。
11.一种存储器芯片,包含:
基板;
安置于所述基板上的存储器阵列,所述存储器阵列包括多个离散存储器组;
安置于所述基板上的处理阵列,所述处理阵列包括各自包括地址产生器的多个逻辑部分,其中所述地址产生器中的每一个与所述多个离散存储器组中对应的专属存储器组相关联;以及
多个总线,每一总线将所述多个地址产生器中的一个连接至其对应的专属存储器组。
12.根据权利要求11所述的存储器芯片,其中每一地址产生器被配置为确定对应于所述地址产生器的存储器组中的待存取以供处理的地址。
13.根据权利要求11所述的存储器芯片,其中所述处理阵列进一步包括多个加速器,每一加速器与对应的地址产生器相关联且被配置为执行特定功能。
14.根据权利要求13所述的存储器芯片,其中所述特定功能包含乘法累加功能、最小值功能、最大值功能、比较功能或计数功能。
15.根据权利要求11所述的存储器芯片,其中所述存储器芯片是DRAM、快闪、SRAM、ReRAM、PRAM、MRAM或ROM存储器芯片中的至少一个。
16.根据权利要求11所述的存储器芯片,其中每一处理器子单元包含精简指令集计算机(RISC)处理器或复杂指令集计算机(CISC)处理器。
17.根据权利要求11所述的存储器芯片,其进一步包含连接至外部主机的存储器接口。
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