[发明专利]用于处理且读取数据的波形管线、系统、存储器及方法有效

专利信息
申请号: 201811435413.7 申请日: 2018-11-28
公开(公告)号: CN110047533B 公开(公告)日: 2023-03-21
发明(设计)人: 卡韦赫·沙克瑞;阿里·法伊兹·扎尔林·加莱姆 申请(专利权)人: 美光科技公司
主分类号: G11C11/4076 分类号: G11C11/4076
代理公司: 北京律盟知识产权代理有限责任公司 11287 代理人: 王龙
地址: 美国爱*** 国省代码: 暂无信息
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摘要:
搜索关键词: 用于 处理 读取 数据 波形 管线 系统 存储器 方法
【说明书】:

本申请案涉及一种用于处理且读取数据的波形管线、系统、存储器及方法。所述波形管线包含多个数据路径、时钟信号路径及返回时钟信号路径。每一数据路径包含输入节点、输出节点及所述输入节点与所述输出节点之间的数据级。每一数据路径在所述输入节点与所述输出节点之间具有不同延迟。所述多个数据路径中的第一数据路径具有第一延迟且所述多个数据路径中的其它数据路径中的每一者具有小于所述第一延迟的延迟。所述时钟信号路径将时钟信号提供给每一数据路径的数据级。所述返回时钟信号路径从所述第一数据路径的数据级提供返回时钟信号。所述返回时钟信号触发源于所述多个数据路径中的每一数据路径的所述数据级的数据。

技术领域

发明大体上涉及集成电路装置中的信号时序。特定来说,在一或多个实施例中,本发明涉及存储器装置中的波形管线的偏斜减少。

背景技术

存储器装置通常被提供为计算机或其它电子装置中的内部半导体集成电路装置。存在许多不同类型的存储器,包含随机存取存储器(RAM)、只读存储器(ROM)、动态随机存取存储器(DRAM)、同步动态随机存取存储器(SDRAM)及快闪存储器。

快闪存储器装置已发展成为广泛范围的电子应用的非易失性存储器的流行源。快闪存储器装置通常使用允许高存储器密度、高可靠性及低功耗的单晶体管存储器单元。通过编程(其通常称为写入)电荷存储结构(例如,浮动栅极或电荷陷阱)或其它物理现象(例如,相变或极化)的存储器单元的阈值电压的改变确定每一单元的数据值。快闪存储器的常见用途包含个人计算机、平板计算机、数码相机、数字媒体播放器、蜂窝电话、固态驱动器及可拆卸存储器模块,且用途正在增长。

可在数据路径中使用波形管线以在集成电路(例如存储器装置)的不同部分之间发送或接收数据。在波形管线中,数据信号及时钟信号一起移动。然而,用于数据信号及时钟信号的不同路径可能导致数据信号与时钟信号之间的偏斜。应最小化数据信号与时钟信号之间的偏斜,这是因为大偏斜限制最大时钟频率以及数据信号及时钟信号可行进的最大距离。

出于上述原因且出于所属领域的技术人员在阅读及理解本说明书后将明白的其它下述原因,所属领域需要用于减少波形管线中的数据信号与时钟信号之间的偏斜的替代方法,以及用来执行此类方法的系统及设备。

发明内容

在一方面,本申请案提供一种波形管线,其包括:多个数据路径,每一数据路径包括输入节点、输出节点及所述输入节点与所述输出节点之间的数据级,所述多个数据路径中的每一数据路径在所述输入节点与所述输出节点之间具有不同延迟,且所述多个数据路径中的第一数据路径具有第一延迟且所述多个数据路径中的其它数据路径中的每一者具有小于所述第一延迟的延迟;时钟信号路径,其用来将时钟信号提供给所述多个数据路径中的每一数据路径的数据级;及返回时钟信号路径,其用来从所述多个数据路径中的所述第一数据路径的数据级提供返回时钟信号,所述返回时钟信号用来触发源于所述多个数据路径中的每一数据路径的所述数据级的数据。

在另一方面,本申请案提供一种系统,其包括:时钟信号路径,其用来提供时钟信号;第一数据路径,其包括第一感测装置,所述第一感测装置用来响应于所述时钟信号而从存储器单元阵列感测第一数据,所述第一数据路径具有第一延迟;第二数据路径,其包括第二感测装置,所述第二感测装置用来响应所述时钟信号而从所述存储器单元阵列感测第二数据,所述第二数据路径具有大于所述第一延迟的第二延迟;及返回时钟信号路径,其在所述第二感测装置处耦合到所述时钟信号路径以提供返回时钟信号。

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