[发明专利]一种芯片内可重构串行总线控制器的硬件实现方法在审
| 申请号： | 201811131605.9 | 申请日： | 2018-09-27 |
| 公开（公告）号： | CN109359083A | 公开（公告）日： | 2019-02-19 |
| 发明（设计）人： | 黄凯 | 申请（专利权）人： | 浙江大学 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 杭州浙科专利事务所(普通合伙) 33213 | 代理人： | 吴秉中 |
| 地址： | 310013 浙江*** | 国省代码： | 浙江;33 |
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| 摘要： | |||
| 搜索关键词： | 硬件实现 串行总线控制器 通信协议 可重构 芯片 复用控制 接口协议 控制电路 逻辑功能 软件配置 顺序配置 协议电路 非标准 灵活的 状态机 非标 跳转 转换 配置 开发 | ||
【权利要求书】：
1.一种芯片内可重构串行总线控制器的硬件实现方法，包括如下步骤：首先定义多个状态，每个状态都能通过控制电路实现对应的逻辑功能，然后将要实现支持的通信协议所对应的状态机转换和跳转按照顺序配置进去，实现通过软件配置来支持不同的接口协议。
2.如权利要求1所述的片内可重构串行总线控制器的硬件实现方法，其特征在于：所对应的状态机转换和跳转按照顺序配置进去的类似指令分为两种：第一种由状态的值和对应的跳转指令的地址组成；第二种是跳转指令，由几个对应状态所可能跳转到的下一个状态机所对应的地址所组成。
3.如权利要求1所述的片内可重构串行总线控制器的硬件实现方法，其特征在于：所支持的标准协议包括I2C、SPI、SSP、Microwire、Enhanced SPI、IrDA 1.0 SIR、RS485、UART、ISO7816-3。
4.如权利要求1所述的片内可重构串行总线控制器的硬件实现方法，其特征在于：所支持的接口协议包括自定义的非标准通信协议。
5.如权利要求1所述的片内可重构串行总线控制器的硬件实现方法，其特征在于：还包括同时存储两份状态及跳转指令，实现全双工的通信协议。
6.如权利要求1所述的片内可重构串行总线控制器的硬件实现方法，其特征在于：可配置的状态机和跳转指令配合，实现接口协议的控制逻辑。
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