[发明专利]半导体器件有效

专利信息
申请号: 201811066922.7 申请日: 2018-09-13
公开(公告)号: CN110196821B 公开(公告)日: 2023-04-07
发明(设计)人: 金载镒 申请(专利权)人: 爱思开海力士有限公司
主分类号: G06F13/16 分类号: G06F13/16
代理公司: 北京弘权知识产权代理有限公司 11363 代理人: 许伟群;郭放
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 半导体器件
【说明书】:

本发明提供一种半导体器件。所述半导体器件可以包括多用途命令锁存电路、锁存控制信号发生电路和训练控制电路。所述多用途命令锁存电路可以被配置为使多用途命令与第一分频时钟信号同步以产生第一锁存多用途命令。所述锁存控制信号发生电路可以被配置为同步于第一分频时钟信号而锁存控制信号以产生第一锁存控制信号。训练控制电路可以被配置为基于训练标志而从第一锁存多用途命令和第一锁存控制信号产生用于执行芯片选择信号的训练操作的训练信号。

相关申请的交叉引用

本申请要求于2018年2月27日提交的申请号为10-2018-0024049的韩国专利申请的优先权,其全部内容通过引用合并于此。

技术领域

本公开的实施例总体而言涉及执行训练操作的半导体器件。

背景技术

诸如便携式计算机、个人数字助理(PDA)和移动电话的移动系统已经被开发,以使其重量减小便于携带。向移动系统提供电力的电池可能在很大程度上影响移动系统的总重量。如果移动系统中采用的半导体器件的功耗降低,则电池的容量也可以降低,从而使移动系统的总重量减小。随着多功能移动系统的发展,快速移动系统的需求量越来越大。因此,诸如移动存储器件(也被称为“移动存储芯片”)的半导体器件的数据传输速度可能是决定高性能移动系统的操作速度的重要因素。

近来,半导体器件已经被设计为通过多个引脚同时接收命令和地址。在这种情况下,通过所述多个引脚输入到每个半导体器件的信号可以包括关于命令和地址的所有信息,并且命令解码器和地址解码器可以对通过所述多个引脚输入的信号进行解码以提取命令和地址。

在同步半导体器件的情形中,命令和地址可以同步于时钟信号而被输入。例如,双数据速率(DDR)半导体器件可以同步于时钟信号的上升沿和下降沿而接收命令和地址,单数据速率(SDR)半导体器件可以同步于时钟信号的上升沿而接收命令和地址。

发明内容

根据一个实施例,一种半导体器件可以包括训练控制电路,其被配置为从第一锁存多用途命令和第一锁存控制信号产生用于执行芯片选择信号的训练操作的训练信号。所述训练控制电路可以被配置为将所述第一锁存多用途命令延迟以产生第一延迟多用途命令和第二延迟多用途命令。如果多用途命令在与时钟信号的周期时间的“N”倍相对应的时段期间被使能,其中N是大于1的整数,则所述训练控制电路可以被配置为对所述第一锁存控制信号解码以产生第一训练进入信号,并且被配置为响应于所述第一训练进入信号而从所述第一锁存多用途命令产生被使能的所述训练信号。如果所述多用途命令在与所述时钟信号的所述周期时间相对应的时段期间被使能,则所述训练控制电路可以被配置为响应于所述第一延迟多用途命令而锁存所述第一锁存控制信号,被配置为对所述第一锁存控制信号的锁存信号解码以产生所述第一训练进入信号,并且被配置为响应于所述第一训练进入信号而从所述第二延迟多用途命令产生被使能的所述训练信号。

根据另一个实施例,一种半导体器件可以包括多用途命令锁存电路、锁存控制信号发生电路和训练控制电路。所述多用途命令锁存电路可以被配置为使多用途命令与第一分频时钟信号同步以产生第一锁存多用途命令。所述锁存控制信号发生电路可以被配置为同步于所述第一分频时钟信号而锁存控制信号以产生第一锁存控制信号。所述训练控制电路可以被配置为基于训练标志从所述第一锁存多用途命令和所述第一锁存控制信号产生用于执行芯片选择信号的训练操作的训练信号。

附图说明

图1是示出根据一个实施例的半导体器件的配置的框图。

图2是示出图1的半导体器件中包括的分频时钟发生电路的示例的配置的框图。

图3是示出图1的半导体器件中包括的多用途命令锁存电路的示例的配置的框图。

图4是示出图1的半导体器件中包括的锁存控制信号发生电路的示例的配置的电路图。

图5是示出图1的半导体器件中包括的训练控制电路的示例的配置的框图。

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