[发明专利]在容错量子计算中优化物理参数以减少频率拥挤在审
| 申请号： | 201780089284.8 | 申请日： | 2017-12-05 |
| 公开（公告）号： | CN110494870A | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | E·马格桑;J·甘贝塔 | 申请（专利权）人： | 国际商业机器公司 |
| 主分类号： | G06N10/00 | 分类号： | G06N10/00;H03K19/003 |
| 代理公司： | 11247 北京市中咨律师事务所 | 代理人： | 刘薇;于静<国际申请>=PCT/EP20 |
| 地址： | 美国*** | 国省代码： | 美国;US |
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| 摘要： | |||
| 搜索关键词： | 量子 校验 配置 受控 纠错 | ||
1.一种用于量子纠错的电路，所述电路包括：
被配置为目标量子比特的代码量子比特，所述代码量子比特具有第一退相时间和第一非谐性；以及
被配置为控制量子比特的校验量子比特，所述校验量子比特具有第二退相时间和第二非谐性，其中，所述目标量子比特和所述控制量子比特被配置为形成一个或多个受控非(CNOT)门，其中，所述第一退相时间大于所述第二退相时间，所述第二非谐性大于所述第一非谐性。
2.根据权利要求1所述的电路，其中，所述校验量子比特中的一个校验量子比特被配置为耦合到所述代码量子比特中的四个代码量子比特。
3.根据权利要求1所述的电路，其中，总线谐振器被配置为包括所述代码量子比特中的两个代码量子比特和所述校验量子比特中的两个校验量子比特。
4.根据权利要求3所述的电路，其中，所述两个代码量子比特被配置为耦合在一起。
5.根据权利要求4所述的电路，其中，所述两个校验量子比特被配置为耦合到所述两个代码量子比特。
6.根据权利要求1所述的电路，其中，所述第一退相时间是所述代码量子比特维持给定的状态叠加的时间长度，所述第二退相时间是所述校验量子比特维持给定的状态叠加的时间长度。
7.根据权利要求1所述的电路，其中，所述第一非谐性表示所述代码量子比特偏离谐波振荡器的偏差，所述第二非谐性表示所述校验量子比特偏离谐波振荡器的偏差。
8.根据权利要求1所述的电路，其中，所述代码量子比特是transmon量子比特。
9.根据权利要求1所述的电路，其中，所述校验量子比特中的每一个是被电容器分流的约瑟夫森结环路，所述环路具有多于两个的约瑟夫森结。
10.一种配置用于量子纠错的电路的方法，包括：
将代码量子比特配置为目标量子比特，所述代码量子比特具有第一退相时间和第一非谐性；以及
将校验量子比特配置为控制量子比特，所述校验量子比特具有第二退相时间和第二非谐性，其中，所述目标量子比特和所述控制量子比特被配置为形成一个或多个受控非(CNOT)门，其中，所述第一退相时间大于所述第二退相时间，所述第二非谐性大于所述第一非谐性。
11.根据权利要求10所述的方法，其中，所述校验量子比特中的一个校验量子比特被配置为耦合到所述代码量子比特中的四个代码量子比特。
12.根据权利要求10所述的方法，其中，总线谐振器被配置为包括所述代码量子比特中的两个码量子比特和所述校验量子比特中的两个校验量子比特。
13.根据权利要求12所述的方法，其中，所述两个代码量子比特被配置为耦合在一起。
14.根据权利要求13所述的方法，其中，所述两个校验量子比特被配置为耦合到所述两个代码量子比特。
15.根据权利要求10所述的方法，其中，所述第一退相时间是所述代码量子比特维持给定的状态叠加的时间长度，所述第二退相时间是所述校验量子比特维持给定的状态叠加的时间长度。
16.根据权利要求10所述的方法，其中，所述第一非谐性表示所述代码量子比特偏离谐波振荡器的偏差，所述第二非谐性表示所述校验量子比特偏离谐波振荡器的偏差。
17.如权利要求10所述的方法，其中，所述代码量子比特是transmon量子比特。
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