[实用新型]一种基于FPGA的综合编译码器有效
| 申请号： | 201720194492.1 | 申请日： | 2017-03-02 |
| 公开（公告）号： | CN206481289U | 公开（公告）日： | 2017-09-08 |
| 发明（设计）人： | 段建军;郭小杰;邹亮 | 申请（专利权）人： | 四川九洲空管科技有限责任公司 |
| 主分类号： | H03M1/02 | 分类号： | H03M1/02 |
| 代理公司： | 成都九鼎天元知识产权代理有限公司51214 | 代理人： | 邓世燕 |
| 地址： | 621000 四川*** | 国省代码： | 四川;51 |
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| 摘要： | |||
| 搜索关键词： | 一种 基于 fpga 综合 译码器 | ||
1.一种基于FPGA的综合编译码器，其特征在于：包括通信控制单元和分别与通信控制单元连接的询问编码单元、询问译码单元、应答编码单元和应答译码单元；其中：
所述通信控制单元将上位机下传的询问编码数据传输给询问编码单元，将询问编码单元输出的编码信号通过发射通道发射出去，将询问编码单元输出的询问模式和距离门信息传输给应答译码单元，将闭锁信息传输给应答译码单元和询问译码单元；
所述通信控制单元通过接收通道接收询问信号并传输给询问译码单元，将询问译码单元输出的应答触发、模式信息传输给应答编码单元，将S模式询问信息上传给上位机；
所述通信控制单元将上位机下传的应答编码、断续震荡或扩展断续震荡数据传输给应答编码单元，将应答编码单元输出的编码信号在发射通道发射出去，将应答编码单元输出的闭锁信息传输给询问编码单元、询问译码单元和应答译码单元；
所述通信控制单元通过接收通道接收应答信号并传输给应答译码单元，将应答译码单元输出的应答译码信息上传给上位机。
2.根据权利要求1所述的一种基于FPGA的综合编译码器，其特征在于：所述通信控制单元通过EMIFA地址数据总线接收上位机下传的询问编码数据；通过SPI总线控制射频收发机切换到1030MHz频率，通过LVDS总线将询问编码单元输出的编码信号在发射通道发射出去，通过LVDS总线接收询问信号并传输给询问译码单元。
3.根据权利要求2所述的一种基于FPGA的综合编译码器，其特征在于：所述通信控制单元将S模式询问信息通过GPIO和EMIFA地址数据总线上传给上位机。
4.根据权利要求1所述的一种基于FPGA的综合编译码器，其特征在于：所述通信控制单元通过EMIFA地址数据总线接收上位机下传的应答编码、断续震荡或扩展断续震荡数据传输给应答编码单元；通过SPI总线控制射频收发机切换到1090MHz频率，通过LVDS总线将应答编码单元输出的编码信号在发射通道发射出去，通过LVDS总线接收应答信号并传输给应答译码单元。
5.根据权利要求4所述的一种基于FPGA的综合编译码器，其特征在于：所述通信控制单元将应答译码单元输出的应答译码信息通过GPIO和EMIFA地址数据总线上传给上位机。
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