[发明专利]一种全桥整流器及自适应调节装置有效

专利信息
申请号: 201711433007.2 申请日: 2017-12-26
公开(公告)号: CN109962605B 公开(公告)日: 2020-06-05
发明(设计)人: 郭越勇;刘柳胜;程宝洪 申请(专利权)人: 美芯晟科技(北京)有限公司
主分类号: H02M1/088 分类号: H02M1/088
代理公司: 北京亿腾知识产权代理事务所(普通合伙) 11309 代理人: 陈霁
地址: 100191 北京市海淀*** 国省代码: 北京;11
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摘要:
搜索关键词: 一种 整流器 自适应 调节 装置
【权利要求书】:

1.一种全桥整流器自适应调节电路,其特征在于,包括:判断电路和可配置延迟电路;

所述判断电路与所述可配置延迟电路相连接,所述判断电路用于接收驱动电压和开启信号,输出控制信号;

所述可配置延迟电路,用于接收所述控制信号和驱动电压,所述可配置延迟电路内的电容阵列根据所述控制信号处理所述驱动电压输出延迟后的驱动电压;

所述判断电路包括:当前周期采样模块、累加器和寄存器;

所述当前周期采样模块接收驱动电压和开启信号,输出累加信号;

所述累加器接收累加信号和从寄存器输出反馈回的控制信号进行累加求和,输出累加结果;

所述寄存器存储累加器输出的累加结果,并输出控制信号至所述可配置延迟电路和所述累加器。

2.根据权利要求1所述的电路,其特征在于,所述当前周期采样模块具体包括:反相器、第一D触发器、第二D触发器和延时单元;

反相器接收驱动电压,输出至第一D触发器的D端,第一D触发器的CP端接收开启信号,第一D触发器的R端接收驱动电压,第一D触发器的Q端输出至第二D触发器的D端;

延时单元一端接收反相器的输出端,另一端输出至第二D触发器的CP端。

3.根据权利要求1所述的电路,其特征在于,所述累加器根据电路的速度、精度和效率确定为n位累加器,n为正整数;以及

所述寄存器包括n个D触发器;以及

所述n个D触发器的CP端接收驱动电压,D端接收累加器输出的累加结果,通过Q端共同输出控制信号;以及

所述D触发器替换为RS触发器或JK触发器。

4.根据权利要求1所述的电路,其特征在于,所述可配置延迟电路为由电流为可配置电容阵列充电的结构,包括:n个延迟MOS管、n个电容、电流源、第一反相器、第二反相器、第三反相器和驱动MOS管;

所述电流源第一端接电源VDD,第二端连接驱动MOS管的漏极,驱动MOS管的源极接地,驱动电压经过第一反相器和第二反相器,连接驱动MOS管的栅极;所述n个延迟MOS管的漏极与电流源第二端相连,所述n个延迟MOS管的栅极接收控制信号,所述n个延迟MOS管中的每个MOS管的源极的与n个电容的每个相连,n个电容另一端接地;

所述第三反相器一端接所述电流源第二端,另一端输出延迟后的驱动电压。

5.根据权利要求4所述的电路,其特征在于,所述n个电容的容量具体为:第二个电容为第一个电容的2倍,第三个电容为第一个电容的4倍,以此类推,第n个电容为第一个电容的2n-1倍。

6.根据权利要求4所述的电路,其特征在于,所述第一反相器、第二反相器和第三反相器用比较器替换。

7.根据权利要求1所述的电路,其特征在于,所述可配置延迟电路的结构为由电阻为可配置电容阵列充电的结构,或由可配置电流阵列为电容充电的结构;

所述控制信号编码为8421编码或温度码。

8.根据权利要求1所述的电路,其特征在于,还包括微处理器;

所述微处理器接收所述判断电路输出的控制信号,并通过软件对控制信号进行控制,输出给所述可配置延迟电路。

9.一种全桥整流器,其特征在于,包括如权利要求1至8中任一权利要求所述的电路。

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