[发明专利]包括时钟发生电路的半导体器件及使用其的半导体系统有效

专利信息
申请号: 201711261532.0 申请日: 2017-12-04
公开(公告)号: CN108874710B 公开(公告)日: 2021-09-07
发明(设计)人: 金圭荣 申请(专利权)人: 爱思开海力士有限公司
主分类号: G06F13/40 分类号: G06F13/40
代理公司: 北京弘权知识产权代理有限公司 11363 代理人: 王建国;厉锦
地址: 韩国*** 国省代码: 暂无信息
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摘要:
搜索关键词: 包括 时钟 发生 电路 半导体器件 使用 半导体 系统
【权利要求书】:

1.一种半导体器件,包括:

时钟发生电路,被配置成:从半导体器件外部接收数据时钟信号,在第一操作模式中接收具有第一频率的第一时钟信号对作为数据时钟信号,在第二操作模式中接收具有第二频率的第二时钟信号对以及与第二时钟信号对具有预定相位差的第三时钟信号对作为数据时钟信号,以及产生具有第二频率的多个内部时钟信号;以及

数据输入/输出电路,被配置成基于所述多个内部时钟信号来接收或传输数据。

2.如权利要求1所述的半导体器件,其中,第二频率为第一频率的一半。

3.如权利要求1所述的半导体器件,其中,预定相位差为90度。

4.如权利要求1所述的半导体器件,

其中,时钟发生电路包括:

第一时钟发生电路,被配置成接收第一数据时钟信号以及产生多个第一内部时钟信号;以及

第二时钟发生电路,被配置成接收第二数据时钟信号以及产生多个第二内部时钟信号,

其中,第一时钟发生电路在第一操作模式中接收第一时钟信号对作为第一数据时钟信号,以及在第二操作模式中接收第二时钟信号对作为第一数据时钟信号,以及

其中,第二时钟发生电路在第一操作模式中接收第一时钟信号对作为第二数据时钟信号,以及在第二操作模式中接收第三时钟信号对作为第二数据时钟信号。

5.如权利要求4所述的半导体器件,其中,第一时钟发生电路包括:

第一时钟缓冲器,被配置成接收第一数据时钟信号;

第一正常时钟路径,与第一时钟缓冲器耦接,且被配置成:接收第一数据时钟信号,对第一数据时钟信号分频,以及产生多个第一分频时钟信号;以及

第一测试时钟路径,与第一时钟缓冲器耦接,且被配置成:接收第一数据时钟信号,缓冲第一数据时钟信号以及产生第一测试时钟信号。

6.如权利要求5所述的半导体器件,其中,第一时钟发生电路还包括:

时钟开关,被配置成基于开关控制信号来切断第一时钟缓冲器与第一测试时钟路径之间的耦接。

7.如权利要求5所述的半导体器件,其中,第二时钟发生电路包括:

第二时钟缓冲器,被配置成接收第二数据时钟信号;

第二正常时钟路径,与第二时钟缓冲器耦接,且被配置成:接收第二数据时钟信号,对第二数据时钟信号分频以及产生多个第二分频时钟信号;以及

第二测试时钟路径,与第二时钟缓冲器耦接,且被配置成:接收第二数据时钟信号,缓冲第二数据时钟信号以及产生第二测试时钟信号。

8.如权利要求7所述的半导体器件,其中,第二时钟发生电路还包括:

时钟开关,被配置成基于开关控制信号来切断第二时钟缓冲器与第二测试时钟路径之间的耦接。

9.如权利要求7所述的半导体器件,其中,第一时钟发生电路还包括;

时钟多路复用器,被配置成在第一操作模式中提供多个第一分频时钟信号作为多个第一内部时钟信号,以及在第二操作模式中提供第一测试时钟信号和第二测试时钟信号作为多个第一内部时钟信号。

10.如权利要求7所述的半导体器件,其中,第二时钟发生电路还包括:

时钟多路复用器,被配置成在第一操作模式中提供多个第二分频时钟信号作为多个第二内部时钟信号,以及在第二操作模式中提供第一测试时钟信号和第二测试时钟信号作为多个第二内部时钟信号。

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