[发明专利]一种逆变器电路系统有效

专利信息
申请号: 201710785150.1 申请日: 2017-09-04
公开(公告)号: CN107592028B 公开(公告)日: 2020-03-31
发明(设计)人: 刘超;祝明建;张纪充 申请(专利权)人: 佛山市索尔电子实业有限公司
主分类号: H02M7/5395 分类号: H02M7/5395;H02M3/335;H02M1/44
代理公司: 广州嘉权专利商标事务所有限公司 44205 代理人: 王国标
地址: 528000 广东省*** 国省代码: 广东;44
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摘要:
搜索关键词: 一种 逆变器 电路 系统
【权利要求书】:

1.一种逆变器电路系统,其特征在于:包括供电电池、第一处理芯片、第二处理芯片、DC-AC模块、变压器、AC-DC模块、逆变模块、隔离通信模块、隔离驱动模块以及为电路各部分供电的辅助电源;所述供电电池与辅助电源输入端相连,所述第一处理芯片通过隔离通信模块与第二处理芯片通信连接,所述供电电池与DC-AC模块输入端相连,所述DC-AC模块输出端与变压器初级绕组相连,所述变压器次级绕组与AC-DC模块输入端相连,所述AC-DC模块输出端与逆变模块输入端相连,所述逆变模块的输出端作为逆变器的电源输出端,所述第一处理芯片与位于变压器初级绕组一侧的电路模块相连,所述第二处理芯片与变压器次级绕组一侧的电路模块相连;所述逆变模块是一种包括有4个第一MOS管的全桥式逆变器拓扑结构,所述第二处理芯片通过隔离驱动模块分别与4个第一MOS管栅极相连;

逆变器电路系统还包括电平转换模块,所述DC-AC模块包括两个开关管组,每个开关管组均包括多个第二MOS管,每个开关管组中各个第二MOS管的栅极连接在一起,每个开关管组中各个第二MOS管的源极连接在一起,每个开关管组中各个第二MOS管的漏极连接在一起,所述第一处理芯片分别通过电平转换模块与两个开关管组中各个第二MOS管栅极相连,每个开关管组中各个第二MOS管的源极均接地,所述变压器初级绕组两端分别与两个开关管组中各个第二MOS管的漏极相连,所述变压器初级绕组中间级与供电电池相连。

2.根据权利要求1所述的一种逆变器电路系统,其特征在于:所述隔离驱动模块包括两个型号为IR2110S的驱动芯片、三极管Q5、三极管Q6、三极管Q7以及三极管Q8,所述第二处理芯片配置有输出端SPWM1-1、输出端SPWM2-2、输出端SPWM3-3以及输出端SPWM4-4,所述输出端SPWM1-1分别与三极管Q5发射极以及三极管Q6基极相连,所述输出端SPWM2-2分别与三极管Q5基极与以及三极管Q6发射极相连,所述输出端SPWM3-3分别与三极管Q7发射极以及三极管Q8基极相连,所述输出端SPWM14-4分别与三极管Q7基极以及三极管Q8发射极相连,所述三极管Q5、三极管Q6、三极管Q7以及三极管Q8集电极分别与驱动芯片输入端相连,所述驱动芯片输出端分别与4个第一MOS管栅极相连。

3.根据权利要求1所述的一种逆变器电路系统,其特征在于:所述电平转换模块包括两个转换单元,所述转换单元包括电阻R1、电阻R2、电阻R3、电阻R4、电容C1、电容C2、三极管Q1、三极管Q2以及二极管D1,所述辅助电源输出端通过电阻R1和电阻R2与三极管Q1基极相连,所述三极管Q1发射极接地,所述三极管Q1集电极与通过电阻R3与辅助电源输出端相连,所述三极管Q1集电极与三极管Q2基极相连,所述三极管Q2集电极与辅助电源输出端相连,所述三极管Q2发射极通过电阻R4与开关管组栅极相连,所述电容C1与电容C2均与电阻R4并联,所述二极管D1正极与三极管Q2发射极相连,所述二极管D1负极与三极管Q1集电极相连。

4.根据权利 要求1所述的一种逆变器电路系统,其特征在于:所述AC-DC模块包括由4个整流二极管组成的整流桥。

5.根据权利要求1所述的一种逆变器电路系统,其特征在于:所述隔离通信模块包括光电耦合器U1、光电耦合器U2、三极管Q3以及三极管Q4,所述第一处理芯片发射端与三极管Q4基极相连,所述三极管Q4发射极接地,所述三极管Q4集电极通过光电耦合器U2输入端与辅助电源相连,所述光电耦合器U2输出端与第二处理芯片接收端相连,所述第二处理芯片发射端与三极管Q3基极相连,所述三极管Q3发射极接地,所述三极管Q3集电极通过光电耦合器U1输入端与辅助电源相连,所述光电耦合器U1输出端与第一处理芯片接收端相连。

6.根据权利要求1所述的一种逆变器电路系统,其特征在于:还包括EMI滤波模块,所述逆变模块输出端与EMI滤波模块输入端相连,所述EMI滤波模块输出端作为逆变器的电源输出端。

7.根据权利要求6所述的一种逆变器电路系统,其特征在于:还包括型号为ACS712-20A的电流传感器芯片,所述EMI滤波模块输出端与电流传感器芯片输入端相连,所述电流传感器芯片输出端与第二处理芯片输入端相连。

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