[发明专利]显示设备及用于显示设备的接口切换方法在审
申请号: | 201710639764.9 | 申请日: | 2017-07-31 |
公开(公告)号: | CN107391071A | 公开(公告)日: | 2017-11-24 |
发明(设计)人: | 金三宝 | 申请(专利权)人: | 苏州佳世达电通有限公司 |
主分类号: | G06F3/14 | 分类号: | G06F3/14;G06F13/42;G06F13/40;H04N5/268 |
代理公司: | 北京万慧达知识产权代理有限公司11111 | 代理人: | 王虎 |
地址: | 215000 江*** | 国省代码: | 江苏;32 |
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摘要: | |||
搜索关键词: | 显示 设备 用于 接口 切换 方法 | ||
技术领域
本发明涉及显示设备技术领域,特别涉及一种显示设备及用于显示设备的接口切换方法。
背景技术
显示设备,如显示器、液晶电视及投影机等消费型电子产品,其基本参数如生产厂商,产品编号,支持的解析度或分辨率等都是按照VESA(Video Electronics Standards Association,视频电子标准协会)标准的EDID(Extended Display Identification Data,扩展显示标识数据)数据格式存储在显示设备专用的存储器中。信号输出设备,如外部计算机通过DDC(Display Data Channel,显示数据通道)读取存储器的EDID来识别显示设备的具体信息。对于显示设备提供的多种视频接口,比如VGA(Video Graphics Array模拟信号接口)、DVI(Digital Visual Interface数字信号接口)以及HDMI(High-Definition Multimedia Interface高清晰度多媒体信号接口)等,由于每种接口的特性和带宽不同,使得不同接口的EDID也不同。
图1是现有技术中双接口的显示设备的构成示意图。
参照图1,显示设备10包括微处理器11、VGA接口13、DVI接口14、与VGA接口13相连接的第一存储器15、以及与DVI接口14相连接的第二存储器16;信号输出设备20连接于显示设备10的VGA接口13或者DVI接口14。在此种构造中,显示设备10需要两个存储器分别存储VGA接口和DVI接口的EDID,当信号输出设备20连接VGA接口13时,读取到第一存储器15中的EDID内容,当信号输出设备20连接DVI接口14时,读取到第二存储器16中的EDID内容。
因此,现有技术中显示设备若有多个视频接口,则需要需要多个存储器分别存储每个接口的EDID,比如显示设备有VGA、DVI和HDMI三个接口,则需要三个存储器分别存储各接口的EDID,因此,现有技术中,由于显示设备需要多个存储器存储多个接口对应的EDID,存在制造成本较高的问题。
发明内容
为了解决现有技术中由于显示设备需要多个存储器存储多个接口对应的EDID导致制造成本较高的问题,本发明实施例提供了一种显示设备及用于显示设备的接口切换方法。所述技术方案如下:
第一方面,提供了一种显示设备,所述显示设备包括多个接口和接口切换装置,所述接口切换装置包括切换单元、存储器和处理器;
所述多个接口分别连接所述处理器;
所述切换单元包括多路信号通道以及用于切通和切断所述多路信号通道的多个通道切换端,所述多路信号通道分别连接多个接口;
所述多路信号通道还分别连接至所述存储器;
所述多路信号通道、所述多个通道切换端分别连接所述处理器;
所述处理器确定当前信号对应的接口,所述切换单元根据所述多个通道切换端接收到的所述处理器输出的控制信号,切通所述接口所对应的信号通道,同时切断其他信号通道。
结合第一方面,在第一种可能的实现方式中,所述处理器包括:
连接检测程序,用于检测接入设备与所述多个接口中的每个接口的连接状态;
确定程序,用于当所述连接检测程序检测出至少两个接口连接所述接入设备时,确定用户所选择的接口的当前信号,或者当所述连接检测程序检测出仅一个接口连接所述接入设备时,确定所述接口的当前信号;
控制程序,用于控制所述切换单元切通所述当前信号对应的信号通道,同时切断其他信号通道。
结合第一方面,在第二种可能的实现方式中,每路信号通道的输入端对应连接每个接口的输出端;
所述每路信号通道的输出端分别连接所述存储器的输入端和所述处理器的输入端。
结合第一方面的第二种可能的实现方式,在第三种可能的实现方式中,所述每路信号通道的所述输入端包括两个输入端子,所述每路信号通道的所述输出端包括两个输出端子,所述输入端子与所述输出端子相对应;
所述通道切换端切换所述输入端子与所述输出端子之间的通道。
结合第一方面的第三种可能的实现方式,在第四种可能实现的方式中,所述切换单元至少包括第一通道切换端、第二通道切换端、四个输入端子和两个输出端子;
所述四个输入端子分别为第一数据输入端子、第一时钟输入端子、第二数据输入端子和第二时钟输入端子;
所述两个输出端子分别为数据输出端子和时钟输出端子;
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