[发明专利]栅极芯片在审

专利信息
申请号: 201710453640.1 申请日: 2017-06-15
公开(公告)号: CN107068105A 公开(公告)日: 2017-08-18
发明(设计)人: 黄泰钧;徐京 申请(专利权)人: 深圳市华星光电技术有限公司
主分类号: G09G3/36 分类号: G09G3/36;G09G3/3266
代理公司: 深圳市德力知识产权代理事务所44265 代理人: 林才桂,刘巍
地址: 518132 广东*** 国省代码: 广东;44
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摘要:
搜索关键词: 栅极 芯片
【说明书】:

技术领域

发明涉及液晶面板及OLED面板领域,尤其涉及一种栅极芯片。

背景技术

液晶显示屏是液晶显示器的重要组成部分,液晶显示屏主要包括液晶面板、用于向液晶面板提供行扫描信号的栅极芯片以及用于向液晶面板提供数据信号的源极芯片。

传统的栅极芯片(Gate IC),其工作机制是配合源极芯片(Source IC)的输出,逐行依次扫描,其实现原理是基于移位寄存器的。然而,在一些特殊功能需求的电路中,需要非逐行地打开栅极线(Gate Line),传统的Gate IC则无法满足。因此,需要设计一种新型的Gate IC。

参见图1及图2,图1为传统栅极芯片的架构示意图,图2为图1的栅极芯片的驱动时序。传统栅极芯片主要包括移位寄存器(Shift Register)10,逻辑控制单元(Logic Control)11,电平转换器(Level Shifter)12,以及输出放大器(Output Buffer)13;该移位寄存器10连接该逻辑控制单元11,该逻辑控制单元11连接该电平转换器12,该电平转换器12连接该输出放大器13。Gate IC接收输入信号CPV(一般为栅极移位时钟信号)、DIO(一般为栅极启动信号)和OE(一般为栅极输出控制信号),在输入信号CPV、DIO和OE的控制下,Gate IC会依序逐行的输出行扫描信号G1~Gn,并依序提供给n条栅极线。其中,移位寄存器10根据栅极移位时钟信号CPV依次将栅极启动信号DIO进行移位。逻辑控制单元11对移位寄存器10的输出信号和输入的栅极输出控制信号OE进行逻辑运算,产生输出信号。电平转换器12利用输入的高电平信号VGH和低电平信号VGL将来自逻辑控制单元11的输入信号转换为适合于驱动栅极线。输出放大器13增强信号的驱动能力。

如图3所示,其为不适合于传统栅极芯片的特殊应用示意图,在一些特殊应用中,栅极线除了在AA区(有效显示区域)逐行依序打开(实线脉冲),还在Blank区(空白区域)内逐帧依序打开(虚线脉冲)。传统的Gate IC的扫描方式,每次都要从第一通道或最后通道开始输出,因而无法满足以上功能。

发明内容

因此,本发明的目的在于提供一种栅极芯片,可以在任何时候,都能控制指定的输出通道打开。

为实现上述目的,本发明提供一种栅极芯片,包括:数据分配器,逻辑控制单元,电平转换器,以及输出放大器;该数据分配器连接该逻辑控制单元,该逻辑控制单元连接该电平转换器,该电平转换器连接该输出放大器;在输入该栅极芯片的信号的控制下,通过该数据分配器的地址引脚的选择,该栅极芯片能够输出任意一条指定通道的行扫描信号。

其中,该数据分配器具有单通道输入引脚,多通道输出引脚以及地址引脚,通过配置该地址引脚从该多通道输出引脚中确定具体的输出通道。

其中,该逻辑控制单元将输入自身的信号进行组合逻辑运算后再输出。

其中,该电平转换器将输入自身的数字电平转换为相应的模拟电压。

其中,该输出放大器用于增强信号的驱动能力,增强该栅极芯片的行扫描信号的输出。

其中,还包括串并转换模块,该串并转换模块连接该数据分配器;该串并转换模块接收串行数据,将串行数据转换为并行数据,然后再传递给该数据分配器。

其中,该串行数据为I2C总线数据。

其中,该串行数据为SPI总线数据。

其中,该栅极芯片设有使能引脚,当多颗栅极芯片级联时,通过配置使能引脚选择工作的栅极芯片。

综上,本发明的栅极芯片通过地址引脚的选择,能够让栅极芯片输出任意一条指定的通道的行扫描信号;能够满足更多、更广泛的特殊时序需求;有利于实现产品地多样化。

附图说明

下面结合附图,通过对本发明的具体实施方式详细描述,将使本发明的技术方案及其他有益效果显而易见。

附图中,

图1为传统栅极芯片的架构示意图;

图2为图1的栅极芯片的驱动时序;

图3为不适合于传统栅极芯片的特殊应用示意图;

图4为本发明的栅极芯片一较佳实施例的架构示意图;

图5为本发明的栅极芯片一较佳实施例的数据分配器结构示意图;

图6为本发明的栅极芯片一较佳实施例的驱动时序图;

图7为本发明的栅极芯片一较佳实施例的串并转换模块示意图;

图8为本发明的栅极芯片一较佳实施例的级联示意图。

具体实施方式

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