[发明专利]互连结构及其制造方法在审
申请号: | 201611156276.4 | 申请日: | 2016-12-15 |
公开(公告)号: | CN108231659A | 公开(公告)日: | 2018-06-29 |
发明(设计)人: | 周鸣 | 申请(专利权)人: | 中芯国际集成电路制造(北京)有限公司;中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/768 | 分类号: | H01L21/768;H01L23/532 |
代理公司: | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人: | 孙宝海 |
地址: | 100176 北京市*** | 国省代码: | 北京;11 |
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摘要: | |||
搜索关键词: | 电介质层 碳氟化合物层 互连结构 金属互连层 硬掩模层 通孔 半导体技术领域 沉积金属 沉积碳氟 化合物层 基本齐平 平坦化 图案化 刻蚀 掩模 填充 制造 金属 | ||
1.一种互连结构的制造方法,其特征在于,包括:
提供在金属互连层上的电介质层,所述电介质层包括多孔低k或超低k电介质层,所述多孔低k或超低k电介质层包括SiOCH;
在所述电介质层上沉积含氢的碳氟化合物层;
在所述碳氟化合物层上形成图案化的硬掩模层;
以所述硬掩模层为掩模刻蚀所述碳氟化合物层和所述电介质层,以形成到所述电介质层中的沟槽和到所述金属互连层的通孔;
沉积金属以填充所述沟槽和所述通孔;
执行平坦化工艺,以使得剩余的金属和剩余的碳氟化合物层基本齐平。
2.根据权利要求1所述的方法,其特征在于,所述硬掩膜层具有延伸到所述硬掩膜层中的第一开口;
所述以所述硬掩模层为掩模刻蚀所述碳氟化合物层和所述电介质层,以形成到所述电介质层中的沟槽和到所述金属互连层的通孔包括:
在所述硬掩模层上形成图案化的第一掩模层,所述第一掩模层具有延伸到所述第一开口的底部的第二开口;
以所述第一掩模层为掩模刻蚀所述硬掩模层、所述碳氟化合物层和所述电介质层,从而形成到所述电介质层中的第三开口;
去除所述第一掩模层;
以剩余的硬掩模层为掩模去除所述第三开口下的电介质层,并去除第一开口下的硬掩模层、碳氟化合物层和电介质层的一部分,从而形成所述沟槽和所述通孔。
3.根据权利要求2所述的方法,其特征在于,
所述第一掩模层具有延伸到所述第一开口的底部的两个第二开口,从而形成到所述金属互连层的两个通孔。
4.根据权利要求2所述的方法,其特征在于,所述在所述碳氟化合物层上形成图案化的硬掩模层包括:
在所述碳氟化合物层上依次形成第一硬掩模层、第二硬掩模层和第三硬掩模层;
在所述第三硬掩模层之上形成图案化的第二掩模层;
以所述第二掩模层为掩模刻蚀所述第三硬掩模层和所述第二硬掩模层,从而形成延伸到所述第二硬掩模层中或延伸到所述第一硬掩模层的表面的第一开口;
去除所述第二掩模层。
5.根据权利要求4所述的方法,其特征在于,所述在所述第三硬掩模层之上形成图案化的第二掩模层包括:
在所述第三硬掩模层上形成遮蔽氧化物层;
在所述遮蔽氧化物层上形成所述第二掩模层;
所述以所述第二掩模层为掩模刻蚀所述第三硬掩模层和所述第二硬掩模层包括:
以所述第二掩模层为掩模刻蚀所述遮蔽氧化物层、所述第三硬掩模层和所述第二硬掩模层;
在去除所述第二掩模层之后,所述方法还包括:
去除剩余的遮蔽氧化物层。
6.根据权利要求4所述的方法,其特征在于,
所述第一硬掩模层包括无孔的SiOCH;
所述第二硬掩模层包括TEOS;
所述第三硬掩模层包括TiN。
7.根据权利要求1所述的方法,其特征在于,在沉积金属前,还包括:
执行加热处理,以去除所述电介质层中的水分。
8.根据权利要求7所述的方法,其特征在于,在100-400℃的温度范围内,并以氮气、氨气和联氨中的至少一种气体作为保护气体来执行所述加热处理。
9.根据权利要求1所述的方法,其特征在于,还包括:
在剩余的金属和剩余的碳氟化合物层上沉积SiCN层。
10.根据权利要求1所述的方法,其特征在于,所述电介质层包括在所述金属互连层上的SiCN层、在所述SiCN层上的缓冲层和在所述缓冲层上的所述多孔低k电介质层。
11.根据权利要求1所述的方法,其特征在于,所述碳氟化合物层的厚度为5-1000埃。
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H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造