[发明专利]FPGA器件以及使用该器件的AMOLED显示电路在审

专利信息
申请号: 201610516241.0 申请日: 2016-07-04
公开(公告)号: CN107578745A 公开(公告)日: 2018-01-12
发明(设计)人: 陆磊 申请(专利权)人: 上海和辉光电有限公司
主分类号: G09G3/3225 分类号: G09G3/3225
代理公司: 上海申新律师事务所31272 代理人: 俞涤炯
地址: 201506 上海市*** 国省代码: 上海;31
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摘要:
搜索关键词: fpga 器件 以及 使用 amoled 显示 电路
【说明书】:

技术领域

发明涉及显示电路设计领域,尤其涉及一种FPGA器件以及使用该器件的AMOLED显示电路。

背景技术

目前在设计基于FPGA(Field Programmable Gate Array,现场可编程门阵列)平台的AMOLED(Active Matrix/Organic Light Emitting Diode,主动矩阵有机发光二极体面板)屏幕显示电路时,多以一个FPGA IC(integrated circuit,集成电路)搭配一个EEPROM(Electrically Erasable Programmable Read-Only Memory,电可擦只读存储器)IC应用,先以FPGA为载体,基于SPI(Serial Peripheral Interface,串行外设接口)通信,将代码(code)烧录到EEPROM中,后续运用再由FPGA读取EEPROM中的code,转换成相应的信号,控制整个电路。这种设计方式的一个严重弊端是一旦EEPROM线路出现严重损坏,无法维修时,整个线路板都一起报废。

因此,亟需设计一种新的线路结构,确保在EEPROM线路出现严重损坏的状况下,让其他线路部分依然可以再利用,不至于报废整个线路板,从而提高线路板的利用率。

发明内容

鉴于上述技术问题,本发明旨在提供一种模块化设计的FPGA器件以及使用该器件的AMOLED显示电路,以解决基于FPGA的EEPROM线路出现严重损坏,无法维修时,整个线路板无法再利用的问题。

本发明解决上述技术问题的主要技术方案为:

一种FPGA器件,应用于AMOLED显示电路中,其特征在于,所述FPGA器件包括FPGA电路和EEPROM,所述FPGA电路通过插接方式与所述EEPROM通信连接,以对所述EEPROM进行读/写操作。

优选的,上述的FPGA器件,其中,所述FPGA电路与所述EEPROM之间采用串行外设接口协议进行通信连接。

优选的,上述的FPGA器件还包括:

公共连接器,与所述FPGA电路连接,不同规格的所述EEPROM通过所述公共连接器以插接方式与所述FPGA电路通信连接。

优选的,上述的FPGA器件,其中,所述公共连接器包括:

母连接器,与所述FPGA电路连接;

子连接器,与所述EEPROM连接;

其中,所述子连接器与所述母连接器对接,以将所述EEPROM与所述FPGA电路通信连接。

优选的,上述的FPGA器件,其中,所述母连接器具有6个引脚,包括:

工作电压引脚,与所述FPGA电路的工作电压端对应连接;

串行时钟引脚,与所述FPGA电路的串行时钟端对应连接;

主出从入引脚,与所述FPGA电路的主出从入端对应连接;

主入从出引脚,与所述FPGA电路的主入从出端对应连接;

从机选择引脚,与所述FPGA电路的从机选择端对应连接;以及

接地引脚,与所述FPGA电路的接地端对应连接。

优选的,上述的FPGA器件,其中,所述母连接器采用双列直插式封装。

优选的,上述的FPGA器件,其中,所述子连接器具有6个引脚,包括:

工作电压引脚,与所述EEPROM的工作电压引脚对应连接;

串行时钟引脚,与所述EEPROM的串行时钟引脚对应连接;

主出从入引脚,与所述EEPROM的主出从入引脚对应连接;

主入从出引脚,与所述EEPROM的主入从出引脚对应连接;

从机选择引脚,与所述EEPROM的从机选择引脚对应连接;以及

接地引脚,与所述EEPROM的接地引脚对应连接。

优选的,上述的FPGA器件,其中,所述子连接器采用双列直插式封装。

优选的,上述的FPGA器件,其中,所述EEPROM中存储有用于点亮复数种规格的AMOLED显示屏幕的代码。

本发明还提供一种AMOLED显示电路,其特征在于,包括上述的FPGA器件,以及通过所述FPGA电路与所述EEPROM通信连接的信号转换电路;

其中,所述FPGA电路读取所述EEPROM中存储的代码并发送至所述信号转换电路,所述信号转换电路将所述代码换成电信号,以控制所述AMOLED显示电路的运行。

上述技术方案具有如下优点或有益效果:

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