[发明专利]DDR地址映射系统和方法有效

专利信息
申请号: 201510991145.7 申请日: 2015-12-24
公开(公告)号: CN106919516B 公开(公告)日: 2020-06-16
发明(设计)人: 丁少华 申请(专利权)人: 辰芯科技有限公司;大唐半导体设计有限公司
主分类号: G06F12/06 分类号: G06F12/06
代理公司: 北京品源专利代理有限公司 11332 代理人: 孟金喆
地址: 201206 上海市浦东新区中国(上海*** 国省代码: 上海;31
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摘要:
搜索关键词: ddr 地址 映射 系统 方法
【权利要求书】:

1.一种DDR地址映射系统,通过row,bank,col方式进行地址映射,其中row代表行地址,col代表列地址,bank代表块地址,其特征在于,不同模块访问所述DDR的地址位于不同的块;其中,不同模块访问所述DDR的地址位于不同的块的实现方式是:在DDR的指定地址空间内进行地址重排,使得该空间内通过bank,row,col的方式进行地址映射。

2.如权利要求1所述的DDR地址映射系统,其特征在于,所述不同模块至少包含数字信号处理器、CPU、信号处理加速器、GPU和DMA其中之二。

3.如权利要求2所述的DDR地址映射系统,其特征在于,所述不同模块属于同一移动终端。

4.如权利要求1所述的DDR地址映射系统,其特征在于,在所述指定地址空间内进行地址重排时,将所述指定地址空间平均分配给多个块。

5.如权利要求1所述的DDR地址映射系统,其特征在于,通过规定所述指定地址空间的起始地址大小和所述指定地址空间的大小获取所述指定地址空间。

6.如权利要求5所述的DDR地址映射系统,其特征在于,所述指定地址空间的大小为所述指定地址空间的起始地址不为零时,其大小为

其中,N、M为整数,N为设定重排空间的行的bit数,Nbank为所述DDR的bank的数量2的对数,Ncol为所述DDR的col的大小的2的对数,Nbus为所述DDR总线的大小的2的对数,上述DDR总线的大小以byte为单位。

7.如权利要求1所述的DDR地址映射系统,其特征在于,不同模块访问所述DDR的地址位于不同的块的实现方式是:将同一模块访问的某一段地址划分至同一个块,其余地址做适应性调整。

8.一种DDR地址映射方法,通过row,bank,col方式进行地址映射,其中row代表行地址,col代表列地址,bank代表块地址,其特征在于,不同模块访问所述DDR的地址设置于不同的块;其中,不同模块访问所述DDR的地址位于不同的块的实现方式是:在DDR的指定地址空间内进行地址重排,使得该空间内通过bank,row,col的方式进行地址映射。

9.如权利要求8所述的DDR地址映射方法,其特征在于,所述不同模块至少包含数字信号处理器、CPU、信号处理加速器、GPU或DMA其中之二。

10.如权利要求9所述的DDR地址映射方法,其特征在于,所述不同模块属于同一移动终端。

11.如权利要求8所述的DDR地址映射方法,其特征在于,在所述指定地址空间内进行地址重排时,将所述指定地址空间平均分配给多个块。

12.如权利要求8所述的DDR地址映射方法,其特征在于,通过规定所述指定地址空间的起始地址大小和所述指定地址空间的大小获取所述指定地址空间。

13.如权利要求12所述的DDR地址映射方法,其特征在于,所述指定地址空间的大小为所述指定地址空间的起始地址不为零时,其大小为

其中,N、M为整数,N为设定重排空间的行的bit数,Nbank为所述DDR的bank的数量2的对数,Ncol为所述DDR的col的大小的2的对数,Nbus为所述DDR总线的大小的2的对数,上述DDR总线的大小以byte为单位。

14.如权利要求8所述的DDR地址映射方法,其特征在于,不同模块访问所述DDR的地址位于不同的块的实现方式是:将同一模块访问的某一段地址划分至同一个块,其余地址做适应性调整。

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